[发明专利]射频拉远单元及RRU与BBU组网系统有效

专利信息
申请号: 202011043050.X 申请日: 2020-09-28
公开(公告)号: CN111885617B 公开(公告)日: 2020-12-15
发明(设计)人: 沈杰;吴涛;陈高强;王剑侠;蒋旭晨;张小龙 申请(专利权)人: 三维通信股份有限公司
主分类号: H04W16/18 分类号: H04W16/18;H04W88/08;H04B1/40
代理公司: 杭州华进联浙知识产权代理有限公司 33250 代理人: 聂磊
地址: 310000 浙江*** 国省代码: 浙江;33
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摘要:
搜索关键词: 射频 单元 rru bbu 组网 系统
【权利要求书】:

1.一种射频拉远单元,其特征在于,所述射频拉远单元不具有CPU单元,所述射频拉远单元包括:FPGA单元、数字中频单元、射频单元和第一网络接口单元,所述FPGA单元、所述数字中频单元和所述射频单元依次连接;所述第一网络接口单元与所述FPGA单元通过RMII接口连接,所述FPGA单元通过CPRI接口与基带处理单元建立第一通信连接;其中,所述FPGA单元用于从所述第一网络接口单元接收RMII接口协议数据,通过所述第一通信连接将所述RMII接口协议数据传输给所述基带处理单元的CPU单元,接收所述基带处理单元的CPU单元响应于所述RMII接口协议数据的第一响应数据。

2.根据权利要求1所述的射频拉远单元,其特征在于,所述FPGA单元包括控制单元和数字处理单元,所述控制单元通过所述RMII接口与所述第一网络接口单元连接,所述控制单元与所述数字处理单元连接,所述控制单元还通过串行通信分别与所述数字中频单元和所述射频单元连接,所述数字处理单元还分别与所述CPRI接口和所述数字中频单元连接;其中,

所述数字处理单元至少用于对所述RMII接口协议数据和所述第一响应数据进行数字信号处理;

所述控制单元至少用于从所述第一网络接口单元接收所述RMII接口协议数据、控制所述CPRI接口与所述基带处理单元的CPRI接口对接传输、控制所述数字处理单元进行数字信号处理以及接收经过数字信号处理的所述第一响应数据。

3.根据权利要求2所述的射频拉远单元,其特征在于,所述串行通信包括以下其中一种:SPI通信、I²C通信。

4.根据权利要求1至3任一项所述的射频拉远单元,其特征在于,所述射频拉远单元还包括存储单元,所述存储单元通过串行通信与所述FPGA单元连接,其中,所述存储单元用于存储预设配置程序,所述FPGA单元还用于通过预设配置模式从所述存储单元读取所述预设配置程序。

5.根据权利要求4所述的射频拉远单元,其特征在于,所述预设配置模式包括主动串行配置模式。

6.根据权利要求4所述的射频拉远单元,其特征在于,所述射频拉远单元还包括电源单元,所述电源单元与所述FPGA单元、所述数字中频单元和所述射频单元电连接;其中,所述电源单元至少用于为所述FPGA单元、所述数字中频单元和所述射频单元供电。

7.一种如权利要求1至6任一项所述的射频拉远单元的工作方法,其特征在于,包括如下步骤:

所述FPGA单元拉取所述射频拉远单元存储的预设配置程序;

所述FPGA单元根据所述预设配置程序执行第一功能,其中,所述第一功能至少包括:所述FPGA单元通过CPRI接口与基带处理单元建立第一通信连接,并将从所述第一网络接口单元接收的所述RMII接口协议数据通过所述第一通信连接传输给所述基带处理单元的CPU单元、所述FPGA单元接收所述基带处理单元的CPU单元响应于所述RMII接口协议数据的第一响应数据,并根据所述第一响应数据配置所述数字中频单元和/或所述射频单元。

8.一种RRU与BBU组网系统,包括基带处理单元和至少一个射频拉远单元,其特征在于,所述射频拉远单元为权利要求1至6任一项所述的射频拉远单元,所述基带处理单元通过CPRI接口与所述至少一个射频拉远单元的CPRI接口建立第一通信连接;其中,所述基带处理单元用于通过所述第一通信连接读取所述至少一个射频拉远单元的RMII接口上的RMII接口协议数据,并建立所述基带处理单元的第二网络接口单元与所述至少一个射频拉远单元的第一网络接口单元的以太网连接,和/或,通过所述第一通信连接进行IQ数据和OAM信令数据传输。

9.根据权利要求8所述的RRU与BBU组网系统,其特征在于,所述基带处理单元具有CPU单元,所述CPU单元通过所述第一通信连接与所述射频拉远单元的所述FPGA单元连接,其中,所述CPU单元至少用于接收所述射频拉远单元的所述FPGA单元传输的RMII接口协议数据,发送响应于所述RMII接口协议数据的所述第一响应数据。

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