[发明专利]SiGe(:B):Ga层的形成在审
申请号: | 202011179473.4 | 申请日: | 2020-10-29 |
公开(公告)号: | CN112928014A | 公开(公告)日: | 2021-06-08 |
发明(设计)人: | A·西卡韦;C·波瑞特 | 申请(专利权)人: | IMEC非营利协会 |
主分类号: | H01L21/02 | 分类号: | H01L21/02;H01L29/161;H01L29/167;C23C16/18;C23C16/22;C23C16/52 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 王颖;江磊 |
地址: | 比利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | sige ga 形成 | ||
1.一种形成Ga掺杂的SiGe层(40)的方法,所述方法包括:
a.在含C的Ga前体存在下,在基材(10)上沉积Ga掺杂的SiGe,从而形成Ga掺杂的SiGe层(40)的第一部分;和
b.在不存在含C的Ga前体的情况下,在第一部分(20)上沉积SiGe,从而形成Ga掺杂的SiGe层(40)的第二部分(30);
其中,Ga掺杂的SiGe层(40)的各部分,即在步骤a中沉积的Ga掺杂的SiGe和在步骤b中沉积的SiGe均任选地是B掺杂的。
2.如权利要求1所述的方法,其中,步骤a和/或步骤b中的沉积包括外延工艺。
3.如前述权利要求中任一项所述的方法,其中,步骤a是使用Si前体,Ge前体,B前体和含C的Ga前体进行的;并且步骤b包括在没有含C的Ga前体的情况下继续进行步骤a的沉积。
4.如前述权利要求中任一项所述的方法,其中,步骤a和/或步骤b中的沉积在450℃或更低的温度下进行。
5.如前述权利要求中任一项所述的方法,其中,Si前体是高阶硅烷,并且/或者Ge前体是高阶锗烷。
6.如前述权利要求中任一项所述的方法,其在步骤a和/或步骤b之后还包括步骤c:
c.回蚀Ga掺杂的SiGe层(40)。
7.如权利要求6所述的方法,其中,使用基于Cl的蚀刻剂进行步骤c。
8.如权利要求6或7所述的方法,其中,所述方法用于相对于氧化物或氮化物表面,在半导体表面上区域选择性地形成SiGe(:B):Ga层(40)。
9.如前述权利要求中任一项所述的方法,其中,包括步骤a,b和任选的c的工序重复至少两次。
10.一种Ga掺杂的SiGe层(40),其包括:
i.包含第一浓度的C的第一部分(20),
ii.在第一部分(20)上的第二部分(30),所述第二部分(30)包含第二浓度的C;
其中,第二浓度至少小于第一浓度的二分之一,优选至少小于第一浓度的五分之一,更优选至少小于第一浓度的十分之一,和
其中,Ga掺杂的SiGe层(40)任选地是B掺杂的。
11.如权利要求10所述的Ga掺杂的SiGe层(40),其中,第一部分(20)的厚度为第二部分(30)的厚度的0.05至20倍,优选为0.1至10倍,更优选为0.2至5倍,更优选为0.3至3倍,最优选为0.5至2倍。
12.如权利要求10或11所述的Ga掺杂的SiGe层(40),其中,第一部分(20)的厚度和/或第二部分(30)的厚度为1至50nm,优选为2至25nm,更优选为3至15nm,更优选为5至10nm。
13.一种形成用于半导体器件的Ga掺杂的SiGe结构的方法,其包括如权利要求1至9中任一项所述的方法。
14.一种用于半导体器件的Ga掺杂的SiGe结构,其包括如权利要求10至13中任一项所述的Ga掺杂的SiGe层(40)。
15.如权利要求14所述的Ga掺杂的SiGe结构,其为源极区和/或漏极区。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造