[发明专利]一种基于拥塞协商的拆线重布方法、设备及可读存储介质在审
申请号: | 202011218755.0 | 申请日: | 2020-11-04 |
公开(公告)号: | CN112149378A | 公开(公告)日: | 2020-12-29 |
发明(设计)人: | 黄海山;张亚东;叶锦涛;陈家瑞;陈建利;刘伟平;李起宏;陆涛涛 | 申请(专利权)人: | 深圳华大九天科技有限公司 |
主分类号: | G06F30/394 | 分类号: | G06F30/394;G06F30/3947;G06F119/20 |
代理公司: | 北京德崇智捷知识产权代理有限公司 11467 | 代理人: | 王金双 |
地址: | 518100 广东省深圳市福田区福保街*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 基于 拥塞 协商 拆线 方法 设备 可读 存储 介质 | ||
一种基于拥塞协商的拆线重布方法、设备及可读存储介质,所述方法包括以下步骤:输入版图信息,根据多波扩展算法构造出所有线网的斯坦纳树;根据布线生成的路径记录当前布线代价,根据标记设计规则检测的类型惩罚标记边,增加标记边上网格点的拥塞代价;拆除已有布线,根据更新代价值进行多波扩展算法迭代重新布线;满足迭代次数或DRC清零后布线结束。本发明的基于拥塞协商的拆线重布方法,设备及可读存储介质,能够利用历史布线信息指导解决详细布线阶段的拥塞问题,将之前布线结果中拥塞的线网逐渐散开,获取高质量的布线结果。
技术领域
本发明涉及VLSI设计自动化技术领域,特别是涉及一种超大规模集成电路(VLSI)多线网(net)的详细布线拥塞解决方法。
背景技术
在VLSI详细布线阶段,需要确定每条net的具体走线。布线结果的好坏直接影响整个芯片的性能,该问题是一个 NP-完全问题。近年来, 随着集成电路制造工艺的迅速发展,芯片集成度和复杂性不断增加。通常一次详细布线后往往会造成局部的拥塞,导致很多net不符合连接性约束,如不满足Short(重叠)约束、Open(连通)约束,以及不符合设计规则检测(DRC)约束,如Spacing(间距)约束等。因此在详细布线阶段往往需要进行多次的布线,花费大量的计算时间并且布线的质量不够理想。因此,设计能够有效处理VLSI多线网详细布线的拥塞解决方法已成为VLSI设计自动化的关键问题之一。
人们提出了一些拥塞解决方法。有一类是基于多商品流和整数线性规划的布线模型, 这类方法往往非常耗时, 甚至无法求解。因此,亟待出现一种高效的用于VLSI多线网详细布线的拥塞解决方法。
发明内容
为了解决现有技术存在的不足,本发明的目的在于提供一种基于拥塞协商的拆线重布方法、设备及可读存储介质,能够利用历史布线信息指导解决详细布线阶段的拥塞问题,将之前布线结果中拥塞的线网逐渐散开,从而解决拥塞,获取高质量的布线结果。
为实现上述目的,本发明提供的一种基于拥塞协商的拆线重布方法,包括以下步骤,
输入版图信息,根据多波扩展算法构造出所有线网的斯坦纳树;
根据布线生成的路径记录当前布线代价,根据标记设计规则检测的类型惩罚标记边,增加标记边上网格点的拥塞代价;
拆除已有布线,根据更新代价值进行多波扩展算法迭代重新布线;
满足迭代次数或DRC清零后布线结束。
进一步地,所述输入版图信息,根据多波扩展算法构造出所有线网的斯坦纳树的步骤,进一步包括,
读入布线输入版图信息中所有线网的端口图形,包括端口图形的大小、层次以及各层的间隔规则;
根据网格将布线区域构造为行乘列的棋盘地图结构,所述端口图形分布在所述棋盘地图内;
根据kruscal和dijkstra的多波扩展算法为每一个所述端口图形维护一个优先队列,选择最小代价的结点进行扩展。
进一步地,所述根据kruscal和dijkstra的多波扩展算法为每一个所述端口图形维护一个优先队列,选择最小代价的结点进行扩展的步骤,进一步包括,根据最小代价结点依次连接两个最近的端口图形,当扩展结点穿越两个相邻的矩形块时,构成一段布线路径。
进一步地,所述根据布线生成的路径记录当前布线代价,根据标记设计规则检测的类型惩罚标记边,增加标记边上网格点的拥塞代价的步骤,进一步包括,
获取当前设计规则检测的标记类型,若产生重叠约束类型,增加当前标记边结点拥塞代价;
若产生间距约束类型,将标记边向拥塞方向膨胀二分之一线宽后,增加相应标记边结点拥塞代价。
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