[发明专利]片上一致性互联结构、缓存一致性互联方法及系统在审
申请号: | 202011333035.9 | 申请日: | 2020-11-24 |
公开(公告)号: | CN112463687A | 公开(公告)日: | 2021-03-09 |
发明(设计)人: | 杨凯歌;林江;曹俊 | 申请(专利权)人: | 海光信息技术股份有限公司 |
主分类号: | G06F13/40 | 分类号: | G06F13/40;G06F13/42;G06F13/364 |
代理公司: | 北京市广友专利事务所有限责任公司 11237 | 代理人: | 张仲波 |
地址: | 300000 天津市滨海新区天津华苑*** | 国省代码: | 天津;12 |
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摘要: | |||
搜索关键词: | 一致性 联结 缓存 方法 系统 | ||
本发明实施例公开了一种片上一致性互联结构、缓存一致性互联方法及系统,其中,片上一致性互联结构,包括:至少一个计算快速链接CXL端口,用于与CXL设备相连;端口控制器,用于通过CXL端口与CXL设备进行耦合,通过CXL端口使用CXL.cache协议、CXL.mem协议以及CXL.io协议中的至少一种CXL协议向CXL设备发送事务请求或接收CXL设备的响应,该片上一致性互联结构可提高处理器的兼容性。
技术领域
本发明涉及计算机技术领域,尤其涉及一种片上一致性互联结构、缓存一致性互联方法及系统。
背景技术
计算机系统中的不同元件、电路板或者服务器节点之间通过互联总线标准相互通信。例如,常用的PCIe(Peripheral Component Interconnect express,高速串行计算机扩展总线标准),提供了主板上各个元件之间的互联,并且使得包含PCIe接口的扩展模块可以通过PCIe插槽扩展到计算机系统中。PCIe作为输入/输出(I/O)协议工作良好,但是在多核以及异构系统中,它不能提供足够的支持。
如今,用户对计算机计算能力的需求越来越高,服务器用户的需求尤其明显。为了提高计算机的计算能力涌现出诸如FPGA(Field Programmable Gate Array,现场可编程逻辑门阵列)、GPU(Graphics Processing Unit,图形处理器)等加速芯片,但是由于PCIe标准不能很好解决CPU和设备以及设备与设备之间的一致性互联要求,于是出现了CXL(ComputeExpress Link,计算快速链接)标准组织,以实现CPU与诸如GPU、FPGA等(数据中心)专用加速芯片间的快速互联。
CXL标准实现了CPU与加速芯片或扩展存储之间的一致性互联,但是由于一些CPU内有自身的互联标准,需要将内部互联标准和CXL进行兼容扩展才能实现从CPU的互联标准到CXL标准的兼容和扩展。使用这种兼容和扩展的CPU才可以通过CXL兼容接口扩展使用CXL标准的设备。
发明内容
有鉴于此,本发明实施例提供一种片上一致性互联结构、缓存一致性互联方法及系统,能够有效提高处理器的兼容性。
第一方面,本发明实施例提供一种片上一致性互联结构,包括:至少一个计算快速链接CXL端口,用于与CXL设备相连;端口控制器,用于通过CXL端口与CXL设备进行耦合,通过CXL端口使用CXL.cache协议、CXL.mem协议以及CXL.io协议中的至少一种CXL协议向CXL设备发送事务请求或接收CXL设备的响应。
可选的,所述端口控制器,包括:第一CXL模块,用于使用CXL.cache协议向CXL设备发送事务请求以及接收CXL设备的响应;第二CXL模块,用于使用CXL.mem协议向CXL设备发送事务请求以及接收CXL设备的响应;第三CXL模块,用于使用CXL.io协议向CXL设备发送事务请求或接收CXL设备的响应。
可选的,所述端口控制器还包括:协议控制器,用于响应于所述CXL设备中包括高速缓存,控制所述第一CXL模块使用CXL.cache协议与所述CXL设备通信,以及控制所述第三CXL模块使用CXL.io协议与所述CXL设备通信,以向所述CXL设备发送所述事务请求以及接收所述CXL设备的响应;响应于所述CXL设备中包括可访问存储器,控制所述第二CXL模块使用CXL.mem协议与所述CXL设备通信,以及控制所述第三CXL模块使用CXL.io协议与所述CXL设备通信,以向所述CXL设备发送所述事务请求以及接收所述CXL设备的响应;响应于所述CXL设备中包括高速缓存以及可访问存储器,控制所述第一CXL模块使用CXL.cache协议与所述CXL设备通信,控制所述第二CXL模块使用CXL.mem协议与所述CXL设备通信,以及控制所述第三CXL模块使用CXL.io协议与所述CXL设备通信,以向所述CXL设备发送事务请求或接收所述CXL设备的响应。
可选的,所述第一CXL模块还作为所述片上一致性互联结构中的一致性主模块。
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