[发明专利]用于多级存储器的高效的管理的装置和方法在审

专利信息
申请号: 202011478702.2 申请日: 2020-12-15
公开(公告)号: CN113448882A 公开(公告)日: 2021-09-28
发明(设计)人: E·希弗;Z·A·奇什蒂;S·K·库马尔;Z·格林菲尔德;P·兰茨;E·塞林;A·鲁宾斯坦;R·J·小罗耶 申请(专利权)人: 英特尔公司
主分类号: G06F12/0897 分类号: G06F12/0897;G06F3/06
代理公司: 永新专利商标代理有限公司 72002 代理人: 刘瑜
地址: 美国加*** 国省代码: 暂无信息
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摘要:
搜索关键词: 用于 多级 存储器 高效 管理 装置 方法
【权利要求书】:

1.一种装置,包括:

存储器控制器,其用于与包括近存储器和远存储器的多级存储器接合,所述存储器控制器用于维护第一高速缓存和第二高速缓存,所述第一高速缓存用于缓存从所述远存储器近期访问的页面,所述第二高速缓存用于缓存从所述远存储器近期访问的页面的地址,所述第二高速缓存具有第一级和第二级,所述第一级用于缓存这样的页面的地址:与其相应的地址被缓存在所述第二级中的页面相比这些页面更近期地被访问,所述存储器控制器用于将以下(a)和(b)中的任一个或二者通知系统软件:

(a)比所述第一高速缓存中的其他页面更少被访问的所述第一高速缓存中的第一页面是从所述远存储器迁移到所述近存储器的候选;

(b)其地址在所述第二高速缓存的所述第一级和所述第二级之间进行了门限数量的往返的第二页面是从所述远存储器迁移到所述近存储器的候选。

2.根据权利要求1所述的装置,其中,所述第二高速缓存的所述第一级与所述存储器控制器实现在相同的半导体芯片上。

3.根据权利要求1所述的装置,其中,所述存储器控制器包括第一逻辑电路,所述第一逻辑电路用于跟踪对这样的页面的高速缓存行的访问:其相应的地址被输入到所述第二高速缓存中。

4.根据权利要求3所述的装置,其中,所述存储器控制器包括第二逻辑电路,所述第二逻辑电路用于通知系统软件:

(a)具有已经被访问多于一次的高速缓存行的第三页面是从所述远存储器迁移到所述近存储器的候选;

(b)具有门限数量的已经被访问的高速缓存行的第四页面是从所述远存储器迁移到所述近存储器的候选。

5.根据权利要求1所述的装置,其中,所述存储器控制器用于维护日志,所述日志标识从远存储器迁移到了近存储器并且然后在其迁移之后被写入了近存储器中的页面。

6.根据权利要求1所述的装置,其中,所述日志将对于系统软件可用。

7.根据权利要求3所述的装置,其中,如果所述第三页面在其进入到所述第一高速缓存中之后被写入,则脏位被断言。

8.一种计算系统,包括:

多个处理核心;

网络接口;

多级主存储器,其包括近存储器和远存储器;

主存储器控制器,其耦合到所述多级主存储器,所述存储器控制器用于维护第一高速缓存和第二高速缓存,所述第一高速缓存用于缓存从所述远存储器近期访问的页面,所述第二高速缓存用于缓存从所述远存储器近期访问的页面的地址,所述第二高速缓存具有第一级和第二级,所述第一级用于缓存这样的页面的地址:与其相应的地址被缓存在所述第二级中的页面相比这些页面更近期地被访问,所述存储器控制器用于将以下(a)和(b)中的任一个或二者通知系统软件:

(a)比所述第一高速缓存中的其他页面更少被访问的所述第一高速缓存中的第一页面是从所述远存储器迁移到所述近存储器的候选;

(b)其地址在所述第二高速缓存的所述第一级和所述第二级之间进行了门限数量的往返的第二页面是从所述远存储器迁移到所述近存储器的候选。

9.根据权利要求8所述的计算系统,其中,所述第二高速缓存的所述第一级与所述存储器控制器实现在相同的半导体芯片上。

10.根据权利要求8所述的计算系统,其中,所述存储器控制器包括第一逻辑电路,所述第一逻辑电路用于跟踪对这样的页面的高速缓存行的访问:其相应的地址被输入到所述第二高速缓存中。

11.根据权利要求10所述的计算系统,其中,所述存储器控制器包括第二逻辑电路,所述第二逻辑电路用于通知系统软件:

(a)具有已经被访问多于一次的高速缓存行的第三页面是从所述远存储器迁移到所述近存储器的候选;

(b)具有门限数量的已经被访问的高速缓存行的第四页面是从所述远存储器迁移到所述近存储器的候选。

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