[发明专利]一种双总线高速图像处理系统及方法有效
申请号: | 202011561705.2 | 申请日: | 2020-12-25 |
公开(公告)号: | CN112597088B | 公开(公告)日: | 2022-07-22 |
发明(设计)人: | 武春风;沈志;吴丰阳;高洋;刘明川;王晓丹;胡奇 | 申请(专利权)人: | 航天科工微电子系统研究院有限公司 |
主分类号: | G06F13/40 | 分类号: | G06F13/40;G06F13/42;G06F13/374;G06F13/376;G06T1/20;G06T1/60;G06T1/00 |
代理公司: | 成都九鼎天元知识产权代理有限公司 51214 | 代理人: | 贾年龙 |
地址: | 610000 四川省成都市天府*** | 国省代码: | 四川;51 |
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摘要: | |||
搜索关键词: | 一种 总线 高速 图像 处理 系统 方法 | ||
1.一种双总线高速图像处理系统,其特征在于,包括计算机主机板、数据存储板、信号处理板、接口处理板、高速互联底板和对外连接器接口;计算机主机板用于控制与管理、高速总线图像数据分析、低速总线命令分析和通用数据处理;数据存储板用于高速总线图像数据的存储和分析;信号处理板用于高速总线图像数据的图像处理,并输出相关结果数据;接口处理板用于模数转换、外部数据与内部数据的预处理、高速/低速数据交换;高速互联底板用于实现计算机主机板、数据存储板、信号处理板、接口处理板、电源板、对外连接器接口间的高速互联;对外连接器接口用于接插件物理层与高速互联底板的连接。
2.根据权利要求1所述的一种双总线高速图像处理系统,其特征在于,所述计算机主机板包括CPU和SRIO芯片;所述数据存储板包括第一FPGA单元;所述接口处理板包括第一SRIO交换机和第二FPGA单元;所述信号处理板包括DSP、第三FPGA单元和第二SRIO交换机;第二FPGA单元包括4组SRIO X4通道接口与第一SRIO交换机互联;第二SRIO交换机包括2组SRIOX4接口与第一SRIO交换机互联,信号处理板内的DSP0、DSP1、DSP2、DSP3通过1组SRIO X4通道接口分别与第二SRIO交换机连接,信号处理板内的第三FPGA单元通过4组SRIO X4通道接口与第二SRIO交换机连接;数据存储板包括2组SRIO X4接口与接口处理板中的第一SRIO交换机互联;计算机主机板包括1组SRIO X4接口与接口处理板中的第一SRIO交换机互联。
3.根据权利要求1或2所述的一种双总线高速图像处理系统,其特征在于,所述接口处理板包括第一网络交换机;所述信号处理板包括第二网络交换机,通过1000BASE-T接口与在接口处理板上的第一网络交换机互联,信号处理板内DSP0、DSP1、DSP2、DSP3分别与第二网络交换机连接;数据存储板通过SGMII接口与接口处理板上的第一网络交换机互联;计算机主机板通过1000BASE-T接口与在接口处理板上的第一网络交换机互联。
4.一种基于权利要求1~3任一所述双总线高速图像处理系统的双总线高速图像处理方法,其特征在于,包括采用高速总线、低速总线两套数据传输总线系统进行图像传输处理的步骤;在该步骤中,将高速总线用于点对点高速图像数据传输,在高速总线的通道中只传输高速图像数据,不传输低速短数据及命令;将低速总线用于低速短数据及命令的传输。
5.根据权利要求4所述的双总线高速图像处理方法,其特征在于,在高速总线数据传输总线系统中,包括步骤:预先设置图像数据流的优先级,对于单个高速总线中传输的多路图像数据,根据预先设置的优先级传输。
6.根据权利要求4所述的双总线高速图像处理方法,其特征在于,在高速总线数据传输总线系统中,包括步骤:将多个高速总线通道绑定到一起并行传输图像数据。
7.根据权利要求4所述的双总线高速图像处理方法,其特征在于,在高速总线数据传输总线系统中,包括步骤:当存在多个优先级相同的高速数据需要传输时,将多个高速通道完全分离成多个点对点的独立通道,分别传输各个高速数据。
8.根据权利要求4所述的双总线高速图像处理方法,其特征在于,在低速总线数据传输总线系统中,包括步骤:当某节点需要使用低速总线时,发起低速总线占用请求,判断低速总线是否空闲,在低速总线空闲时则用于传输数据;在低速总线被其它节点占用时,设定随机避让时间进行避让,随机避让时间结束后再次争用,直至获得低速总线使用权完成数据传输。
9.根据权利要求4所述的双总线高速图像处理方法,其特征在于,在低速总线数据传输总线系统中,包括步骤:将多个节点设备挂接在同一低速总线上。
10.根据权利要求9所述的双总线高速图像处理方法,其特征在于,包括步骤:在节点设备的节点外,高速总线与高速总线之间、低速总线与低速总线之间均采用标准交换节点,以传输包为最小单元,完成通用交换功能,高速总线与低速总线之间不进行数据交互;在节点设备的节点内,高速总线与低速总线间,使用标准包格式转换单元模块进行数据交互。
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