[实用新型]一种轮运算电路有效
申请号: | 202020868012.7 | 申请日: | 2020-05-21 |
公开(公告)号: | CN212112472U | 公开(公告)日: | 2020-12-08 |
发明(设计)人: | 李晨晨 | 申请(专利权)人: | 中移(苏州)软件技术有限公司;中国移动通信集团有限公司 |
主分类号: | G06F21/72 | 分类号: | G06F21/72 |
代理公司: | 北京派特恩知识产权代理有限公司 11270 | 代理人: | 姚璐;张颖玲 |
地址: | 215163 江苏*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 一种 运算 电路 | ||
1.一种轮运算电路,其特征在于,包括:寄存器阵列、字节替换子电路、列混淆子电路和轮密钥加子电路;
所述寄存器阵列中设置有至少一个选择器,所述寄存器阵列的输出端与所述字节替换子电路的输入端相连;
所述字节替换子电路的输出端与所述列混淆子电路的输入端相接;
所述轮密钥加子电路具有数据输入端,所述列混淆子电路的输出端与所述轮密钥加子电路的数据输入端相连;
所述轮密钥加子电路的输出端,与所述寄存器阵列的输入端相接。
2.根据权利要求1所述的轮运算电路,其特征在于,所述寄存器阵列包括:至少一个寄存器;
所述至少一个寄存器,均匀排布在预设数目个寄存器支路上;每个寄存器支路上的寄存器的输出端,与位于所述每个寄存器支路上的下一个寄存器的输入端相连。
3.根据权利要求2所述的轮运算电路,其特征在于,所述至少一个选择器分别设置于所述预设数目个寄存器支路中的寄存器支路上;
位于第i个寄存器支路上的选择器的输出端,与所述第i个寄存器支路上的第i个寄存器的输入端相连;i大于1,小于等于预设数目;
位于所述第i个寄存器支路上的所述选择器的低电平输入端,与所述第i个寄存器支路上的首个寄存器的输入端相连;位于所述第i个寄存器支路上的所述选择器的高电平输入端,与所述第i个寄存器支路上的第i-1个寄存器的输出端相连。
4.根据权利要求1至3任一项所述的轮运算电路,其特征在于,所述字节替换子电路包括至少一个字节替换子单元,字节替换子单元的数目与寄存器支路的数目相同;
所述至少一个字节替换子单元中的每个字节替换子单元,分别与所述寄存器阵列中的每个寄存器支路的输出端相接。
5.根据权利要求1至3任一项所述的轮运算电路,其特征在于,所述轮密钥加子电路还具有轮密钥输入端。
6.根据权利要求4所述的轮运算电路,其特征在于,所述列混淆子电路的输入端包括与所述至少一个字节替换子单元对应的至少一个子输入端;
所述至少一个字节替换子单元中的每个字节替换子单元的输出端,与所述每个字节替换子单元所对应的子输入端相接。
7.根据权利要求5所述的轮运算电路,其特征在于,所述轮运算电路设置于加密解密电路中;其中,所述加密解密电路通过所述轮密钥加子电路的轮密钥输入端接收扩展密钥。
8.根据权利要求7所述的轮运算电路,其特征在于,所述轮运算电路还设置于密钥扩展电路中;
所述密钥扩展电路的输出端,与所述轮密钥加子电路的轮密钥输入端相接。
9.根据权利要求7或8所述的轮运算电路,其特征在于,所述加密解密电路设置有数据读入信号端和数据输出信号端;
所述数据读入信号端与数据缓存器的第一信号端相接,所述数据输出信号端与所述数据缓存器的第二信号端相接;
所述加密解密电路的数据输入接口和所述数据缓存器的输出端相接,所述加密解密电路的数据输出接口和所述数据缓存器的输入端相接。
10.根据权利要求1至3、或6至8任一项所述的轮运算电路,其特征在于,所述寄存器为8位移位寄存器。
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