[实用新型]一种能够实现单节放电保护的锂电池包有效
申请号: | 202021061863.7 | 申请日: | 2020-06-10 |
公开(公告)号: | CN212343363U | 公开(公告)日: | 2021-01-12 |
发明(设计)人: | 於锋;王金波;徐锦林;於青江 | 申请(专利权)人: | 宁波锂想电子有限公司 |
主分类号: | H02J7/00 | 分类号: | H02J7/00;H02H7/18 |
代理公司: | 宁波奥圣专利代理有限公司 33226 | 代理人: | 方小惠 |
地址: | 315040 浙江省宁波市宁波高*** | 国省代码: | 浙江;33 |
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摘要: | |||
搜索关键词: | 一种 能够 实现 放电 保护 锂电池 | ||
1.一种能够实现单节放电保护的锂电池包,包括一个锂电池组和一个感应锂电池包温度的热敏电阻,所述的锂电池组包括n节锂电池,n为大于等于3的整数,第n节锂电池的正极作为所述的锂电池组的正极,第j节锂电池的正极和第j+1节锂电池的负极连接,第j节锂电池的正极同时引出用于外部连接,j=1,2,…,n-1,第1节锂电池的负极作为所述的锂电池组的负极,所述的热敏电阻的一端作为所述的锂电池包的温度信号输出端,其特征在于所述的锂电池包还包括用于检测所述的锂电池组中每节锂电池是否过放的信号检测处理电路和用于在所述的锂电池组中任意一节锂电池出现过放时,使所述的热敏电阻由正常工作状态变换至异常工作状态的开关电路,所述的开关电路具有短路状态和断路状态,所述的信号检测处理电路具有休眠模式和工作模式,当所述的锂电池包处于非工作状态时,所述的信号检测处理电路进入休眠模式,当所述的锂电池包进入充电工作状态或者放电工作状态时,所述的信号检测处理电路进入工作模式,在所述的锂电池包处于充电工作状态期间,所述的信号检测处理电路驱动所述的开关电路进入相应状态,使所述的热敏电阻保持正常工作状态,在所述的锂电池包处于放电工作状态期间,所述的信号检测处理电路监测所述的锂电池组中每节锂电池是否过放,如果每节锂电池都未过放,所述的信号检测处理电路输出未过放信号驱动所述的开关电路进入相应状态,使所述的热敏电阻保持正常工作状态,如果至少一节锂电池过放,所述的信号检测处理电路输出过放信号驱动所述的开关电路进入相应状态,使所述的热敏电阻由正常工作状态变换至异常工作状态,所述的锂电池包的温度信号输出端输出异常信号。
2.根据权利要求1所述的一种锂电池包,其特征在于所述的热敏电阻的另一端通过所述的开关电路接地,当所述的信号检测处理电路输出未过放信号时,所述的开关电路呈短路状态,当所述的信号检测处理电路输出过放信号时,所述的开关电路呈断路状态。
3.根据权利要求2所述的一种锂电池包,其特征在于所述的锂电池组包括5节锂电池,所述的开关电路采用第一场效应管实现,所述的信号检测处理电路包括型号为AZL05的第一芯片、型号为HT66F0025的第二芯片、第一电阻、第二电阻、第三电阻、第四电阻、第五电阻、第六电阻、第七电阻、第八电阻、第一电容、第二电容、第三电容、第四电容、第五电容、第六电容、第七电容、第八电容、第九电容和第二场效应管,所述的第二芯片具有电源端口、接地端口和6个I/O端口,将6个I/O端口随机称为第一I/O端口、第二I/O端口、第三I/O端口、第四I/O端口、第五I/O端口和第六I/O端口,所述的第一电阻的一端和所述的锂电池组的正极连接,所述的第一电阻的另一端分别与所述的第一电容的一端和所述的第一芯片的第1脚连接,所述的第一电容的另一端接地,所述的第二电阻的一端和所述的锂电池组的正极连接,所述的第二电阻的另一端分别与所述的第二电容的一端和所述的第一芯片的第2脚连接,所述的第二电容的另一端接地,所述的第三电阻的一端和所述的锂电池组中第4节锂电池的正极连接,所述的第三电阻的另一端分别与所述的第三电容的一端和所述的第一芯片的第3脚连接,所述的第三电容的另一端接地,所述的第四电阻的一端和所述的锂电池组中第3节锂电池的正极连接,所述的第四电阻的另一端分别与所述的第四电容的一端和所述的第一芯片的第4脚连接,所述的第四电容的另一端接地,所述的第五电阻的一端和所述的锂电池组中第2节锂电池的正极连接,所述的第五电阻的另一端分别与所述的第五电容的一端和所述的第一芯片的第5脚连接,所述的第五电容的另一端接地,所述的第六电阻的一端和所述的锂电池组中第1节锂电池的正极连接,所述的第六电阻的另一端分别与所述的第六电容的一端和所述的第一芯片的第6脚连接,所述的第六电容的另一端接地,所述的第一芯片的第7脚接地,所述的第一芯片的第10脚和所述的第七电阻的一端连接,所述的第七电阻的另一端接地,所述的第一芯片的第11脚和所述的第八电容的一端连接,所述的第八电容的另一端接地,所述的第一芯片的第12脚和所述的第九电容的一端连接,所述的第九电容的另一端接地,所述的第一芯片的第14脚和所述的第二芯片的第一I/O端口连接,所述的第一芯片的第15脚和所述的第二芯片的第二I/O端口连接,所述的第一芯片的第16脚分别与所述的第七电容的一端和所述的第二芯片的电源端口连接,所述的第七电容的另一端接地,所述的第二芯片的接地端口接地,所述的第二芯片的第三I/O端口和所述的第二场效应管的漏极连接,所述的第二场效应管的源极和所述的第八电阻的一端均接地,所述的第二场效应管的栅极和所述的第八电阻的另一端连接且其连接端与所述的热敏电阻的另一端连接,所述的第二芯片的第四I/O端口和所述的第一场效应管的栅极连接,所述的第一场效应管的漏极和所述的热敏电阻的另一端连接,所述的第一场效应管的源极接地。
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