[实用新型]晶闸管控制电路有效

专利信息
申请号: 202021107778.X 申请日: 2020-06-16
公开(公告)号: CN213151922U 公开(公告)日: 2021-05-07
发明(设计)人: L·宫蒂尔;林钰朝 申请(专利权)人: 意法半导体有限公司
主分类号: H02M7/162 分类号: H02M7/162;H02M1/42
代理公司: 北京市金杜律师事务所 11256 代理人: 傅远
地址: 中国香港九龙尖沙咀广东道*** 国省代码: 香港;81
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摘要:
搜索关键词: 晶闸管 控制电路
【权利要求书】:

1.一种晶闸管控制电路,其特征在于,包括:

整流桥,在所述整流桥的第一整流输出端子与所述整流桥的第二整流输出端子之间具有与第一整流元件串联耦合的第一晶闸管;以及

第一二极管,在所述第一晶闸管的栅极与所述第二整流输出端子之间与DC电压源串联耦合。

2.根据权利要求1所述的晶闸管控制电路,其特征在于,还包括耦合在所述第一整流输出端子与所述第二整流输出端子之间的晶体管开关,其中,所述晶体管开关被选择性地致动以迫使从所述DC电压源通过所述第一二极管的电流传导。

3.根据权利要求1所述的晶闸管控制电路,其特征在于,还包括耦合在所述第一整流输出端子与所述第二整流输出端子之间的晶体管开关,其中,所述晶体管开关以施加到所述整流桥的输入的AC电压的半波的速率选择性地被致动。

4.根据权利要求1所述的晶闸管控制电路,其特征在于,还包括耦合在所述第一整流输出端子与所述第二整流输出端子之间的晶体管开关,其中,所述晶体管开关在施加到所述整流桥的输入的AC电压的过零的附近选择性地被致动。

5.根据权利要求4所述的晶闸管控制电路,其特征在于,当所述AC电压下降到比由所述DC电压源递送的DC电压大的值以下时,所述晶体管开关的导通被触发。

6.根据权利要求4所述的晶闸管控制电路,其特征在于,在所述AC电压下降到比由所述DC电压源递送的DC电压大的值以下的时间以后的延迟之后,所述开关的导通被触发。

7.根据权利要求1所述的晶闸管控制电路,其特征在于,还包括将所述第一二极管的阴极耦合到所述第一晶闸管的栅极的第一电阻器。

8.根据权利要求1所述的晶闸管控制电路,其特征在于,还包括耦合到所述第一整流输出端子和所述第二整流输出端子的功率因数校正电路。

9.根据权利要求1所述的晶闸管控制电路,其特征在于,还包括耦合在所述整流桥的所述第一整流输出端子与所述第二整流输出端子之间的电容器。

10.根据权利要求9所述的晶闸管控制电路,其特征在于,还包括耦合在所述第一整流输出端子与所述第二整流输出端子之间的晶体管开关,其中,所述晶体管开关选择性地被致动以使所述电容器放电。

11.根据权利要求10所述的晶闸管控制电路,其特征在于,所述晶体管开关的所述选择性致动发生在施加到所述整流桥的输入的AC电压的过零的附近。

12.根据权利要求1所述的晶闸管控制电路,其特征在于,还包括浪涌电流限制电阻器,并且其中所述第一晶闸管的致动旁路所述浪涌电流限制电阻器。

13.根据权利要求1所述的晶闸管控制电路,其特征在于,所述整流桥还具有第二晶闸管,所述第二晶闸管与第二整流元件在所述第一整流输出端子与所述第二整流输出端子之间串联耦合,并且其中,所述第一二极管与所述DC电压源在所述第二晶闸管的栅极与所述第二整流输出端子之间串联耦合。

14.根据权利要求13所述的晶闸管控制电路,其特征在于,还包括第二电阻器,所述第二电阻器将所述第一二极管的阴极耦合到所述第二晶闸管的所述栅极。

15.根据权利要求1所述的晶闸管控制电路,其特征在于,还包括耦合在所述整流桥的输入端子之间的AC电容器。

16.根据权利要求15所述的晶闸管控制电路,其特征在于,还包括:

晶体管开关,耦合在所述第一整流输出端子与所述第二整流输出端子之间;以及

放电电路,被配置为经由至少所述开关对所述AC电容器进行放电,当AC电压的断开被检测到时,所述放电电路被导通。

17.根据权利要求1所述的晶闸管控制电路,其特征在于,还包括耦合到所述第一整流输出端子和所述第二整流输出端子的功率转换电路。

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