[实用新型]基于HSC串行总线接口的64路高速GPIO控制板有效
| 申请号： | 202021931084.8 | 申请日： | 2020-09-07 |
| 公开（公告）号： | CN213457745U | 公开（公告）日： | 2021-06-15 |
| 发明（设计）人： | 崔坤新;徐慧伟 | 申请（专利权）人： | 无锡龙新机电工程有限公司 |
| 主分类号： | G05B19/05 | 分类号： | G05B19/05;G06F13/40 |
| 代理公司： | 连云港联创专利代理事务所(特殊普通合伙) 32330 | 代理人： | 刘刚 |
| 地址： | 214000 江苏省无锡市梁*** | 国省代码： | 江苏;32 |
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| 摘要： | |||
| 搜索关键词： | 基于 hsc 串行 总线接口 64 高速 gpio 控制板 | ||
1.基于HSC串行总线接口的64路高速GPIO控制板，其特征在于：该控制板由GPIO输入、GPIO输出电路、核心控制逻辑单元、输入输出LED指示电路、设备插入通知、BLVDS接口和降压供电电路组成，GPIO输入输出采用SCSI68P连接器与外部设备连接，通过DIN41612欧式插头与高速通讯底板连接，GPIO输入电路由两片74LVC16244芯片组成输入缓冲器，输入端由阻容元件组成输入保护电路，输入支持LVTTL电平输入；GPIO输出电路由两74LVCH16374组成输出缓冲器，输出LVTTL电平信号，输入输出指示电路采用扫描方式，由三极管和ULN2803驱动，驱动信号有信号处理电路提供，板卡插入通知电路是将与高速通讯底板连接的插座引脚接地实现，降压电路由TPS5430芯片构成开关式降压稳压电路，输出3.3V电压。
2.根据权利要求1所述的基于HSC串行总线接口的64路高速GPIO控制板，其特征在于：所述核心控制逻辑单元由10M02SCE144 FPGA芯片完成。
3.根据权利要求1所述的基于HSC串行总线接口的64路高速GPIO控制板，其特征在于：所述核心控制逻辑单元的信号处理电路通过两个片选信号轮流使能74LVC16244缓冲器完成输入信号的采集。
4.根据权利要求1所述的基于HSC串行总线接口的64路高速GPIO控制板，其特征在于：所述核心控制逻辑单元产生两个片选信号，轮流更新74LVCH16374的输出数据。
5.根据权利要求1所述的基于HSC串行总线接口的64路高速GPIO控制板，其特征在于：所述核心控制逻辑单元内部实现SERDES串行解串器，并通过TX发送和RX接收一对BLVDS接口与高速通讯背板相连，完成与通讯控制卡的通讯，通讯速率≥540Mb。
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