[实用新型]一种验证SPI总线时序容限的夹具有效
| 申请号： | 202022191641.3 | 申请日： | 2020-09-29 |
| 公开（公告）号： | CN212846775U | 公开（公告）日： | 2021-03-30 |
| 发明（设计）人： | 陈晨;杨成 | 申请（专利权）人： | 太仓市同维电子有限公司 |
| 主分类号： | G06F11/273 | 分类号： | G06F11/273 |
| 代理公司： | 北京天奇智新知识产权代理有限公司 11340 | 代理人： | 刘黎明 |
| 地址： | 215400 江苏省*** | 国省代码： | 江苏;32 |
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| 摘要： | |||
| 搜索关键词： | 一种 验证 spi 总线 时序 容限 夹具 | ||
1.一种验证SPI总线时序容限的夹具，其特征在于：包括CLK信号输入端(1)、CLK信号输出端(2)、MOSI信号输入端(3)和MOSI信号输出端(4)，所述CLK信号输入端(1)分别与第一CLK三极管(5)、第二CLK三极管(6)和第三CLK三极管(7)的集电极相连，所述第一CLK三极管(5)的发射极通过第一CLK连接线(8)与CLK信号输出端(2)连接，所述第二CLK三极管(6)的发射极通过第二CLK连接线(9)与CLK信号输出端(2)连接，所述第三CLK三极管(7)的发射极通过第三CLK连接线(10)与CLK信号输出端(2)连接，所述第一CLK连接线(8)、第二CLK连接线(9)和第三CLK连接线(10)的长度不同，所述第一CLK三极管(5)的基极通过第一控制线(11)与外部控制电路连接，所述第二CLK三极管(6)的基极通过第二控制线(12)与外部控制电路连接，所述第三CLK三极管(7)的基极通过第三控制线(13)与外部控制电路连接，所述MOSI信号输入端(3)分别与第一MOSI三极管(14)、第二MOSI三极管(15)和第三MOSI三极管(16)的集电极相连，所述第一MOSI三极管(14)的发射极通过第一MOSI连接线(17)与MOSI信号输出端(4)连接，所述第二MOSI三极管(15)的发射极通过第二MOSI连接线(18)与MOSI信号输出端(4)连接，所述第三MOSI三极管(16)的发射极通过第三MOSI连接线(19)与MOSI信号输出端(4)连接，所述第一MOSI连接线(17)的长度与第一CLK连接线(8)的长度相同，所述第二MOSI连接线(18)的长度与第二CLK连接线(9)的长度相同，所述第三MOSI连接线(19)的长度与第三CLK连接线(10)的长度相同，所述第一MOSI三极管(14)的基极通过第四控制线(20)与外部控制电路连接，所述第二MOSI三极管(15)的基极通过第五控制线(21)与外部控制电路连接，所述第三MOSI三极管(16)的基极通过第六控制线(22)与外部控制电路连接。
2.根据权利要求1所述的一种验证SPI总线时序容限的夹具，其特征在于：所述CLK信号输入端(1)、CLK信号输出端(2)、MOSI信号输入端(3)和MOSI信号输出端(4)均为3.5mm SMA母头座子。
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