[实用新型]兼具提高电路阶数与尺寸小型化的高频滤波器有效

专利信息
申请号: 202022655130.2 申请日: 2020-11-17
公开(公告)号: CN213342161U 公开(公告)日: 2021-06-01
发明(设计)人: 洪永晋;谢育书;陈佳锚;陈惠如 申请(专利权)人: 华新科技股份有限公司
主分类号: H03H7/01 分类号: H03H7/01
代理公司: 北京寰华知识产权代理有限公司 11408 代理人: 何尤玉;郭仁建
地址: 中国台*** 国省代码: 台湾;71
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摘要:
搜索关键词: 兼具 提高 电路 尺寸 小型化 高频 滤波器
【权利要求书】:

1.一种兼具提高电路阶数与尺寸小型化的高频滤波器,其特征在于,包含:

多个基板,堆叠形成一积层本体,各该基板的表面形成至少一图案层,该多个基板上的图案层形成多个电容、多个耦合电容以及多个耦合线;

一输入导体片,设置于该积层本体外并等效于一输入耦合线;以及

一输出导体片,设置于该积层本体外并等效于一输出耦合线,其中,该多个耦合线、该输入耦合线与该输出耦合线相互耦合;

该多个电容、该多个耦合电容、该多个耦合线、该输入耦合线与该输出耦合线连接形成一高频滤波电路。

2.如权利要求1所述的兼具提高电路阶数与尺寸小型化的高频滤波器,其特征在于,包含多个接地片与多个导电柱,该多个接地片分布设置于该积层本体的侧面,该多个导电柱设置于该积层本体内;

该积层本体中的该多个基板的所述图案层、该多个接地片、该输入导体片、该输出导体片与该多个导电柱等效于一第一电容至一第七电容、一第一耦合电容至一第七耦合电容、一第一耦合线至一第五耦合线、该输入耦合线与该输出耦合线。

3.如权利要求2所述的兼具提高电路阶数与尺寸小型化的高频滤波器,其特征在于,该第一电容连接该输入耦合线且其连接节点为一信号传输端;该第二电容连接该第一耦合线;该第三电容连接该第二耦合线;该第四电容连接该第三耦合线;该第五电容连接该第四耦合线;该第六电容连接该第五耦合线;该第七电容连接该输出耦合线且其连接节点为另一信号传输端;

该第一耦合电容的一端连接该第二电容与该第一耦合线之间的节点,该第一耦合电容的另一端连接该第三电容与该第二耦合线之间的节点;

该第二耦合电容的一端连接该第三电容与该第二耦合线之间的节点,该第二耦合电容的另一端连接该第四电容与该第三耦合线之间的节点;

该第三耦合电容的一端连接该第四电容与该第三耦合线之间的节点,该第三耦合电容的另一端连接该第五电容与该第四耦合线之间的节点;

该第四耦合电容的一端连接该第五电容与该第四耦合线之间的节点,该第四耦合电容的另一端连接该第六电容与该第五耦合线之间的节点;

该第五耦合电容的一端连接该第三电容与该第二耦合线之间的节点,该第五耦合电容的另一端连接该第五电容与该第四耦合线之间的节点;

该第六耦合电容的一端连接该第二电容与该第一耦合线之间的节点,该第六耦合电容的另一端连接该第四电容与该第三耦合线之间的节点;

该第七耦合电容的一端连接该第四电容与该第三耦合线之间的节点,该第七耦合电容的另一端连接该第六电容与该第五耦合线之间的节点。

4.如权利要求3所述的兼具提高电路阶数与尺寸小型化的高频滤波器,其特征在于,该积层本体包含一底面、一顶面、一第一侧面、一第二侧面、一第三侧面与一第四侧面,该第一侧面相对于该第三侧面,该第二侧面相对于该第四侧面;

该多个接地片分布设置于该积层本体的该第一至该第四侧面,该输入导体片设置于该积层本体的第一侧面,该输出导体片设置于该积层本体的第三侧面,该多个导电柱包含一第一导电柱至一第七导电柱;

该多个基板包含由下而上依序堆叠的一第一基板至一第十基板;

该第一基板上的图案层为一第1图案层,该第1图案层连接该多个接地片;

该第二基板上的图案层包含一第2图案层与一第3图案层,该第2图案层连接该输入导体片,该第3图案层连接该输出导体片;

该第三基板上的图案层包含一第4图案层至一第8图案层;

该第四基板上的图案层包含一第9图案层至一第16图案层;

该第五基板上的图案层包含一第17图案层与一第18图案层;

该第六基板上的图案层包含一第19图案层至一第21图案层;

该第七基板上的图案层包含一第22图案层与一第23图案层;

该第八基板上的图案层包含一第24图案层与一第25图案层,该第24图案层连接该输入导体片,该第25图案层连接该输出导体片;

该第九基板上的图案层为一第26图案层;

该第十基板上的图案层为一第27图案层,该第27图案层连接该多个接地片;

该第一导电柱连接该第4图案层、第9图案层、第19图案层、第24图案层、第26图案层及第27图案层,且该第一导电柱等效于该第一耦合线;

该第二导电柱连电接该第5图案层、第10图案层、第17图案层及第27图案层,该第三导电柱连接该第5图案层、第11图案层、第17图案层及第27图案层,且该第二导电柱与该第三导电柱等效于该第二耦合线;

该第四导电柱连接该第6图案层、第13图案层、第20图案层、第26图案层及第27图案层,且该第四导电柱等效于该第三耦合线;

该第五导电柱连接该第7图案层、第14图案层、第18图案层及第27图案层,该第六导电柱连接该第7图案层、第15图案层、第18图案层及第27图案层,且该第五导电柱与该第六导电柱等效于该第四耦合线;

该第七导电柱连接该第8图案层、第16图案层、第21图案层、第25图案层、第26图案层及第27图案层,且该第七导电柱等效于该第五耦合线;

该第2图案层与该第1图案层形成该第一电容,该第3图案层与该第1图案层形成该第七电容,该第4图案层至该第8图案层分别与该第1图案层形成该第二至该六电容;

该第4图案层、第10图案层、第11图案层形成该第一耦合电容;

该第17图案层、第20图案层形成该第二耦合电容;

该第18图案层、第20图案层形成该第三耦合电容;

该第08图案层、第14图案层、第15图案层形成该第四耦合电容;

该第05图案层、第07图案层、第12图案层、第17图案层、第18图案层形成该第五耦合电容;

该第19图案层、第20图案层、第22图案层形成该第六耦合电容;

该第20图案层、第21图案层、第23图案层形成该第七耦合电容。

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