[实用新型]一种基于JESD204B高速接口的零低中频收发系统有效

专利信息
申请号: 202023213843.X 申请日: 2020-12-28
公开(公告)号: CN213585756U 公开(公告)日: 2021-06-29
发明(设计)人: 吴小波;刘解华;李加胜;周宇飞 申请(专利权)人: 华力智芯(成都)集成电路有限公司
主分类号: H04B1/30 分类号: H04B1/30;H04B1/40
代理公司: 成都先导云创知识产权代理事务所(普通合伙) 51321 代理人: 李坤
地址: 610000 四川省成都市中国(四川)自由贸易试验区成都*** 国省代码: 四川;51
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摘要:
搜索关键词: 一种 基于 jesd204b 高速 接口 中频 收发 系统
【权利要求书】:

1.一种基于JESD204B高速接口的零低中频收发系统,其特征在于,包括中频信号接收端、中频信号发送端、中频信号处理单元、基带信号处理单元以及背板,所述中频信号接收端用于接收中频信号并送入中频信号处理单元;

所述中频信号处理单元包括中频信号接收方向处理单元和中频信号发送方向处理单元,所述中频信号接收方向处理单元包括第一低噪声放大器、带通滤波器、第二低噪声放大器以及第一平衡不平衡转换器,所述第一低噪声放大器的信号输入端与所述中频信号接收端相连,所述第一低噪声放大器的信号输出端与所述带通滤波器的信号输入端相连,所述带通滤波器的信号输出端与第二低噪声放大器的信号输入端相连,所述第二低噪声放大器的信号输出端与所述第一平衡不平衡转换器的信号输入端相连;所述中频信号发送方向处理单元包括第二平衡不平衡转换器,所述第二平衡不平衡转换器的信号输出端与中频信号发送端相连;

所述基带信号处理单元包括基带信号接收方向处理单元和基带信号发送方向处理单元,所述基带信号接收方向处理单元包括I/Q解调器、第一基带可编程VGA滤波器、第一低通可调谐滤波器以及模数转换器,所述I/Q解调器的信号输入端与所述第一平衡不平衡转换器的信号输出端相连,所述I/Q解调器的信号输出端与所述第一基带可编程VGA滤波器的信号输入端相连,所述第一基带可编程VGA滤波器的信号输出端与所述第一低通可调谐滤波器的信号输入端相连,所述第一低通可调谐滤波器的信号输出端与所述模数转换器的信号输入端相连,所述模数转换器的信号输出端通过JESD204B高速接口与所述背板实现信号连接;所述基带信号发送方向处理单元包括数模转换器、第二低通可调谐滤波器、第二基带可编程VGA滤波器以及I/Q调制器,所述数模转换器的信号输入端通过JESD204B高速接口与所述背板实现信号连接,所述数模转换器的信号输出端与所述第二低通可调谐滤波器的信号输入端相连,所述第二低通可调谐滤波器的信号输出端与所述第二基带可编程VGA滤波器的信号输入端相连,所述第二基带可编程VGA滤波器的信号输出端与所述I/Q调制器的信号输入端相连,所述I/Q调制器的信号输出端与所述第二平衡不平衡转换器的信号输入端相连。

2.根据权利要求1所述的一种基于JESD204B高速接口的零低中频收发系统,其特征在于,还包括合路单元,所述合路单元包括晶振、频率合成器、时钟缓冲器以及合路器,所述晶振与频率合成器实现信号连接,所述频率合成器的信号输出端与所述时钟缓冲器的信号输入端相连,所述时钟缓冲器的时钟信号输出端与所述背板的时钟信号输入端相连,所述时钟缓冲器的输出端与所述第二平衡不平衡转换器的输出端连接到合路器的输入端,所述合路器的输出端发射中频信号。

3.根据权利要求1所述的一种基于JESD204B高速接口的零低中频收发系统,其特征在于,还包括第一开关和第二开关,所述第一开关设置于所述第一低噪声放大器的信号输入端,所述第二开关设置于所述第二平衡不平衡转换器的信号输出端。

4.根据权利要求3所述的一种基于JESD204B高速接口的零低中频收发系统,其特征在于,所述第一开关和第二开关均为射频开关,分别为第一射频开关、第二射频开关,所述第一射频开关的两个选择端分别与发射射频连接器和第二射频开关的选择端互联,所述第二射频开关的两个选择端分别与发射射频连接器和第一射频开关的选择端互联。

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