[发明专利]抓包装置以及方法有效
申请号: | 202080099956.5 | 申请日: | 2020-04-24 |
公开(公告)号: | CN115428409B | 公开(公告)日: | 2023-04-11 |
发明(设计)人: | 荻田惠一 | 申请(专利权)人: | 株式会社东阳特克尼卡 |
主分类号: | H04L43/022 | 分类号: | H04L43/022;H04L43/04 |
代理公司: | 永新专利商标代理有限公司 72002 | 代理人: | 高迪 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 装置 以及 方法 | ||
1.一种抓包装置,对在通信网络中流动的数据包进行捕获,并记录到次级存储装置,
所述抓包装置具备:
捕获部,对以200Gbps在所述通信网络中流动的数据包,无疏漏地连续地进行捕获;
控制部,暂时保持由所述捕获部捕获的数据包;以及
接口部,将所述控制部中暂时保持的数据包记录到所述次级存储装置,
所述控制部具有构成NUMA架构的2个NUMA节点,所述2个NUMA节点分别为,由第1处理器和第1存储器构成的第1NUMA节点、以及由第2处理器和第2存储器构成的第2NUMA节点,所述NUMA是指,Non-Uniform Memory Access即非统一内存访问,并且,所述控制部具有对所述第1处理器和所述第2处理器进行连接的信道,
所述捕获部具有:
第1捕获部,与所述第1NUMA节点连接,对所述通信网络中流动的数据包进行捕获,并将捕获的数据包存放到所述第1存储器;以及
第2捕获部,与所述第2NUMA节点连接,与所述第1捕获部的捕获并行地对所述通信网络中流动的数据包进行捕获,并将捕获的数据包存放到所述第2存储器,
所述接口部具有:
第1接口部,与所述第1NUMA节点连接,将所述第1存储器中存放的数据包记录到所述次级存储装置;以及
第2接口部,与所述第2NUMA节点连接,与所述第1接口部的记录并行地将所述第2存储器中存放的数据包记录到所述次级存储装置,
在所述抓包装置中,(1)和(2)的处理被并行执行,(1)的处理是:由所述第1捕获部捕获的数据包,不经由所述信道,而是在被存放到构成所述第1NUMA节点的所述第1存储器后,通过与所述第1NUMA节点连接的所述第1接口部,被记录到所述次级存储装置,(2)的处理是:由所述第2捕获部捕获的数据包,不经由所述信道,而是在被存放到构成所述第2NUMA节点的所述第2存储器后,通过与所述第2NUMA节点连接的所述第2接口部,被记录到所述次级存储装置。
2.如权利要求1所述的抓包装置,
所述第1捕获部对以100Gbps在所述通信网络中流动的第1类数据包进行捕获,并将捕获的数据包存放到所述第1存储器,
所述第2捕获部与所述第1捕获部的捕获并行,对以100Gbps在所述通信网络中流动的第2类数据包进行捕获,并将捕获的数据包存放到所述第2存储器。
3.如权利要求2所述的抓包装置,
所述第1类数据包是所述通信网络中的上行的数据包,
所述第2类数据包是所述通信网络中的下行的数据包。
4.如权利要求1所述的抓包装置,
所述第1存储器保持由所述第1处理器并行处理的多个第1线程,
所述多个第1线程中包括:将由所述第1捕获部捕获的数据包存放到所述第1存储器的多个线程;以及将所述第1存储器中存放的数据包,经由所述第1接口部记录到所述次级存储装置的多个线程,
所述第2存储器保持由所述第2处理器并行处理的多个第2线程,
所述多个第2线程中包括:将由所述第2捕获部捕获的数据包存放到所述第2存储器的多个线程;以及将所述第2存储器中存放的数据包,经由所述第2接口部记录到所述次级存储装置的多个线程。
5.一种抓包方法,对通信网络中流动的数据包进行捕获,并记录到次级存储装置,
所述抓包方法包括:
捕获步骤,对以200Gbps在所述通信网络中流动的数据包,无疏漏地连续地进行捕获;以及
记录步骤,将在所述捕获步骤捕获的数据包记录到所述次级存储装置,
所述捕获步骤包括:
第1捕获步骤,对所述通信网络中流动的数据包进行捕获,并将捕获的数据包存放到构成NUMA架构的第1NUMA节点所具有的第1存储器,所述NUMA是指,Non-Uniform MemoryAccess即非统一内存访问;以及
第2捕获步骤,与所述第1捕获步骤的捕获并行,对所述通信网络中流动的数据包进行捕获,并将捕获的数据包存放到构成所述NUMA架构的第2NUMA节点所具有的第2存储器,
所述记录步骤包括:
第1记录步骤,将所述第1存储器中存放的数据包记录到所述次级存储装置;以及
第2记录步骤,与所述第1记录步骤的记录并行,将所述第2存储器中存放的数据包记录到所述次级存储装置,
在所述第1捕获步骤、所述第2捕获步骤、所述第1记录步骤、以及所述第2记录步骤中,所述数据包不经由对构成所述第1NUMA节点的第1处理器和构成所述第2NUMA节点的第2处理器进行连接的信道。
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