[发明专利]集成电路及其信号传输方法在审

专利信息
申请号: 202110043834.0 申请日: 2021-01-13
公开(公告)号: CN113992199A 公开(公告)日: 2022-01-28
发明(设计)人: 宋廉祥 申请(专利权)人: 瑞昱半导体股份有限公司
主分类号: H03K19/0185 分类号: H03K19/0185
代理公司: 北京市立方律师事务所 11330 代理人: 李娜;赵莎
地址: 中国台*** 国省代码: 台湾;71
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摘要:
搜索关键词: 集成电路 及其 信号 传输 方法
【说明书】:

本案提供一种集成电路及其信号传输方法,此集成电路包括一第一电源域、一第二电源域以及一弱拉电路。第一电源域由一第一电源供电,第二电源域由一第二电源供电,且第二电源域通过一传输路径传送信号至第一电源域。弱拉电路信号连接传输路径,在第二电源域处于一断电模式时,弱拉电路将传输路径稳定维持在一逻辑电平,以避免未知信号由第二电源域进入第一电源域而干扰到第一电源域的正常运作。

技术领域

本案有关一种集成电路(Integrated Circuit,IC)在不同电源域之间的传输技术,特别是关于一种集成电路及其信号传输方法。

背景技术

在集成电路运作中,为了减少能源消耗,通常会将集成电路分为数个电源域(Power Domain),并会将系统中未使用的部份电源域关闭,所以在同一时间点,会有一个处于供电模式的第一电源域,另一个第二电源域则是处于不供电(断电)模式。然而当第二电源域断电时,为避免未知信号(噪声)从第二电源域进入至第一电源域,而干扰到第一电源域里面的逻辑运作,现有技术在第一电源域及第二电源域之间设有一隔离单元(isolationcell),以避免供电及断电的不同电源域互相干扰。然而,当集成电路本身无法掌握断电时间,无法在正确时间使能隔离单元,使能太早会导致第一电源域及第二电源域之间信号无法相通,使能太晚又会让未知信号干扰到第一电源域,导致隔离单元会失去作用。

发明内容

鉴于此,本案提出一种集成电路,包括一第一电源域、一第二电源域以及一弱拉电路。第一电源域由一第一电源供电,第二电源域由一第二电源供电,且第二电源域通过一传输路径传送信号至第一电源域。弱拉电路信号连接传输路径,在第二电源域处于一断电模式时,弱拉电路将传输路径稳定维持在一逻辑电平。

本案另外提出一种信号传输方法,适用于一集成电路,此集成电路包括一第一电源域以及一第二电源域。信号传输方法包括:第一电源供电给第一电源域,且第二电源供电给第二电源域;第二电源域通过一传输路径传送信号至第一电源域;以及在第二电源域处于一断电模式时,一弱拉电路将传输路径稳定维持在一逻辑电平。

依据一些实施例,第一电源域具有一第一连接垫,第二电源域具有一第二连接垫,第二连接垫电性连接至第一连接垫,以形成传输路径。

依据一些实施例,弱拉电路位于第一电源域内,并电性连接第一连接垫或传输路径。

依据一些实施例,弱拉电路为一弱拉高电路或一弱拉低电路。当弱拉电路为弱拉低电路时,逻辑电平为一低逻辑电平;以及当弱拉电路为弱拉高电路时,逻辑电平为一高逻辑电平。

依据一些实施例,第一电源域处于一供电模式,且第二电源域处于供电模式或是断电模式。

依据一些实施例,第一电源及第二电源为相同的电源。

综上所述,本案直接在集成电路内部进行电路设计,以利用弱拉电路在一电源域断电时将传输路径稳定维持在一逻辑电平上,避免断电的电源域会有未知信号(包括噪声)进入到另一电源域中而干扰其逻辑运作,以维持集成电路本身的正常运作。因此,本案不需使用隔离单元,所以无需繁琐的隔离设定流程且也不需要提早知道断电时间,即使其中一电源域受到突发的断电事件,也不会影响到另一电源域的逻辑运作。

附图说明

图1为根据本案一实施例的集成电路的方块示意图。

图2为根据本案一实施例的信号传输方法的流程示意图。

图3为根据本案另一实施例的集成电路的方块示意图。

图4为应用于本案的通用型输入输出电路的实际电路示意图。

图5为根据本案又一实施例的集成电路的方块示意图。

具体实施方式

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