[发明专利]互联裸芯的时钟域系统及其管理方法有效

专利信息
申请号: 202110160498.8 申请日: 2021-02-05
公开(公告)号: CN112817906B 公开(公告)日: 2023-03-07
发明(设计)人: 魏敬和;黄乐天;肖志强;王小航;冯敏刚;刘德 申请(专利权)人: 中国电子科技集团公司第五十八研究所
主分类号: G06F15/78 分类号: G06F15/78;G06F13/40;G06F13/16;G06F13/42;G06F1/12;G06F9/448
代理公司: 无锡派尔特知识产权代理事务所(普通合伙) 32340 代理人: 杨立秋
地址: 214000 *** 国省代码: 江苏;32
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摘要:
搜索关键词: 互联裸芯 时钟 系统 及其 管理 方法
【权利要求书】:

1.互联裸芯的时钟域系统,其特征在于,包括:全局时钟域、均与所述全局时钟域连接的标准协议接口时钟域和跨裸芯接口源同步时钟域;

所述全局时钟域用于管理互联裸芯内部的裸芯级网络;

所述标准协议接口时钟域用于管理标准协议接口;

所述跨裸芯接口源同步时钟域用于管理跨裸芯扩展同步器,所述跨裸芯扩展同步器包括异步Buffer和双向LVDS;

所述全局时钟域与所述标准协议接口时钟域用于控制裸芯级网络与协议转换模块之间的通信;

所述全局时钟域与所述跨裸芯接口源同步时钟域用于控制互联裸芯之间的通信;

全局时钟域包含了裸芯级网络内所有的路由器以及传输总线;

标准协议接口时钟域根据标准协议需要设置不同的时钟域;

跨裸芯接口源同步时钟域分为两个时钟域:输入通道和输出通道分属于各自独立的时钟域。

2.根据权利要求1所述的互联裸芯的时钟域系统,其特征在于,所述全局时钟域与所述标准协议接口时钟域之间通过异步Buffer连接,所述异步Buffer的两端均设有FSM,所述全局时钟域和所述标准协议接口时钟域均通过各自的FSM控制数据传输。

3.根据权利要求1所述的互联裸芯的时钟域系统,其特征在于,所述异步Buffer分别与互联裸芯的片上总线和双向LVDS连接,所述异步Buffer的两端均设有FSM,所述全局时钟域和所述跨裸芯接口源同步时钟域均通过各自的FSM控制数据传输,所述双向LVDS用于差分信号的生成和整合。

4.根据权利要求3所述的互联裸芯的时钟域系统,其特征在于,所述异步Buffer为异步双口RAM。

5.互联裸芯的时钟域管理方法,其特征在于,包括:

将互联裸芯上的时钟分为全局时钟域、标准协议接口时钟域和跨裸芯接口源同步时钟域;

所述全局时钟域用于管理互联裸芯内部的裸芯级网络;

所述标准协议接口时钟域用于管理标准协议接口;

所述跨裸芯接口源同步时钟域用于管理跨裸芯扩展同步器;

所述全局时钟域与所述标准协议接口时钟域用于控制裸芯级网络与协议转换模块之间的通信;

所述全局时钟域与所述跨裸芯接口源同步时钟域用于控制互联裸芯之间的通信;

全局时钟域包含了裸芯级网络内所有的路由器以及传输总线;

标准协议接口时钟域根据标准协议需要设置不同的时钟域;

跨裸芯接口源同步时钟域分为两个时钟域:输入通道和输出通道分属于各自独立的时钟域;

所述跨裸芯扩展同步器包括异步Buffer和双向LVDS。

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