[发明专利]频率校准系统、方法及应答器有效
申请号: | 202110237217.4 | 申请日: | 2021-03-03 |
公开(公告)号: | CN113078991B | 公开(公告)日: | 2022-07-22 |
发明(设计)人: | 黄金煌 | 申请(专利权)人: | 北京紫光青藤微系统有限公司 |
主分类号: | H04L7/033 | 分类号: | H04L7/033;H04L7/00;H04B1/59 |
代理公司: | 北京清亦华知识产权代理事务所(普通合伙) 11201 | 代理人: | 韩海花 |
地址: | 100084 北京市海淀区王庄路*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 频率 校准 系统 方法 应答器 | ||
1.一种频率校准系统,其特征在于,包括:
锁相环,所述锁相环的第一输入端用于输入参考时钟信号,所述锁相环用于基于所述参考时钟信号、预设分频比及第一预设时钟信号运行,以输出第二预设时钟信号,其中,所述第二预设时钟信号的第二预设频率等于第一目标时钟信号的第一目标频率的第一正整数倍;
时间数字转换单元,所述时间数字转换单元的第一输入端与所述锁相环的输出端相连,所述时间数字转换单元的第二输入端用于输入第一目标时钟信号,所述时间数字转换单元的输出端与所述锁相环的第二输入端相连;
所述时间数字转换单元,用于根据所述第二预设时钟信号的第二预设频率与第一目标时钟信号的第一目标频率,确定所述锁相环的目标分频比;所述锁相环还用于基于所述目标分频比运行,以输出第二目标时钟信号,其中,所述第二目标时钟信号的第二目标频率等于所述第一目标频率的第二正整数倍;
所述时间数字转换单元,包括:
反相器延迟链,所述反相器延迟链包括多个反相器,所述多个反相器首尾依次连接,其中,第一个所述反相器的输入端与所述锁相环的输出端相连;
采样电路,所述采样电路包括多个D触发器,所述多个D触发器与所述多个反相器一一对应,其中每个所述D触发器的D输入端与对应的反相器的输出端相连,每个所述D触发器的CK输入端用于输入所述第一目标时钟信号;
分频比重组电路,所述分频比重组电路的输入端与每个所述D触发器的输出端相连,所述分频比重组电路的输出端与所述锁相环的第二输入端相连;
其中,所述采样电路通过所述第一目标时钟信号的上升沿对所述第二预设时钟信号进行采样,得到采样信号,所述分频比重组电路用于根据所述采样信号确定所述目标分频比;
所述分频比重组电路,具体用于获取所述第二预设时钟信号的多个第二预设周期中分别包含的延迟时间的第一平均个数、及所述第一目标时钟信号的多个第一目标周期中分别包含的所述延迟时间的第二平均个数,根据所述第一平均个数、所述第二平均个数及所述预设分频比确定所述目标分频比。
2.根据权利要求1所述的系统,其特征在于,所述锁相环,包括:
鉴频鉴相器、电荷泵、无源滤波器、压控振荡器及分频器;其中,
所述鉴频鉴相器的输出端作为所述锁相环的输入端,所述鉴频鉴相器的第一输入端用于输入参考时钟信号,所述鉴频鉴相器的第二输入端与所述分频器的输出端相连;
所述电荷泵的输入端与所述鉴频鉴相器的输出端相连,所述电荷泵的输出端与所述无源滤波器的输入端相连,所述无源滤波器的输出端与所述压控振荡器的输入端相连;
所述压控振荡器的输出端作为所述锁相环的输出端,所述压控振荡器的输出端分别与所述时间数字转换单元的第一输入端及所述分频器的输入端相连。
3.根据权利要求2所述的系统,其特征在于,还包括:
分频比预设单元,所述分频比预设单元用于存储预设分频比;
多路选择器,所述多路选择器的输入端分别与所述分频比预设单元的输出端及所述时间数字转换单元的输出端相连,所述多路选择器的输出端与所述分频器相连,所述多路选择器的输入端用于将所述预设分频比或者目标分频比传输至所述分频器;
其中,当所述多路选择器的输入端用于输入预设分频比时,所述锁相环基于所述预设分频比运行,以输出第二预设时钟信号;
当所述多路选择器的输入端用于输入目标分频比时,所述锁相环基于所述目标分频比运行,以输出第二目标时钟信号。
4.根据权利要求3所述的系统 ,其特征在于,所述分频器,包括:
整数分频器、小数分频器及Σ-Δ调制器;
所述整数分频器的输入端及所述Σ-Δ调制器的输入端与所述多路选择器的输出端相连,所述整数分频器的输入端与所述锁相环的输出端相连,所述Σ-Δ调制器的输出端与所述小数分频器的输入端相连,所述整数分频器的输出端及所述小数分频器的输出端与所述锁相环的输入端相连。
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