[发明专利]一种三维存储器及其制作方法有效
申请号: | 202110243935.2 | 申请日: | 2021-03-05 |
公开(公告)号: | CN113013172B | 公开(公告)日: | 2022-01-25 |
发明(设计)人: | 邢彦召 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/11524 | 分类号: | H01L27/11524;H01L27/11556;H01L27/1157;H01L27/11582 |
代理公司: | 深圳紫藤知识产权代理有限公司 44570 | 代理人: | 唐秀萍 |
地址: | 430205 湖北省武汉*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 一种 三维 存储器 及其 制作方法 | ||
1.一种三维存储器的制作方法,其特征在于,包括:
在衬底上形成第一叠层结构,所述第一叠层结构包括在垂直于所述衬底的方向上多层交替层叠设置的栅极牺牲层和绝缘层;
在所述第一叠层结构上形成隔离层;
形成穿过所述隔离层和所述第一叠层结构的第一沟道孔;
在所述第一沟道孔底部通过选择性外延生长形成外延层,其中,所述衬底相对于所述隔离层的选择性外延生长选择比,大于所述衬底相对于所述第一叠层结构背离所述衬底的最外层的选择性外延生长选择比。
2.根据权利要求1所述的制作方法,其特征在于,所述第一叠层结构通过所述栅极牺牲层与所述隔离层相接触。
3.根据权利要求2所述的制作方法,其特征在于,所述栅极牺牲层的材质为氮化硅,所述隔离层的材质为氧化硅或不含硅元素的绝缘材料。
4.根据权利要求1所述的制作方法,其特征在于,所述第一叠层结构通过所述绝缘层与所述隔离层相接触。
5.根据权利要求4所述的制作方法,其特征在于,所述绝缘层的材质为氧化硅,所述隔离层的材质为不含硅元素的绝缘材料。
6.根据权利要求1所述的制作方法,其特征在于,所述形成穿过所述隔离层和所述第一叠层结构的第一沟道孔,具体包括:
刻蚀所述隔离层至所述第一叠层结构表面,以图案化所述隔离层;
将图案化的所述隔离层作为硬掩膜,刻蚀所述第一叠层结构至所述衬底,以形成第一沟道孔。
7.根据权利要求1所述的制作方法,其特征在于,在所述第一沟道孔底部通过选择性外延生长形成外延层之后,还包括:
在所述第一沟道孔中形成覆盖所述外延层的保护层;
在所述第一沟道孔中形成覆盖所述保护层的牺牲材料层;
在所述第一叠层结构和所述牺牲材料层上形成第二叠层结构;
形成穿过所述第二叠层结构的第二沟道孔,所述第二沟道孔与所述第一沟道孔相连通;
经由所述第二沟道孔去除所述牺牲材料层和所述保护层。
8.根据权利要求1所述的制作方法,其特征在于,在所述第一沟道孔底部通过选择性外延生长形成外延层之后,还包括:
在所述第一沟道孔的侧壁上依次沉积作为存储功能层的第一氧化物层、氮化物层和第二氧化物层,以及作为沟道的半导体层。
9.根据权利要求1所述的制作方法,其特征在于,还包括:
形成在垂直于所述衬底的方向上贯穿所述第一叠层结构的栅线缝隙;
通过所述栅线缝隙将所述第一叠层结构中的所述栅极牺牲层置换成栅极层。
10.一种三维存储器,其特征在于,包括:
衬底;
位于所述衬底上的第一叠层结构,所述第一叠层结构包括在垂直于所述衬底的方向上多层交替层叠设置的栅极层和绝缘层;
位于所述第一叠层结构上的隔离层;
穿过所述隔离层和所述第一叠层结构的第一沟道孔;
位于所述第一沟道孔底部的外延层,所述外延层通过选择性外延生长得到,且所述衬底相对于所述隔离层的选择性外延生长选择比,大于所述衬底相对于所述第一叠层结构背离所述衬底的最外层的选择性外延生长选择比。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的