[发明专利]一种二维异质结阵列器件及其制备方法有效
申请号: | 202110433616.8 | 申请日: | 2021-04-20 |
公开(公告)号: | CN113284889B | 公开(公告)日: | 2023-06-09 |
发明(设计)人: | 李东;朱晨光;朱小莉;潘安练 | 申请(专利权)人: | 湖南大学 |
主分类号: | H01L27/02 | 分类号: | H01L27/02;H01L29/24;H01L29/778;H01L21/8232 |
代理公司: | 长沙市融智专利事务所(普通合伙) 43114 | 代理人: | 钟丹 |
地址: | 410082 湖*** | 国省代码: | 湖南;43 |
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摘要: | |||
搜索关键词: | 一种 二维 异质结 阵列 器件 及其 制备 方法 | ||
1.一种二维半导体异质结阵列器件的制备方法,其特征在于, 包括如下步骤:
1)采用气相沉积法于衬底上制备WSe2/SnS2二维异质结材料,所述WSe2/SnS2二维异质结材料中,上层SnS2将下层WSe2完全覆盖,
2)在WSe2/SnS2二维异质结材料上制备阵列化金属电极;
3)利用Plasma刻蚀,将任意两组电极之间的WSe2/SnS2二维异质结材料去除;将任意两组电极之间的WSe2/SnS2二维异质结材料去除的过程为,在WSe2/SnS2二维异质结材料上旋涂PMMA胶并烘干,利用电子束曝光的方法在特定位置曝出图案,之后显影、定影,将任意两组电极之间的WSe2/SnS2二维异质结材料裸露出来,再进行Plasma刻蚀,从而除去该部分任意两组电极之间的WSe2/SnS2二维异质结材料;步骤3)中,Plasma刻蚀的参数为:刻蚀功率为High power;刻蚀时间为1-2min;刻蚀气体选用N2和O2的混合气体,气体流速均为0.4-0.6NL/min;
4)利用Plasma刻蚀,将源极电极与漏极电极之间的沟道上的SnS2材料去除,即获得二维半导体异质结阵列器件;步骤4)中,Plasma刻蚀的参数为: Low power;刻蚀时间为10-20s;刻蚀气体选用N2和O2的混合气体,气体流速为0.4-0.6 NL/min;
所述二维半导体异质结阵列器件,包含衬底、位于衬底上的沟道材料层阵列,间隔的位于每个沟道材料层上的两个接触层,以及分别位于两个接触层上的源极电极和漏极电极,沟道材料层与接触层为一体成型的WSe2/SnS2异质结材料,其中沟道材料层的材料为WSe2材料,接触层的材料为SnS2材料;所述WSe2材料为两层,所述SnS2材料为单层。
2.根据权利要求1所述的一种二维半导体异质结阵列器件的制备方法,其特征在于:步骤1)中,先采用物理气相沉积法于SiO2/Si衬底表面沉积获得WSe2材料,再采用化学气相沉积法在WSe2材料表面生长SnS2材料,获得WSe2/SnS2二维异质结材料。
3.根据权利要求1所述的一种二维半导体异质结阵列器件的制备方法,其特征在于:步骤1)中,所述WSe2/SnS2二维异质结材料的边长为200-600 µm。
4.根据权利要求1所述的一种二维半导体异质结阵列器件的制备方法,其特征在于:步骤2)中,利用电子束曝光将设计好的阵列化电极定点曝光在步骤1)所得的WSe2/SnS2二维异质结材料上,并经过热蒸发镀膜、剥离工艺、加工于WSe2/SnS2二维异质结材料表面形成阵列化的源极电极和漏极电极。
5.根据权利要求1所述的一种二维半导体异质结阵列器件的制备方法,其特征在于:所述源极电极和漏极电极的宽度为5-10 µm,所述源极电极和漏极电极之间的导电沟道长度为5-10 µm,宽度为5-10 µm。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的