[发明专利]总线收发器在审
| 申请号： | 202110438304.6 | 申请日： | 2021-04-22 |
| 公开（公告）号： | CN113542082A | 公开（公告）日： | 2021-10-22 |
| 发明（设计）人： | T·伊斯林格;M-M·赫尔;M·曼戈斯特;E·皮赫特;J·雷珀 | 申请（专利权）人： | 英飞凌科技股份有限公司 |
| 主分类号： | H04L12/40 | 分类号： | H04L12/40;G06F13/40;G06F13/42 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 闫昊 |
| 地址： | 德国诺伊*** | 国省代码： | 暂无信息 |
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| 摘要： | |||
| 搜索关键词： | 总线 收发 | ||
1.一种集成的驱动器电路，包括以下项：
第一接头(TXD)和第二接头(RXD)，所述第一接头和所述第二接头两者都可连接到控制芯片(10)；
至少一个总线接头(L+，L-)，所述总线接头可连接到总线线路；
控制电路(23，24)，所述控制电路被设计为在第一模式(M3)或第二模式(M1)中工作，其中所述控制电路被设计为：
在所述第二模式(M1)中，在所述第二接头(RXD)处输出接收信号(SRX)，所述接收信号表示在所述总线接头(L+，L-)处接收到的总线信号(VBUS)；以及
在所述第一模式(M3)中占据低功耗状态；以及
其中控制电路(23，24)还被设计为：
当在所述第一接头(TXD)或所述第二接头(RXD)处检测到第一命令时，从所述第一模式(M3)变换到所述第二模式(M1)；以及
当所述总线信号(VBUS)对于预定时间段(TS)未显示任何数据时，从所述第二模式(M1)变换到所述第一模式(M3)。
2.根据权利要求1所述的驱动器电路，
其中所述第一命令通过具有特定电平变化序列的二进制信号被表示。
3.根据权利要求1或2所述的驱动器电路，
其中所述控制电路还被设计为：在经过所述预定时间段(TS)之后从所述第二模式(M1)变换到所述第一模式(M3)之后，在所述第二接头(RXD)处输出确认信号。
4.根据权利要求1至3中任一项所述的驱动器电路，
其中所述第二接头(RXD)在所述第一模式(M3)中被配置为输入端，以及
其中所述控制电路(23、24)被设计为：当在被配置为输入段的所述第二接头(RXD)处接收到所述第一命令时，所述控制电路(23、24)从所述第一模式(M3)变换到所述第二模式(M1)。
5.根据权利要求4所述的驱动器电路，
其中所述第二接头(RXD)在所述第二模式(M1)中被配置为输出端，所述接收信号(SRX)在所述输出端处被输出。
6.根据权利要求1至5中任一项所述的驱动器电路，
其中所述控制电路(23、24)还被设计为：在第三模式(M2)中工作，在所述第三模式中，总线信号(VBUS)在所述总线接头(L+，L-)处被输出，所述总线信号表示在所述第一接头(TXD)处接收到的数据信号(STX)，以及
其中所述控制电路(23、24)还被设计为：当在所述第一接头(TXD)处检测到第二命令时，从所述第二模式(M1)变换到所述第三模式(M2)。
7.根据权利要求1至6中任一项所述的驱动器电路，
其中在所述第二模式(M1)中在所述总线接头(L+，L-)处接收到的总线信号(VBUS)符合10BASE-T1S标准。
8.一种网络节点，具有以下项：
微控制器(10)；
根据权利要求1至7中任一项所述的集成的驱动器电路，其中所述微控制器的第一引脚(OUT1)与所述驱动器电路(20)的所述第一接头(TXD)连接，并且所述微控制器的第二引脚(IN1)与所述驱动器电路(20)的所述第二接头(TXD)连接；以及
两线总线线路，所述两线总线线路连接到所述驱动器电路的所述总线接头(L+，L-)，
其中所述微控制器(10)被设计为：产生所述第一命令并将所述第一命令传输到所述驱动器电路(20)。
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