[发明专利]一种高复杂性四维超混沌电路在审
申请号: | 202110463487.7 | 申请日: | 2021-04-23 |
公开(公告)号: | CN113078995A | 公开(公告)日: | 2021-07-06 |
发明(设计)人: | 唐宋;宋梓豪;陈利娟;杨芳艳;季云峰;李清都 | 申请(专利权)人: | 上海理工大学 |
主分类号: | H04L9/00 | 分类号: | H04L9/00 |
代理公司: | 上海邦德专利代理事务所(普通合伙) 31312 | 代理人: | 梁剑 |
地址: | 200093 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 一种 复杂性 四维超 混沌 电路 | ||
1.一种高复杂性四维超混沌电路,其特征在于,包括第一通道电路、第二通道电路、第三通道电路和第四通道电路,其中:
所述第一通道电路包括乘法器A1、运放器U1A、运放器U1B、运放器U1C、电阻R1、电阻R2、电阻R3、电阻R4、电阻R5、电阻R6、电阻R7和电容C1;
所述乘法器A1的输出端与所述电阻R3相接,所述电阻R3与所述电阻R1和所述电阻R2并联后接入所述运放器U1A的负输入端,所述运放器U1A的输出端经所述电阻R4反馈接入所述运放器U1A的负输入端,所述运放器U1A的输出端经所述电阻R5连接后接入所述运放器U1B的负输入端,所述运放器U1B的输出端经所述电容C1反馈接入所述运放器U1B的负输入端,所述运放器U1B的输出端经所述电阻R6连接后接入所述运放器U1C的负输入端,所述运放器U1C的输出端经所述电阻R7反馈接入所述运放器U1C的负输入端;
所述第二通道电路包括乘法器A2、运放器U2A、运放器U2B、运放器U2C、电阻R8、电阻R9、电阻R10、电阻R11、电阻R12、电阻R13、电阻R14和电容C2;
所述乘法器A2的输出端与所述电阻R9相接,所述电阻R9与所述电阻R8和所述电阻R10并联后接入所述运放器U2A的负输入端,所述运放器U2A的输出端经所述电阻R11反馈接入所述运放器U2A的负输入端,所述运放器U2A的输出端经所述电阻R12连接后接入所述运放器U2B的负输入端,所述运放器U2B的输出端经所述电容C2反馈接入所述运放器U2B的负输入端,所述运放器U2B的输出端经所述电阻R13连接后接入所述运放器U2C的负输入端,所述运放器U2C的输出端经所述电阻R14反馈接入所述运放器U2C的负输入端;
所述第三通道电路包括乘法器A3、乘法器A4、运放器U3A、运放器U3B、运放器U3C、电阻R15、电阻R16、电阻R17、电阻R18、电阻R19、电阻R20、电阻R21和电容C3;
所述乘法器A3的输出端与所述电阻R15相接,所述乘法器A4的输出端与所述电阻R17相接,所述电阻R15与所述电阻R16和所述电阻R17并联后接入所述运放器U3A的负输入端,所述运放器U3A的输出端经所述电阻R18反馈接入所述运放器U3A的负输入端,所述运放器U3A的输出端经所述电阻R19连接后接入所述运放器U3B的负输入端,所述运放器U3B的输出端经所述电容C3反馈接入所述运放器U3B的负输入端,所述运放器U3B的输出端经所述电阻R20连接后接入所述运放器U3C的负输入端,所述运放器U3C的输出端经所述电阻R21反馈接入所述运放器U3C的负输入端;
所述第四通道电路包括运放器U4A、运放器U4B、电阻R22、电阻R23、电阻R24和电容C4;
所述电阻R22与所述运放器U4A的负输入端相接,所述运放器U4A的输出端经所述电阻R23反馈接入所述运放器U4A的负输入端,所述运放器U4A的输出端经所述电阻R24连接后接入所述运放器U4B的负输入端,所述运放器U4B的输出端经所述电容C4反馈接入所述运放器U4B的负输入端。
2.根据权利要求1所述的高复杂性四维超混沌电路,其特征在于,还存在x连接线路、-x连接线路、y连接线路、-y连接线路、z连接线路和w连接线路,其中:
在x连接线路中,所述运放器U1B的输出端经所述电阻R10反馈接入所述运放器U2A的负输入端,且所述运放器U1B的输出端分别接入所述乘法器A3的输入端和所述乘法器A4的输入端;
在-x连接线路中,所述运放器U1C的输出端经所述电阻R22反馈接入所述运放器U4A的负输入端,且所述运放器U1C的输出端接入所述乘法器A2的输入端;
在y连接线路中,所述运放器U2B的输出端经所述电阻R1反馈接入所述运放器U1A的负输入端,且所述运放器U2B的输出端接入分别所述乘法器A1的输入端和所述乘法器A4的输入端;
在-y连接线路中,所述运放器U2C的输出端经所述电阻R8反馈接入所述运放器U2A的负输入端;
在z连接线路中,所述运放器U3B的输出端经过所述电阻R16反馈接入所述运放器U3A的负输入端,所述运放器U3B的输出端分别接入所述乘法器A1的输入端和所述乘法器A2的输入端;
在w连接线路中,所述运放器U4B的输出端接入所述乘法器A3的输入端。
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