[发明专利]语句块封装方法、装置、电子设备及存储介质有效
申请号: | 202110606072.0 | 申请日: | 2021-06-01 |
公开(公告)号: | CN113255272B | 公开(公告)日: | 2021-10-01 |
发明(设计)人: | 邵中尉;张吉锋 | 申请(专利权)人: | 上海国微思尔芯技术股份有限公司 |
主分类号: | G06F30/34 | 分类号: | G06F30/34;G06F30/343;G06F30/347;G06F8/33 |
代理公司: | 北京清大紫荆知识产权代理有限公司 11718 | 代理人: | 黎飞鸿;张梦龙 |
地址: | 201306 上海市浦东新区中国(上海)自由*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 语句 封装 方法 装置 电子设备 存储 介质 | ||
本说明书实施例提供一种语句块封装方法、装置、电子设备及存储介质,应用于电子设计自动化技术领域,其中封装方法包括:根据RTL分割工具获得的分割边界确定若干待封装语句块;遍历每个所述待封装语句块,其中将当前所述待封装语句块所在的模块作为当前处理模块;扫描所述当前处理模块,确定所述当前处理模块是否包含黑盒信号,依据黑盒信号聚类子模块和语句块进行封装处理。通过以黑盒信号为纽带进行封装处理,使得RTL分割工具适用于对不同语法规则下的子模块和语句块进行封装处理,提高处理效率,实现快速布局规划。
技术领域
本发明涉及电子设计自动化技术领域,具体涉及一种语句块封装方法、装置、电子设备及存储介质。
背景技术
RTL(Register Transfer Level,寄存器转换级电路)分割工具的作用是将用户的芯片逻辑设计代码分割为若干部分的代码,分别运行在不同的FPGA(Field ProgrammableGate Array,现场可编程逻辑门阵列)上,其中FPGA之间通过互连线相互通信,FPGA可以进行并行综合和逻辑验证。其中,RTL分割工具的处理流程大致是:确定分割边界、封装语句块、形成图结构、图分割、图分割结果转回RTL级语言,从而便于综合工具对各部分RTL进行逻辑综合、布局布线等处理。
在利用RTL分割工具进行分割时,要求分割结果不应改变用户设计的逻辑,也要求尽可能少地改变用户原有代码的内容和层次结构等,以及能够根据分割结果还原用户原有代码的逻辑。
现有方案是直接扫描语句块的语法结构,分析并提取输入输出端口信号,并根据提取的信号对分割代码进行封装。
但是,在遇到含有复合结构的语句块时,如含有如interface/package/struct等复合结构体的语句块,需要深入到这些结构体内部,搜索并分析其语法和信号,而这些复合结构体的内部结构特别复杂,所涉及的语法类型数量都极其庞大,需要构建专用的语法解析库来匹配所有语法规则,才能保证正确解析。
另外,在将这些含有复杂结构的语句块封装为新module(模块)后,新module的代码形式与写法与用户原始设计存在不同,并且新module的代码变化属于不可逆,与RTL分割工具要求在切割边界模块以外的区域尽量减少对用户原始代码的修改相违背。
因此,亟需一种针对RTL分割语句块进行封装的新方案。
发明内容
有鉴于此,本说明书实施例提供一种语句块封装方法、装置、电子设备及存储介质,提高RTL分割工具的处理效率,实现快速布局规划。
本说明书实施例提供以下技术方案:
本说明书实施例提供一种语句块封装方法,包括:
根据RTL分割工具获得的分割边界确定若干待封装语句块;
遍历每个所述待封装语句块,其中将当前所述待封装语句块所在的模块作为当前处理模块;
扫描所述当前处理模块,确定所述当前处理模块是否包含黑盒信号,并执行:若所述当前处理模块中的对外端口信号中存在黑盒信号,则放弃对所述当前处理模块的处理,将实例化所述当前处理模块的父模块作为新的当前处理模块进行处理;若所述当前处理模块中的语句块和/或子模块中包含有黑盒信号,则将所述当前处理模块中包含有同一黑盒信号的语句块和/或子模块聚合封装为第一模块,并将所述第一模块进行实例化更新到所述当前处理模块中以对应替换所述当前处理模块中包含所述同一黑盒信号的语句块和/或子模块;若所述当前处理模块中未包含黑盒信号,则对所述当前处理模块中的各待封装语句块分别执行:扫描所述待封装语句块,提取端口信息,根据提取的端口信息将所述待封装语句块封装为第二模块,并将所述第二模块实例化更新到所述当前处理模块中以替换所述待封装语句块;
其中,所述黑盒信号包括RTL分割工具未支持的信号类型的信号。
本说明书实施例还提供一种语句块封装装置,包括:
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