[发明专利]基于FPGA处理指令的方法、装置、电子设备及介质在审

专利信息
申请号: 202110620641.7 申请日: 2021-06-03
公开(公告)号: CN113377440A 公开(公告)日: 2021-09-10
发明(设计)人: 占李洋 申请(专利权)人: 昆山丘钛微电子科技股份有限公司
主分类号: G06F9/38 分类号: G06F9/38
代理公司: 北京众达德权知识产权代理有限公司 11570 代理人: 张桂蓉
地址: 215300 江苏省苏*** 国省代码: 江苏;32
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摘要:
搜索关键词: 基于 fpga 处理 指令 方法 装置 电子设备 介质
【权利要求书】:

1.一种基于FPGA处理指令的方法,其特征在于,包括:

接收主处理器顺序发送的至少一条指令;

针对所述至少一条指令的当前目标指令,将所述当前目标指令并行分发至所述FPGA的多个执行模块,使得所述多个执行模块同步执行所述当前目标指令,并同步得到所述多个执行模块对所述当前目标指令的执行结果;

向所述主处理器反馈所述多个执行模块对所述当前目标指令的执行结果。

2.如权利要求1所述的基于FPGA处理指令的方法,其特征在于,所述将所述当前目标指令并行分发至所述FPGA的多个执行模块,包括:

解析所述当前目标指令的目标字段,获取所述当前目标指令的模块标识信息;

将所述当前目标指令并行分发至所述模块标识信息所指示的每个执行模块。

3.如权利要求1所述的基于FPGA处理指令的方法,其特征在于,所述向所述主处理器反馈所述多个执行模块对所述当前目标指令的执行结果,包括:

向所述主处理器反馈针对所述当前目标指令的指令反馈,所述指令反馈中包含所述多个执行模块中每个执行模块对所述当前目标指令的子执行结果。

4.如权利要求1-3中任一所述的基于FPGA处理指令的方法,其特征在于,所述FPGA内预先写有指令分发控制器以及M个执行模块,M为大于1的整数;

所述接收主处理器顺序发送的至少一条指令,包括:通过所述指令分发控制器接收主处理器顺序发送的一条指令或者多条不同指令;

所述将所述当前目标指令并行分发至所述FPGA的多个执行模块,包括:通过所述指令分发控制器将所述当前目标指令并行分发至所述FPGA的N个执行模块,N为小于或者等于M的正整数。

5.如权利要求4所述的基于FPGA处理指令的方法,其特征在于,所述当前目标指令用于完成针对N摄像头模组的同一测试步骤。

6.一种基于FPGA测试摄像头模组的方法,其特征在于,包括:

接收主处理器顺序发送的至少一条测试指令;

针对所述至少一条测试指令的当前测试指令,将所述当前测试指令分发至所述FPGA的N个执行模块,使得所述N个执行模块同步执行所述当前测试指令,以同步得到针对N个摄像头模组的测试反馈数据,所述测试反馈数据包含对应所述N个摄像头模组的相同测试步骤的测试结果,N为大于1的整数;

向所述主处理器反馈所述测试反馈数据。

7.如权利要求6所述的基于FPGA测试摄像头模组的方法,其特征在于,所述FPGA内预先写入有指令分发控制器和M个执行模块,M为大于或者等于N的整数,所述接收主处理器顺序发送的至少一条测试指令,包括:

通过所述指令分发控制器接收所述主处理器顺序发送的一条测试指令或者多条不同测试指令;

将所述当前测试指令分发至所述FPGA的N个执行模块,包括:通过所述指令分发控制器将所述当前测试指令分发至所述FPGA的N个执行模块。

8.一种基于FPGA处理指令的装置,其特征在于,包括:

第一指令分发控制器,用于接收主处理器顺序发送的至少一条指令;以及用于针对所述至少一条指令的当前目标指令,将所述当前目标指令并行分发至所述FPGA的多个执行模块;

第一指令执行器,用于通过所述多个执行模块同步执行所述当前目标指令,并同步得到所述多个执行模块对所述当前目标指令的执行结果;

第一发送器,用于向所述主处理器反馈所述多个执行模块对所述当前目标指令的执行结果。

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