[发明专利]交织方法、交织器及存储介质有效
申请号: | 202110648005.5 | 申请日: | 2021-06-10 |
公开(公告)号: | CN113381770B | 公开(公告)日: | 2022-11-04 |
发明(设计)人: | 刘福良;房旭;张丽君;张汇洋 | 申请(专利权)人: | OPPO广东移动通信有限公司 |
主分类号: | H03M13/13 | 分类号: | H03M13/13;H03M13/27 |
代理公司: | 广州德科知识产权代理有限公司 44381 | 代理人: | 蔡丽妮;万振雄 |
地址: | 523860 广东*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 交织 方法 存储 介质 | ||
本发明实施例公开了一种交织方法、交织器及存储介质,应用于通信技术领域,可以解决目前的交织方法需要的存储器的存储空间较大,对存储器硬件的要求较高的问题。该方法包括:根据目标序列长度,确定Polar编码核的输出比特按照等腰直角三角形交织方式写入时每一列的比特数,目标序列长度为Polar编码核的输出比特通过速率匹配后的比特序列长度;根据每一列的比特数以及交织总行数,确定Polar编码核的输出比特进行比特交织后的输出比特序号,交织总行数为等腰直角三角形交织方式所对应的总行数。
技术领域
本发明实施例涉及通信技术领域,尤其涉及一种交织方法、交织器及存储介质。
背景技术
极化码(即Polar码)是一种高性能的信道编码方法,在3GPP协议38.212中被确定为5G新无线(New Radio,NR)上下行控制信道的编码方案。Polar码利用比特交织能够显著提高信道编码性能的技术,通过调整编码输出序列比特的顺序,能够有效降低信道突发错误对于译码性能的影响。
3GPP协议38.212中规定上行Polar码的编码输出序列采用等腰直角三角形交织方法,即将速率匹配后的编码比特序列按行写入一个等腰直角三角形交织器,然后按列将编码比特序列读出。例如,Polar编码核输出的编码比特序列的长度最大可以为1024,假设速率匹配之后的编码比特序列长度为8192,实际中需要采用矩形存储器实现等腰直角三角形交织,为了满足最大8192比特编码序列的交织,该矩形存储器的大小至少为8192*2=16384比特,该交织方法需要的存储器的存储空间较大,对存储器硬件的要求较高。
发明内容
本发明实施例提供一种交织方法、交织器及存储介质,用以解决现有技术中目前的交织方法需要的存储器的存储空间较大,对存储器硬件的要求较高的问题。
为了解决上述技术问题,本发明实施例是这样实现的:
第一方面,提供一种交织方法,包括:
根据目标序列长度,确定Polar编码核的输出比特按照等腰直角三角形交织方式写入时每一列的比特数,目标序列长度为Polar编码核的输出比特通过速率匹配后的比特序列长度;
根据每一列的比特数以及交织总行数,确定Polar编码核的输出比特进行比特交织后的输出比特序号,交织总行数为等腰直角三角形交织方式所对应的总行数。
第二方面,提供一种交织器,包括:处理器、存储器及存储在存储器上并可在处理器上运行的计算机程序,计算机程序被处理器执行时实现如第一方面的基于Polar编解码的交织方法。
第三方面,提供一种交织器,包括:
2n个寄存器,用于缓存Polar编码核的输出比特,2n是根据Polar编码核的输出比特的序列长度确定的;
2p个选1的MUX,每个选1的MUX的连接2n个寄存器中的个寄存器,2p个选1的MUX用于从2n个寄存器中选择Polar编码核的输出比特中的2p个比特,将2p个比特,进行2p路并行输出。
第四方面,提供一种交织器,包括:
处理模块,用于根据目标序列长度,确定Polar编码核的输出比特按照等腰直角三角形交织方式写入时每一列的比特数,目标序列长度为Polar编码核的输出比特通过速率匹配后的比特序列长度;
根据每一列的比特数以及交织总行数,确定Polar编码核的输出比特进行比特交织后的输出比特序号,交织总行数为等腰直角三角形交织方式所对应的总行数。
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