[发明专利]处理晶片、插件装置以及操作方法在审
申请号: | 202110698265.3 | 申请日: | 2021-06-23 |
公开(公告)号: | CN115509614A | 公开(公告)日: | 2022-12-23 |
发明(设计)人: | 黄振庭;翁而咨;朱世强;林群皓 | 申请(专利权)人: | 瑞昱半导体股份有限公司 |
主分类号: | G06F9/4401 | 分类号: | G06F9/4401;H04L12/46 |
代理公司: | 北京康信知识产权代理有限责任公司 11240 | 代理人: | 刘瑞贤 |
地址: | 中国台*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 处理 晶片 插件 装置 以及 操作方法 | ||
1.一种处理晶片,包含:
一逻辑电路,用以耦接一电子装置,其中该逻辑电路的组态对应多个候选组态,
其中该逻辑电路的组态在该多个候选组态中切换,以使该电子装置协同该处理晶片实现对应于该逻辑电路的组态的一功能,
其中当该逻辑电路的组态为一第一组态且该电子装置执行一第一驱动程序时,该功能为一第一连网功能,
其中当该逻辑电路的组态为一第二组态且该电子装置执行一第二驱动程序时,该功能为不同于该第一连网功能的一第二连网功能。
2.根据权利要求1所述的处理晶片,其中,该第一连网功能的一第一封包碰撞率高于该第二连网功能的一第二封包碰撞率。
3.根据权利要求1所述的处理晶片,其中,该处理晶片配置于一插件装置中,该插件装置还包含一存储器,且该存储器储存一第三驱动程序,其中该多个候选组态还包含一第三组态,
其中当该逻辑电路的组态切换为该第三组态时,该电子装置执行该第三驱动程序以实现一第三连网功能。
4.根据权利要求1所述的处理晶片,其中,该逻辑电路的组态从该第一组态切换为该第二组态,
其中当该逻辑电路的组态为该第一组态且该电子装置的一操作系统包含该第一驱动程序时,该功能包含该第一连网功能以及下载该第二驱动程序,
其中当该逻辑电路的组态切换为该第二组态时,该功能为执行下载的该第二驱动程序以实现该第二连网功能。
5.根据权利要求4所述的处理晶片,其中,该第一组态包含一第一基础连网组态以及一第二基础连网组态,该逻辑电路的组态从该第一基础连网组态切换为该第二基础连网组态,且从该第二基础连网组态切换为该第二组态,其中该第一基础连网组态为一网络控制模式组态和一以太网络控制模式组态中的一者,且该第二基础连网组态为该网络控制模式组态和该以太网络控制模式组态中的另一者。
6.根据权利要求1所述的处理晶片,其中,该处理晶片配置于一插件装置中,该插件装置上配置一开关元件,其中该处理晶片具有一引脚且该引脚耦接该开关元件以及该逻辑电路,且该引脚依据相关于该开关元件上的一操作输出控制信号,
其中该逻辑电路的组态依据来自该引脚的一该控制信号该多个候选组态中切换。
7.根据权利要求1所述的处理晶片,还包含:
一计时器,耦接该逻辑电路,该计时器用以在一临限时间内未检测到一特征值时输出一控制信号以切换该逻辑电路的组态,其中该特征值对应于一封包形式。
8.根据权利要求1所述的处理晶片,其中,该逻辑电路的组态依据来自该电子装置的一指令而切换,其中该指令由该电子装置中一操作系统的一通用串行总线驱动程序或一应用程序依据该电子装置的一应用场景所产生。
9.一种插件装置,包含:
一处理晶片,包含一逻辑电路,该插件装置用以耦接一电子装置,其中该逻辑电路的组态对应多个候选组态,
其中该逻辑电路的组态在该多个候选组态中切换,以使该电子装置协同该处理晶片实现对应于该逻辑电路的组态的一功能,
其中当该逻辑电路的组态为一第一组态且该电子装置执行一第一驱动程序时,该功能为一第一连网功能,
其中当该逻辑电路的组态为一第二组态且该电子装置执行一第二驱动程序时,该功能为不同于该第一连网功能的一第二连网功能。
10.一种电子系统的操作方法,其中,该电子系统包含一插件装置以及一电子装置,该插件装置用以耦接该电子装置,该插件装置包含一处理晶片,且该操作方法包含:
将该处理晶片中的一逻辑电路的组态在多个候选组态中切换;以及
通过该电子装置协同该处理晶片实现对应于该逻辑电路的组态的一功能,
其中当该逻辑电路的组态为一第一组态且该电子装置执行一第一驱动程序时,该功能为一第一连网功能,
其中当该逻辑电路的组态为一第二组态且该电子装置执行一第二驱动程序时,该功能为不同于该第一连网功能的一第二连网功能。
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