[发明专利]数据传输测试方法、装置、设备以及存储介质有效
申请号: | 202110713111.7 | 申请日: | 2021-06-25 |
公开(公告)号: | CN113609056B | 公开(公告)日: | 2023-08-25 |
发明(设计)人: | 肖熠;霍志坤;李志功 | 申请(专利权)人: | 曙光信息产业(北京)有限公司 |
主分类号: | G06F13/42 | 分类号: | G06F13/42;G06F13/40;H04L1/00 |
代理公司: | 北京清亦华知识产权代理事务所(普通合伙) 11201 | 代理人: | 孙立波 |
地址: | 100193 北京*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 数据传输 测试 方法 装置 设备 以及 存储 介质 | ||
1.一种数据传输测试方法,其特征在于,包括:
获取目标节点的拓扑结构信息,所述拓扑结构信息包括CPU和异构加速器的存储空间以及数据链路信息;
根据所述拓扑结构信息和待测试的传输策略创建多个测试项,每个所述测试项包括待传输数据长度、一个待测试的传输策略和一条待测试连接链路,所述待测试连接链路为所述数据链路信息中的连接链路;
根据所述多个测试项进行数据传输测试,得到每个测试项的测试结果;
根据所述每个测试项的测试结果,确定所述数据链路信息中每条连接链路的传输策略信息,所述传输策略信息包括传输数据长度区间和传输时间最小的传输策略的对应关系。
2.根据权利要求1所述的方法,其特征在于,所述数据链路信息包括CPU与异构加速器之间的连接链路和距离以及两个异构加速器之间的连接链路和距离,获取所述目标节点的数据链路信息,包括:
根据每个CPU与异构加速器之间的连接链路的类型和每个CPU与异构加速器之间的非统一内存访问NUMA距离,确定每个CPU与异构加速器之间的距离;
根据两个异构加速器的连接链路的类型和两个异构加速器之间的NUMA距离,确定两个异构加速器之间的距离;
其中,所述连接链路的类型包括PCI-E链路和高速互联链路。
3.根据权利要求1或2所述的方法,其特征在于,所述根据所述拓扑结构信息和待测试的传输策略创建多个测试项,包括:
依次选取所述数据链路信息中的一条连接链路作为待测试连接链路,根据所述待测试连接链路的两个传输方的存储空间,确定传输数据长度的取值区间,所述传输数据长度的取值区间的第一端值为预设值,所述传输数据长度的取值区间的第二端值为所述待测试连接链路的两个传输方的存储空间中的最小值,所述传输方为CPU或异构加速器;
根据所述传输数据长度的取值区间和预设间隔确定多个待传输数据长度;
根据所述待测试连接链路、所确定的多个待传输数据长度和所述待测试的传输策略,创建多个测试项。
4.根据权利要求3所述的方法,其特征在于,所述待测试的传输策略包括CPU直接传输策略、SDMA传输策略和临时缓冲区传输策略中的至少一个,所述临时缓冲区传输策略携带策略设置信息,所述策略设置信息包括缓冲区大小的取值区间和缓冲区数量的取值区间;
若所述待测试的传输策略为所述临时缓冲区传输策略,所述根据所述待测试连接链路、所确定的多个待传输数据长度和所述待测试的传输策略,创建多个测试项,包括:
根据所述缓冲区大小的取值区间和所述缓冲区数量的取值区间,确定出多个待测试的临时缓冲区传输策略,每一个待测试的临时缓冲区传输策略对应一缓冲区大小和缓冲区数量;
根据所述待测试连接链路、所确定的多个待传输数据长度和所述待测试的临时缓冲区传输策略,创建多个测试项。
5.根据权利要求1所述的方法,其特征在于,所述根据所述多个测试项进行数据传输测试,得到每个测试项的测试结果,包括:
依次对每个测试项,使用所述待测试的传输策略将所述待传输数据长度在所述待测试连接链路上进行数据传输,得到每个测试项的测试结果。
6.根据权利要求1所述的方法,其特征在于,所述测试结果包括传输时间,所述根据所述每个测试项的测试结果,确定所述数据链路信息中每条连接链路的传输策略信息,包括:
分别根据所述每条连接链路对应的测试项及测试项的测试结果,确定所述每条连接链路下所有待测试的传输策略对应的多条传输时间曲线,所述传输时间曲线表征待传输数据长度与传输时间的对应关系;
从所述多条传输时间曲线中查找第一关键点、第二关键点和第三关键点,所述第一关键点为所述多条传输时间曲线的交点,所述第二关键点和所述第三关键点分别为所述多条传输时间曲线中最小长度的待传输数据传输时间最小时对应的点和最大长度的待传输数据传输时间最小时对应的点;
根据所述第一关键点、所述第二关键点、所述第三关键点和所述多条传输时间曲线,确定所述传输策略信息。
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