[发明专利]一种实时视频图像采集处理系统有效
申请号: | 202110718246.2 | 申请日: | 2021-06-28 |
公开(公告)号: | CN113438435B | 公开(公告)日: | 2022-05-24 |
发明(设计)人: | 庄游彬;李非桃;唐开东;鄢冬斌;郑勇;王彬;晋中明;唐杨;陈春;魏兴龙;王寻宇;肖兴 | 申请(专利权)人: | 四川赛狄信息技术股份公司 |
主分类号: | H04N7/01 | 分类号: | H04N7/01;H04N5/262 |
代理公司: | 成都行之专利代理事务所(普通合伙) 51220 | 代理人: | 李朝虎 |
地址: | 610000 四*** | 国省代码: | 四川;51 |
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摘要: | |||
搜索关键词: | 一种 实时 视频 图像 采集 处理 系统 | ||
1.一种实时视频图像采集处理系统,其特征在于,包括光电传感器模块、采样处理模块和显示模块;
所述采样处理模块用于对光电传感器模块输入的模拟信号顺序采样保持、处理后生成数字信号,所述采样处理模块发送生成的数字信号至显示模块,所述采样处理模块还发送采样记录至显示模块;
显示模块用于采样记录数字信号进行数据处理并进行图像显示;
采样处理模块用于对光电传感器模块传入的模拟信号进行多通道采样处理,采样处理模块还包括依次连接的积分器、两级ADC、DAC和加法器,积分器接入光电传感器模块,积分器用于将每个通道的模拟信号转换为电压,第一级ADC将电压转换为高位数字信号,高位数字信号接入DAC,DAC用于将高位数字信号中的残差电压进行放大输出,加法器接入DAC的输出端与第一级ADC的输入端,加法器后接入第二级ADC,加法器用于将第一级ADC的输入信号与DAC残差电压放大输出的信号进行相减,第二级ADC用于将加法器的输出信号进行数字输出为低位数字信号;
所述采样处理模块包括MUX buffer,MUX buffer用于采样并记录高位数字信号、低位数字信号的产生时序,MUX buffer还用于采样高位数字信号、低位数字信号的位间传输时隙,MUX buffer用于对采样电容的保持时间进行记录;
还包括MUXbuffer的闭环反馈控制电路,包括记录采样电容保持时间的存储模块与修改MUX buffer时序控制的处理模块,处理模块用于调整下一通道高位数字信号输出的时序间隔。
2.根据权利要求1所述的一种实时视频图像采集处理系统,其特征在于,还包括接入所述采样处理模块的DSP处理器,DSP处理器连接上位机,所述DSP处理器包括RS422串口、网口通讯接口,所述DSP处理器通过千兆网和串口与上位机连接,所述上位机载入并监测采样处理模块的处理数据,所述上位机用于监测采样处理模块的温度并提供过热保护。
3.根据权利要求1所述的一种实时视频图像采集处理系统,其特征在于,所述显示模块内还包括信号处理模块,所述信号处理模块对高位数字信号、低位数字信号进行数字信号处理,所述信号处理模块用于将模拟数据进行数据重建并进行图像显示。
4.根据权利要求1所述的一种实时视频图像采集处理系统,其特征在于,所述第一级ADC采用多通道的SARADC,SARADC为逐次逼近寄存器型模数转换器。
5.根据权利要求1所述的一种实时视频图像采集处理系统,其特征在于,所述MUXbuffer还接入包括auto-zeroing模块,所述auto-zeroing模块用于消除同一组数据各通道之间的失调误差,失调误差为积分器进行采样保持时开关电荷的注入误差。
6.根据权利要求2所述的一种实时视频图像采集处理系统,其特征在于,还包括DDR3缓存条,DDR3缓存条连接DSP处理器,DDR3缓存条与采样处理模块进行双向读写,所述DDR3缓存条内存储采样处理模块的驱动程序,所述DDR3缓存条包括两个分区,第一分区和第二分区,DDR3缓存条通过DSP处理器从上位机上、下载采样处理模块的驱动程序,第一分区内存储当前驱动程序,第二分区内按时间记录存储旧版驱动程序,所述DDR3缓存条用于在采集处理的过程中更新驱动程序。
7.根据权利要求1所述的一种实时视频图像采集处理系统,其特征在于,所述光电传感器模块为多组光电成像模组,每组光电成像模组为一个规则区域的光敏二极管板,多组光电成像模组构成光电成像阵列,所述光电成像阵列通过总线连接采样处理模块,每组光电成像模组对应一个采样处理模块,多个采样处理模块之间的时钟信号同步且采用同一个时钟控制,多个采样处理模块连接的多个显示模块的位置与光电成像模组的位置对应。
8.根据权利要求1所述的一种实时视频图像采集处理系统,其特征在于,所述MUXbuffer为多路调制开关。
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