[发明专利]执行通信的装置和包括该装置的计算系统在审

专利信息
申请号: 202110782305.2 申请日: 2021-07-12
公开(公告)号: CN115185875A 公开(公告)日: 2022-10-14
发明(设计)人: 全勇泰;朴大植;赵承德 申请(专利权)人: 爱思开海力士有限公司
主分类号: G06F13/42 分类号: G06F13/42;G06F13/16
代理公司: 北京路浩知识产权代理有限公司 11002 代理人: 宋玉环;刘成春
地址: 韩国*** 国省代码: 暂无信息
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摘要:
搜索关键词: 执行 通信 装置 包括 计算 系统
【说明书】:

本发明涉及一种可以限制能够在上游端口中控制通路裕量操作的每个功能的性能的装置。该装置包括:上游端口,用于通过链路从位于上游路径上的一个或多个外部装置接收数据或向位于上游路径上的一个或多个外部装置发送数据,链路包括多个通路;通路裕量控制器,联接到上游端口并且用于经由上游端口向一个或多个外部装置发送用于请求通路裕量操作的裕量命令以获取裕量状态信息,裕量状态信息指示多个通路中的每一个的裕量,并且该通路裕量控制器控制上游端口从外部装置接收裕量状态信息;以及端口设置控制器,联接为与上游端口通信以接收裕量状态信息并且用于基于裕量状态信息来确定上游端口的设置。

相关申请的交叉引用

专利文件要求于2021年4月1日提交的申请号为10-2021-0042642的韩国专利申请的优先权和权益,该韩国专利申请通过引用全部并入本文。

技术领域

所公开的技术总体涉及一种电子装置,并且更特别地,涉及一种执行通信的装置和包括该装置的计算系统。

背景技术

诸如外围组件互连(PCI)的计算机总线用于将外围装置连接到计算机系统。高速PCI(PCIe)是在与PCI标准保持软件兼容性的同时,包括作为高速串行接口的物理通信层的高速计算机总线标准。

数据存储装置用于响应于来自诸如计算机或智能手机的主机装置的请求而存储或提供数据。这种数据存储装置可以包括用于存储数据的一个或多个存储器装置和用于控制该一个或多个存储器装置的存储器控制器。存储器装置可以分类为易失性存储器装置和非易失性存储器装置。

易失性存储器装置仅在装置通电时保持其数据并且在失电时丢失其数据。易失性存储器装置的示例可以包括静态随机存取存储器(SRAM)或动态随机存取存储器(DRAM)。

非易失性存储器装置即使在不存在电力供应的情况下也保持所存储的数据,因此当失电时不丢失其数据。非易失性存储器装置的示例包括只读存储器(ROM)、可编程ROM(PROM)、电可编程ROM(EPROM)、电可擦除ROM(EEROM)和闪速存储器。

发明内容

所公开的技术的实施例涉及一种能够控制上游端口中的通路裕量操作的高速外围组件互连(PCIe)装置以及包括该PCIe装置的计算系统。

根据所公开技术的一个方面,提供一种执行计算系统中的组件之间的通信的装置,该装置包括:上游端口,被构造为通过链路从位于上游路径上的一个或多个外部装置接收数据或向位于上游路径上的一个或多个外部装置发送数据,链路包括多个通路,多个通路被构造为包括用于接收和发送数据的差分信号对;通路裕量控制器,联接到上游端口并且被配置为经由上游端口向一个或多个外部装置发送用于请求通路裕量操作的裕量命令,以获取裕量状态信息,该裕量状态信息指示多个通路中的每一个的裕量,并且该通路裕量控制器控制上游端口从外部装置接收裕量状态信息;以及端口设置控制器,联接为与上游端口通信以接收裕量状态信息并且可操作成基于裕量状态信息来确定上游端口的设置。

基于所公开技术的另一方面,提供一种计算系统,该计算系统包括:第一装置,被构造为包括下游端口并且根据高速外围组件互连(PCIe)标准经由下游端口来接收和发送数据;以及第二装置,被构造为包括通过链路而连接到第一装置的下游端口的上游端口,链路包括多个通路,其中第二装置被配置为:根据高速外围组件互连(PCIe)标准经由上游端口通过第一装置来接收和发送数据,通过上游端口来向第一装置发送裕量命令,接收裕量状态信息作为对来自第一装置的裕量命令的响应,该裕量状态信息指示多个通路中的每一个的裕量,并且基于裕量状态信息来确定上游端口的设置。

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