[发明专利]快速重新锁定DLL电路的方法在审
申请号: | 202111082977.9 | 申请日: | 2021-09-15 |
公开(公告)号: | CN113904680A | 公开(公告)日: | 2022-01-07 |
发明(设计)人: | 亚历山大;上官朦朦 | 申请(专利权)人: | 浙江力积电子有限公司 |
主分类号: | H03L7/081 | 分类号: | H03L7/081;G11C11/4076 |
代理公司: | 江苏坤象律师事务所 32393 | 代理人: | 赵新民 |
地址: | 321000 浙江省金华市金*** | 国省代码: | 浙江;33 |
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摘要: | |||
搜索关键词: | 快速 重新 锁定 dll 电路 方法 | ||
1.快速重新锁定DLL电路的方法,DLL电路包括控制模块和延迟链模组;所述延迟链模组包括串联的粗调延迟模块和精调延迟模块;其特征在于:步骤包括:
步骤S1.通过所述控制模块获取当前外部时钟和所述DLL电路反馈时钟的相位差以及所述粗调延迟模块提供的当前延迟量;
步骤S2.判断所述当前延迟量能否继续改变以补偿所述相位差,实时检测是否存在上溢或下溢;
若不存在,通过所述控制模块基于所述相位差更新当前的控制信号以调节所述当前延迟量更新所述反馈时钟,返回所述步骤S1;若存在,通过所述控制模块随机生成更新的控制信号以设定所述当前延迟量使得所述DLL电路脱离所述上溢或所述下溢,返回所述步骤S1;
重复所述步骤S1至所述步骤S2直至所述外部时钟与所述反馈时钟相位对齐。
2.根据权利要求1所述的快速重新锁定DLL电路的方法,其特征在于:所述粗调延迟模块包括若干延迟链路,所述延迟链路包括级联的多个延迟单元,所述当前延迟量基于所述DLL电路的内部时钟所经历的所述延迟单元个数;所述实时检测是否存在上溢或下溢的做法包括:
根据所述相位差确定需要继续增加或减少所述当前延迟量;
通过所述控制模块获取当前已使用的延迟单元个数,并判断能否继续改变延迟单元个数继续增加或减少所述当前延迟量。
3.根据权利要求2所述的快速重新锁定DLL电路的方法,其特征在于:检测存在所述上溢的方法是:若需要继续增加所述当前延迟量而当前已使用的所述延迟单元已是最多,则判断存在所述上溢。
4.根据权利要求2所述的快速重新锁定DLL电路的方法,其特征在于:检测存在所述下溢的方法是:若需要继续减少所述当前延迟量而当前已使用的所述延迟单元已是最少,则判断存在所述下溢。
5.根据权利要求2-4任意一项所述的快速重新锁定DLL电路的方法,其特征在于:所述控制信号包括第一控制信号和第二控制信号;所述内部时钟响应于所述第一控制信号经历若干所述延迟单元得到第一时钟;所述内部时钟响应于所述第二控制信号经历若干所述延迟单元得到第二时钟;
使得所述DLL电路脱离所述上溢或所述下溢的做法是:
保持当前的所述第一控制信号不变以保持当前的所述第一时钟不变;
随机生成新的所述第二控制信号,控制所述内部时钟经历随机个数的所述延迟单元更新所述第二时钟;
基于当前的所述第一时钟和更新的所述第二时钟更新所述反馈时钟。
6.根据权利要求5所述的快速重新锁定DLL电路的方法,其特征在于:在随机生成更新的所述第二控制信号之前,使用当前的所述第一时钟经过所述DLL电路作为当前输出数据的临时时钟。
7.根据权利要求5所述的快速重新锁定DLL电路的方法,其特征在于:所述DLL电路还包括连接所述粗调延迟模块输入端的占空比调整模块,用于接收外部时钟并调整其占空比后输出所述内部时钟;所述延迟链路包括分别有N个延迟单元的第一支链和第二支链;
得到第一时钟的做法是:所述内部时钟经历所述第一支链的i个所述延迟单元延迟得到第一时钟,1≤i≤N;
得到第二时钟的做法是:所述内部时钟经历所述第二支链的j个所述延迟单元延迟得到第二时钟,1≤j≤N;
其中N、i和j是正整数;判断能否继续改变延迟单元个数以继续增加或减少所述当前延迟量的过程包括判断i和j的差值能否继续增加或减少。
8.根据权利要求7所述的快速重新锁定DLL电路的方法,其特征在于:所述第一时钟为奇分频信号;所述第二时钟为偶分频信号。
9.根据权利要求8所述的快速重新锁定DLL电路的方法,其特征在于:所述控制信号还包括精调控制信号;更新所述反馈时钟的做法包括:所述精调延迟模块响应于所述精调控制信号,基于所述第一时钟和所述第二时钟的相位差延迟所述第一时钟,得到并输出延迟时钟;对所述延迟时钟累加系统固定延迟得到所述反馈时钟。
10.根据权利要求9所述的快速重新锁定DLL电路的方法,其特征在于:得到所述延迟时钟的做法是:基于延迟精度要求将所述第一时钟与第二时钟相位差均分为若干延迟步长;将所述第一时钟累加延迟m个所述延迟步长得到所述延迟时钟。
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