[发明专利]人机接口设备的延迟确定在审
申请号: | 202111172348.5 | 申请日: | 2021-10-08 |
公开(公告)号: | CN114296843A | 公开(公告)日: | 2022-04-08 |
发明(设计)人: | D·利姆;H-L·林;T·J·D·韦伯;G·斯拉文博格;S·施耐德 | 申请(专利权)人: | 辉达公司 |
主分类号: | G06F9/451 | 分类号: | G06F9/451;G06F9/455;G06F9/50;G06T15/00 |
代理公司: | 北京市磐华律师事务所 11336 | 代理人: | 高伟 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 人机 接口 设备 延迟 确定 | ||
1.一种方法,包括:
由计算设备确定从通信地耦合到所述计算设备的输入设备接收到数据包;以及
由所述计算设备并且从所述数据包检索指示与在所述输入设备处接收的输入相关联的延迟值的数据,所述延迟值对应于在所述输入设备处接收的所述输入与表示由所述计算设备正在接收的所述输入的输入数据之间的时间量。
2.根据权利要求1所述的方法,其中所述延迟值是第一延迟值,并且所述方法还包括:
确定对应于由所述计算设备正在接收的所述输入数据与反映所述输入数据的显示之间的另一时间量的第二延迟值;以及
至少部分地基于所述第一延迟值和所述第二延迟值来计算端到端延迟值。
3.根据权利要求2所述的方法,还包括:显示表示所述第一延迟值、所述第二延迟值或所述端到端延迟值中的至少一者的数据。
4.根据权利要求1所述的方法,其中检索所述数据包括:响应于确定接收到所述数据包,拦截所述数据包。
5.根据权利要求1所述的方法,其中所述计算设备包括显示设备,并且所述显示设备包括用于所述输入设备的连接类型的传递功能。
6.根据权利要求5所述的方法,其中检索所述数据包括:使用所述显示设备的现场可编程门阵列(FPGA)来计算所述延迟值。
7.根据权利要求1所述的方法,其中从所述输入设备接收的每个数据包包括对应于所述延迟值的数据字段,并且从所述数据包中的所述数据字段的实例检索所述数据。
8.根据权利要求7所述的方法,其中在配置所述输入设备期间,接收表示对应于所述输入设备的报告描述符的数据,所述报告描述符标识所述数据字段在每个数据包内的位置。
9.一种方法,包括:
响应于接收到输入,生成对应于接收所述输入的时间的第一时间戳;
将表示所述输入的输入数据发送到计算设备;
至少部分地基于所述发送,生成对应于由所述计算设备接收所述输入数据的时间的第二时间戳;
至少部分地基于所述第一时间戳和所述第二时间戳来计算外围延迟值;
生成包括所述外围延迟值的数据包;以及
将所述数据包发送到所述计算设备。
10.根据权利要求9所述的方法,其中所述方法由通信地耦合到所述计算设备的人机接口设备(HID)执行。
11.根据权利要求9所述的方法,其中计算所述外围延迟值包括:确定所述第一时间戳与所述第二时间戳之间的差,所述外围延迟值等于所述差。
12.根据权利要求9所述的方法,还包括:
在配置期间,发送表示报告描述符的数据,所述报告描述符包括每个数据包包括针对外围延迟值指定的数据字段的指示。
13.根据权利要求12所述的方法,其中生成所述数据包包括:用所述外围延迟值填充所述数据字段。
14.根据权利要求9所述的方法,其中所述方法由作为计算系统的一部分的人机接口设备(HID)执行,并且其中所述外围延迟值被用作多个延迟组件中的一个延迟组件,所述多个延迟组件用于确定所述计算系统的端到端延迟。
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