[发明专利]一种电荷泵不交叠时钟控制方法及电路在审
申请号: | 202111216055.2 | 申请日: | 2021-10-19 |
公开(公告)号: | CN113922640A | 公开(公告)日: | 2022-01-11 |
发明(设计)人: | 徐华超;胡胜发 | 申请(专利权)人: | 广州安凯微电子股份有限公司 |
主分类号: | H02M1/088 | 分类号: | H02M1/088;H02M3/07 |
代理公司: | 广州三环专利商标代理有限公司 44202 | 代理人: | 郭浩辉;颜希文 |
地址: | 510799 广*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 电荷 交叠 时钟 控制 方法 电路 | ||
1.一种电荷泵不交叠时钟控制方法,其特征在于,适用于电荷泵电路,所述电荷泵电路,包括:
第一PMOS管、第二PMOS管、第三PMOS管、第一NMOS管、第二MOS管、第三NMOS管、第四NMOS管、第一电容、第二电容和第三电容;所述第一PMOS管的源端接电源输入端,栅端与第一驱动时钟输入端连接,漏端分别与第一电容的上极板和第三NMOS管的漏端连接;所述第一电容的下极板分别与第一NMOS管的漏端以及第二PMOS管的源端连接;所述第一NMOS管的栅端与第二驱动时钟输入端连接;所述第二PMOS管的栅端与电压输出端连接,漏端分别与第二电容的上极板和第四NMOS管的漏端连接;所述第二电容的下极板分别与第二NMOS管的漏端以及第三PMOS管的源端连接;所述第二NMOS管的栅端与所述第二驱动时钟输入端连接;所述第三NMOS管的栅端与第三驱动时钟输入端连接,源端接电路输出端;所述第四NMOS管的栅端与所述第三驱动时钟输入端连接,源端接电路输出端;所述第三PMOS管的栅端与第四驱动时钟输入端连接,漏端接电路输出端;第三电容的上极板与所述电压输出端连接;
所述控制方法包括:
对于所述电荷泵电路中不同位置的MOS管,确定每一所述MOS管在关闭以及充分导通时,其对应驱动时钟的逻辑对应的电压值;
在所述电荷泵电路充电阶段时,控制正电荷仅通过所述第一电容和所述第二电容流向所述电路输出端。
2.如权利要求1所述的电荷泵不交叠时钟控制方法,其特征在于,所述确定每一所述MOS管在关闭以及充分导通时,其对应驱动时钟的逻辑对应的电压值,包括:
对于不同位置的NMOS管,确定每一所述NMOS管关闭时需要的第一电压值,将所述第一电压值设定为每一所述NMOS管对应驱动时钟的逻辑0对应的电压值;设置所述每一NMOS管充分导通时的第一栅源电压,将所述栅源电压设定为每一所述NMOS管对应驱动时钟的逻辑1对应的电压值;
对于不同位置的PMOS管,确定每一所述PMOS管关闭时需要的第二电压值,将所述第二电压值设定为每一所述PMOS管对应驱动时钟的逻辑1对应的电压值;设置每一所述PMOS充分导通时的第二栅源电压,将所述第二栅源电压设定为每一所述PMOS管对应驱动时钟的逻辑0对应的电压值。
3.如权利要求1所述的电荷泵不交叠时钟控制方法,其特征在于,所述在所述电荷泵电路充电阶段时,控制正电荷仅通过所述第一电容和所述第二电容流向所述电路输出端,具体为:
在充电阶段,控制第一驱动时钟恒为逻辑0,并提前关闭和延后打开所有的NMOS管;
在放电阶段,第一驱动时钟恒为逻辑1,第一PMOS管恒定关闭;
按照时间节点从左往右分为t1~t7共七个时间段,第四驱动时钟在t1时间段内为逻辑0,在t2开始阶段跳变为逻辑1以关闭第三PMOS管,在第三PMOS管充分关闭后,t3开始阶段时第二驱动时钟从逻辑0跳变到逻辑1,此时第三驱动时钟为逻辑0;t4开始阶段第三驱动时钟从逻辑0跳变到逻辑1,第一电容和第二电容对第三电容放电;t5开始阶段第三驱动时钟从逻辑1跳变到逻辑0,此时第三驱动时钟保持为逻辑1;t6开始阶段第二驱动时钟跳变为逻辑0,t6~t时间段内第一驱动时钟保持为逻辑1;t7阶段开始,第一驱动时钟从逻辑1跳变到逻辑0,直到放电阶段结束。
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