[发明专利]一种异构资源池管理方法、系统及异构计算平台在审
申请号: | 202111234819.0 | 申请日: | 2021-10-22 |
公开(公告)号: | CN114020452A | 公开(公告)日: | 2022-02-08 |
发明(设计)人: | 樊嘉恒;黄宬;阚宏伟;王彦伟 | 申请(专利权)人: | 浪潮电子信息产业股份有限公司 |
主分类号: | G06F9/50 | 分类号: | G06F9/50 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 刘珂 |
地址: | 250101 山东*** | 国省代码: | 山东;37 |
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摘要: | |||
搜索关键词: | 一种 资源 管理 方法 系统 计算 平台 | ||
本申请公开了一种异构资源池管理方法、系统及异构计算平台,该方法包括:由PCIE交换机连接的第一个可编程器件接收原始计算数据;第一个可编程器件计算完成后,将得到的第一中间数据通过PCIE交换机传递至连接的第二个可编程器件;第二个可编程器件计算完成后,将得到的第二中间数据通过PCIE交换机传递至连接的第三个可编程器件;重复PCIE交换机的数据传递操作,直至PCIE交换机连接的最后一个可编程器件完成计算,得到最终计算结果。这样在异构计算资源池化中增加PCIE交换机,通过PCIE交换机的数据传递操作,提高可编程器件间的数据交互效率,降低数据传输的延时和抖动,对外提供更大的计算资源模块。
技术领域
本发明涉及云计算技术领域,特别是涉及一种异构资源池管理方法、系统及异构计算平台。
背景技术
目前,加速设备的分布式管理和云化管理已经成为趋势。现场可编程门阵列(Field Programmable Gate Array,FPGA)异构资源池是一款提供FPGA的计算实例,FPGA异构资源池提供核心算力,同时也是一种新型的行业解决方案。首先,它是一种异构计算平台的体系结构,由于FPGA硬件的可重配特性,用户可以对已创建的FPGA硬件加速应用,进行快速擦写和重配,达到低时延硬件与弹性伸缩最好的结合,通过并行和流水等设计手段,提高计算性能、能效比和计算实时性,对应用进行硬件加速处理。
如图1,现有的FPGA异构资源池是将机柜中每个FPGA板卡通过网络交换机互联起来,达到互联互通。数据中心通过接入网络交换机,来访问每个FPGA板卡的计算资源。在图1这个模式当一个FPGA的资源可以承载下KERNEL的计算要求的时候,是可以正常运行的。但是,当前算法越来越复杂,一个FPGA的资源是无法承载下KERNEL的计算要求的,这时就需要多个FPGA进行同时运行,来承载一个KERNEL的计算,在计算过程中就避免不了FPGA之间的数据交互。而目前FPGA之间必须通过网络交互机才能进行数据交互,这样会增加数据的延时和抖动,并且FPGA在通过网络进行数据传输的时候还要进行数据的检查和校验,这样也浪费了自身的计算单元。
因此,如何解决在异构计算资源池化的过程中,FPGA板卡间传输性能,及延时和抖动过大的问题,是本领域技术人员亟待解决的技术问题。
发明内容
有鉴于此,本发明的目的在于提供一种异构资源池管理方法、系统及异构计算平台,可以提高可编程器件间的数据交互效率,降低数据传输的延时和抖动,提升计算效率。其具体方案如下:
一种异构资源池管理方法,包括:
由PCIE交换机连接的第一个可编程器件接收原始计算数据;
所述第一个可编程器件计算完成后,将得到的第一中间数据通过所述PCIE交换机传递至连接的第二个可编程器件;
所述第二个可编程器件计算完成后,将得到的第二中间数据通过所述PCIE交换机传递至连接的第三个可编程器件;
重复所述PCIE交换机的数据传递操作,直至所述PCIE交换机连接的最后一个可编程器件完成计算,得到最终计算结果。
优选地,在本发明实施例提供的上述异构资源池管理方法中,在所述由PCIE交换机连接的第一个可编程器件接收原始计算数据之前,还包括:
根据所述PCIE交换机的接口个数和所述原始计算数据的大小,确定可编程器件的连接个数;
按照确定的所述连接个数,将可编程器件与对应的所述PCIE交换机连接。
优选地,在本发明实施例提供的上述异构资源池管理方法中,每个所述PCIE交换机可连接相同个数的可编程器件。
优选地,在本发明实施例提供的上述异构资源池管理方法中,在所述将可编程器件与对应的所述PCIE交换机连接之后,还包括:
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