[发明专利]存储器及其制作方法在审
申请号: | 202111276182.1 | 申请日: | 2021-10-29 |
公开(公告)号: | CN113889474A | 公开(公告)日: | 2022-01-04 |
发明(设计)人: | 罗启仁;张钦福;童宇诚 | 申请(专利权)人: | 福建省晋华集成电路有限公司 |
主分类号: | H01L27/108 | 分类号: | H01L27/108;H01L21/8242 |
代理公司: | 上海思捷知识产权代理有限公司 31295 | 代理人: | 沈宗晶 |
地址: | 362200 福建省泉州*** | 国省代码: | 福建;35 |
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摘要: | |||
搜索关键词: | 存储器 及其 制作方法 | ||
1.一种存储器,其特征在于,包括:
衬底,包括多个有源区以及一隔离结构包围所述多个有源区;
多个位线结构,位于所述衬底上,并与所述有源区直接接触;
侧墙间隔层,至少覆盖所述位线结构的侧壁,并沿部分所述位线结构的侧壁深入所述隔离结构。
2.根据权利要求1所述的存储器,其特征在于,所述位线结构包括依次堆叠的位线接触插塞、位线导电层及位线遮蔽层,其中,所述位线导电层的顶部的尺寸大于所述位线导电层的底部的尺寸。
3.根据权利要求1所述的存储器,其特征在于,所述位线结构包括“U”型设置的扩散阻挡层、填充在所述扩散阻挡层内的导电层,及位于所述扩散阻挡层和所述导电层之上的遮蔽图案。
4.根据权利要求3所述的存储器,其特征在于,所述扩散阻挡层与所述有源区直接接触。
5.根据权利要求3所述的存储器,其特征在于,所述扩散阻挡层的底部和侧壁均与所述侧墙间隔层接触。
6.根据权利要求3所述的存储器,其特征在于,还包括衬垫层,所述衬垫层位于所述位线结构与所述衬底之间。
7.根据权利要求6所述的存储器,其特征在于,所述扩散阻挡层与所述衬垫层接触。
8.根据权利要求1所述的存储器,其特征在于,所述侧墙间隔层包括第一间隔层和第二间隔层,其中,
所述第二间隔层覆盖位线结构的侧壁,且沿部分所述位线结构的侧壁深入所述隔离结构;
所述第一间隔层覆盖在所述衬底上的所述第二间隔层的侧壁。
9.根据权利要求1所述的存储器,其特征在于,所述侧墙间隔层包括第一间隔层和第二间隔层,其中,
所述第一间隔层和所述第二间隔层均沿部分所述位线结构深入所述隔离结构,其中,所述第一间隔层呈“L”型,所述第二间隔层位于所述“L”型的水平端之上。
10.根据权利要求1所述的存储器,其特征在于,所述侧墙间隔层包括第一间隔层、第二间隔层及第三间隔层,所述第一间隔层和所述第二间隔层均位于所述衬底之上,
其中,所述第一间隔层呈“L”型,所述第二间隔层位于所述“L”型的水平端之上,所述第三间隔层接触所述第二间隔层的侧壁及所述第一间隔层的“L”型的水平端,并沿部分所述位线结构的侧壁深入所述隔离结构。
11.根据权利要求1所述的存储器,其特征在于,至少部分所述侧墙间隔层呈“U”型设置,以从底部隔离所述位线结构。
12.一种存储器的制作方法,其特征在于,包括:
提供衬底,包括多个有源区以及一隔离结构包围所述多个有源区;
在所述衬底上形成介质层并进行图案化,以形成多个位线沟槽,所述位线沟槽至少部分深入所述衬底;
在所述位线沟槽的侧壁形成侧墙间隔层;以及,
在所述位线沟槽中形成位线结构,其中,所述侧墙间隔层至少覆盖所述位线结构的侧壁并沿部分所述位线结构的侧壁深入所述隔离结构。
13.根据权利要求12所述的存储器的制作方法,其特征在于,所述侧墙间隔层包括第一间隔层和第二间隔层,所述侧墙间隔层的形成过程包括:
沿所述位线沟槽的侧壁和底部依次形成第一间隔层和第二间隔层;以及,
刻蚀部分所述第一间隔层和所述第二间隔层的底部,以暴露部分所述有源区。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的