[发明专利]用于PCIe信号一致性测试的测试夹具在审

专利信息
申请号: 202111577262.0 申请日: 2021-12-21
公开(公告)号: CN114113714A 公开(公告)日: 2022-03-01
发明(设计)人: 孙浩;杨晓君;程鹏;胡涛;孙浩天 申请(专利权)人: 海光信息技术股份有限公司
主分类号: G01R1/04 分类号: G01R1/04;G01R31/00;G06F13/40
代理公司: 北京兰亭信通知识产权代理有限公司 11667 代理人: 孙峰芳
地址: 300384 天津市滨海新区华苑产*** 国省代码: 天津;12
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摘要:
搜索关键词: 用于 pcie 信号 一致性 测试 夹具
【权利要求书】:

1.一种用于PCIe信号一致性测试的测试夹具,其特征在于,包括:

信号连接器,用于输入待测试的N路PCIe信号,N≥2,每路PCIe信号均为包括DP信号和DN信号的差分信号,所述N路PCIe信号传输至N路PCIe信号各自的规范测试点;

信号选择电路,其输入端连接于所述N路PCIe信号的规范测试点,其输出端连接于SMP差分接口,用于从所述N路PCIe信号中选择一路PCIe信号输出至所述SMP差分接口;

与所述N路PCIe信号所属的DP信号和DN信号一一对应连接的2N个阻抗匹配电路,每两个阻抗匹配电路为一组,任意一组阻抗匹配电路用于实现一路PCIe信号所属的DP信号和DN信号的阻抗匹配;

控制电路,用于向所述信号选择电路和2N个所述阻抗匹配电路发送控制信号,以使所述信号选择电路选择一路PCIe信号并使能除该路PCIe信号以外的其他各路PCIe信号连接的阻抗匹配电路。

2.根据权利要求1所述的测试夹具,其特征在于,所述规范测试点满足条件:与所述信号连接器之间链路的插入损耗为8dB。

3.根据权利要求1所述的测试夹具,其特征在于,所述信号选择电路包括:

前后串联连接的多个PCIe信号复用器,用于根据所述控制电路发送的通道选择信号从输入的所述多路PCIe信号中选择其中一路PCIe信号进行输出。

4.根据权利要求3所述的测试夹具,其特征在于,若输入16路PCIe信号,所述信号选择电路包括第一PCIe信号复用器、第二PCIe信号复用器、第三PCIe信号复用器、第四PCIe信号复用器和第五PCIe信号复用器,

所述第一PCIe信号复用器,用于接收16路PCIe信号的其中8路PCIe信号,选择输出4路PCIe信号;

所述第二PCIe信号复用器,用于接收16路PCIe信号的另外8路PCIe信号,选择输出4路PCIe信号;

所述第三PCIe信号复用器,用于接收所述第一PCIe信号复用器和所述第二PCIe信号复用器选择输出的8路PCIe信号,进一步选择输出4路PCIe信号;

所述第四PCIe信号复用器,用于接收所述第三PCIe信号复用器选择输出的4路PCIe信号,进一步选择输出2路PCIe信号;

所述第五PCIe信号复用器,用于接收所述第四PCIe信号复用器选择输出的2路PCIe信号,进一步选择输出1路PCIe信号。

5.根据权利要求4所述的测试夹具,其特征在于,所述第一PCIe信号复用器、第二PCIe信号复用器和第三PCIe信号复用器为8路转4路PCIe信号复用器。

6.根据权利要求4所述的测试夹具,其特征在于,所述第四PCIe信号复用器和第五PCIe信号复用器为4路转2路PCIe信号复用器。

7.根据权利要求1所述的测试夹具,其特征在于,所述阻抗匹配电路为50欧姆阻抗匹配电路。

8.根据权利要求7所述的测试夹具,其特征在于,所述50欧姆阻抗匹配电路包括MOS晶体管和接地电阻,所述MOS晶体管的漏极输入一路PCIe信号所属的DP信号或DN信号在规范测试点之后的信号,所述MOS晶体管的源极经过所述接地电阻接地,所述MOS晶体管的栅极输入该路PCIe信号的链路选通信号。

9.根据权利要求1所述的测试夹具,其特征在于,所述控制电路包括FPGA。

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