[发明专利]一种DSP映射方法、系统、设备及计算机可读存储介质在审

专利信息
申请号: 202111594331.9 申请日: 2021-12-23
公开(公告)号: CN114416347A 公开(公告)日: 2022-04-29
发明(设计)人: 张青 申请(专利权)人: 山东云海国创云计算装备产业创新中心有限公司
主分类号: G06F9/50 分类号: G06F9/50
代理公司: 北京集佳知识产权代理有限公司 11227 代理人: 李泽艳
地址: 250001 山东省济南市自由贸易试验*** 国省代码: 山东;37
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摘要:
搜索关键词: 一种 dsp 映射 方法 系统 设备 计算机 可读 存储 介质
【说明书】:

本申请公开了一种DSP映射方法、系统、设备及计算机可读存储介质,获取对可编程逻辑器件的设计信息;获取可编程逻辑器件中DSP资源的设计单位;按照设计单位,将设计信息映射为初始DSP资源;判断初始DSP资源是否超出阈值;若初始DSP资源超出阈值,则将初始DSP资源拆分为目标DSP资源及待拆分DSP资源,并将待拆分DSP资源拆分为其他资源;其中,目标DSP资源未超出阈值。本申请在设计信息映射成的初始DSP资源超出阈值的情况下,会将初始DSP资源拆分为未超出阈值的目标DSP资源及其他资源,使得可编程逻辑器件可以提供设计所需的目标DSP资源,避免了重新修改设计的情况,提高了用户体验性。本申请提供的DSP映射系统、设备及计算机可读存储介质也解决了相应技术问题。

技术领域

本申请涉及资源管理技术领域,更具体地说,涉及一种DSP映射方法、系统、设备及计算机可读存储介质。

背景技术

随着人工智能等技术的飞速发展,对高性能计算,向量计算等的要求也越来越高。向量与矩阵的乘法运算是现代信号处理中最基本的运算,在很多领域,包括人工智能,加解密算法等得到广泛的应用,但是向量与矩阵的乘法运算的计算复杂度高,因此计算性能直接影响系统的整体性能。FPGA(Field Programmable Gate Array,可编程门阵列)作为一种通用的可编程逻辑器件,设计更接近于硬件底层的架构,拥有大量的RAM(Random AccessMemory,随机存取存储器)资源、DSP(Digital Signal Processing,数字信号处理)资源等,具有擅长数据并行计算、更加灵活和低延迟的特点,同时FPGA还具有功耗低、可编程及设计灵活等的特点,因此FPGA在很多应用领域得到广泛的使用。

但是在FPGA等可编程逻辑器件的应用过程中,当用户设计中存在大量乘法器时,综合时默认将乘法器映射为DSP资源,当映射出的资源超出芯片的DSP资源时,后续布局布线就会失败,导致此用户设计没法使用,或者需要用户修改设计,增加了用户操作复杂度,使得用户体验性较差。

综上所述,如何提高用户使用可编程逻辑器件的体验性是目前本领域技术人员亟待解决的问题。

发明内容

本申请的目的是提供一种DSP映射方法,其能在一定程度上解决如何提高用户使用可编程逻辑器件的体验性的技术问题。本申请还提供了一种DSP映射系统、设备及计算机可读存储介质。

为了实现上述目的,本申请提供如下技术方案:

一种DSP映射方法,包括:

获取对可编程逻辑器件的设计信息;

获取所述可编程逻辑器件中DSP资源的设计单位;

按照所述设计单位,将所述设计信息映射为初始DSP资源;

判断所述初始DSP资源是否超出阈值;

若所述初始DSP资源超出阈值,则将所述初始DSP资源划分为目标DSP资源及待拆分DSP资源,并将所述待拆分DSP资源拆分为其他资源;

其中,所述目标DSP资源未超出所述阈值。

优选的,所述按照所述设计单位,将所述设计信息映射为初始DSP资源,包括:

按照所述设计单位,基于优先使用小数值的所述设计单位的映射规则,将所述设计信息映射为所述初始DSP资源。

优选的,所述将所述初始DSP资源划分为目标DSP资源及待拆分DSP资源,并将所述待拆分DSP资源拆分为其他资源,包括:

在所述初始DSP资源中取出最小的子DSP资源作为所述待拆分DSP资源;

将所述待拆分DSP资源拆分为所述其他资源;

判断剩余的所述初始DSP资源是否超出所述阈值;

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