[发明专利]一种信号监测方法及电路在审

专利信息
申请号: 202111665061.6 申请日: 2021-12-30
公开(公告)号: CN114928413A 公开(公告)日: 2022-08-19
发明(设计)人: 周杰;章可循;葛军华;潘剑华 申请(专利权)人: 厦门优迅高速芯片有限公司
主分类号: H04B17/00 分类号: H04B17/00;H04L69/18
代理公司: 厦门市首创君合专利事务所有限公司 35204 代理人: 李雁翔;吴晓梅
地址: 361000 福建省*** 国省代码: 福建;35
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摘要:
搜索关键词: 一种 信号 监测 方法 电路
【说明书】:

发明公开了一种信号监测方法及电路,以通信协议所允许的长连续码持续时间作为时间间隔探测外部输入信号是否存在上升沿或下降沿,若探测到输入信号的上升沿或下降沿,说明存在输入数据,否则说明不存在数据输入。监测电路根据监测方法设计,包括长连续码判决电路CID,该长连续码判决电路CID包括锁存器DL1、锁存器DL2、或门OR1、非门N1、锁存器DL3、判决信号产生电路、或门OR2,其中,锁存器DL1、锁存器DL3、锁存器DL2、锁存器DL4均为上升沿触发锁存器。该监测方法及监测电路对外部输入信号进行信号丢失判断,不改变原有信号传输结构,在不影响信号传输的质量的情况下有效降低信号丢失判决所需要消耗的时间。

技术领域

本发明涉及一种用于监测数据传输时信号的存在或者丢失的信号监测方法及电路。

背景技术

通讯领域,在数据传输时需要确认信号的存在或者丢失,以实现时分传输模式的控制。传统的信号传输有无的确认方式是通过探测信号幅度的大小与相关阈值的比较而得到的。

针对信号丢失的判定,现有技术采用幅度判决方式如图1所示,这是现有的信号速率判决电路的结构框架图。图中输入放大级,输出缓冲级组成高速信号放大器的信号通道部分。高速交流信号从输入端DIN,/DIN输入,经过放大后从输出端DOUT,/DOUT输出。模拟信号经过幅值判决电路Signal Level Detector做幅值判决,由输出电路输出判决信号SD。

通过幅值判决电路对信号丢失的判决时间比较长,为通信协议所允许的长连续码持续时间(正常的通信协议对传输数据的长连续码有一定的要求,即可以连续相同的高电平或者低电平极限;超过通信协议允许的持续时间长度的长连续码被认为是错误的输入信号)要求的十倍以上。过长的信号丢失判决时间对于信号传输的总时间消耗是一种不必要的浪费。

导致上述缺点的原因:信号结束之后,其幅值的恢复时间由输入RC滤波电路低频带宽决定。低频带宽越小其信号丢失判断时间越长,其通信的物理消耗越大。

如图2所示,其为对图1的INP和INN进行瞬态模拟仿真。当信号结束后,INP和INN需要很长的时间才能回复到中间电平。随着通信协议对长连续码的需求提高,其幅值恢复到中间电平的时间会更长。

通信协议为了提高信号传输效率,往往会提高数据长连续码的容忍度。长连续码的容忍度的提高往往需要输入的RC低频带宽越小。因此现有技术在物理消耗和长连续码的容忍度的二个重要参数上出现严重分歧。

发明内容

本发明提供了一种信号监测方法及电路,其克服了背景技术中所述的现有技术的不足,实现了数据传输时信号的存在与丢失的确认,解决了物理消耗和长连续码的容忍度之间的矛盾。

本发明解决其技术问题所采用的技术方案是:

一种信号监测方法,是在外部复位完成后,以通信协议所允许的长连续码持续时间作为时间间隔探测外部输入信号是否存在上升沿或下降沿。若探测到输入信号不存在上升沿或下降沿,说明无输入数据;若探测到输入信号存在上升沿或下降沿,说明存在输入数据,电路反馈产生新的复位信号,并再次以通信协议所允许的长连续码持续时间作为时间间隔探测外部输入信号是否存在上升沿或下降沿。

一种信号监测电路,包括长连续码判决电路CID,该长连续码判决电路CID包括:

锁存器DL1、锁存器DL2、或门OR1、非门N1,该锁存器DL1的输入端连接高电平信号,控制端连接外部输入信号;锁存器DL2的输入端连接高电平信号,外部输入信号经非门N1后连接锁存器DL2的控制端,锁存器DL1和锁存器DL2的输出端经连接至或门OR1产生信号DATA_EXIST;

锁存器DL3,该锁存器DL3的输入端连接信号DATA_EXIST,控制端连接信号EXIST_DETECT,输出端产生信号DATA_CONFIRM;

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