[实用新型]基于FPGA片上系统的MIPI电路板有效
申请号: | 202121323833.3 | 申请日: | 2021-06-15 |
公开(公告)号: | CN214959850U | 公开(公告)日: | 2021-11-30 |
发明(设计)人: | 钟广静 | 申请(专利权)人: | 山东高云半导体科技有限公司 |
主分类号: | H04N5/765 | 分类号: | H04N5/765 |
代理公司: | 北京安信方达知识产权代理有限公司 11262 | 代理人: | 胡艳华;李丹 |
地址: | 250101 山东省济南市高新区*** | 国省代码: | 山东;37 |
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摘要: | |||
搜索关键词: | 基于 fpga 系统 mipi 电路板 | ||
1.一种基于现场可编程门阵列FPGA片上系统的移动产业处理器接口MIPI电路板,其特征在于:包括:FPGA片上系统;所述FPGA片上系统包括主控模块、第一接口模块、和第二接口模块;所述第一接口模块包括摄像头串行接口CSI,所述CSI接口连接外部摄像头;所述第二接口模块包括显示器串行接口DSI,所述DSI接口连接外部显示屏;
主控模块,配置为获取第一接口模块生成的第一数据,向第二接口模块发送第二数据;
第一接口模块,配置为通过所述CSI接口接收所述摄像头的信号,对所述信号进行处理生成第一数据;
第二接口模块,配置为根据第二数据生成显示信号,并通过所述DSI接口将所述显示信号发送至所述显示屏。
2.如权利要求1所述的MIPI电路板,其特征在于:
所述CSI接口包括至少一对差分数据信号线和至少一对差分时钟信号线。
3.如权利要求1所述的MIPI电路板,其特征在于:
所述DSI接口包括至少一对差分数据信号线和至少一对差分时钟信号线。
4.如权利要求2所述的MIPI电路板,其特征在于:
所述第一接口模块还包括MIPI接收知识产权IP核;所述MIPI接收IP核配置为接收CSI接口的数据信号和时钟信号,并对所述数据信号和时钟信号进行处理,生成接收数据。
5.如权利要求4所述的MIPI电路板,其特征在于:
所述MIPI接收IP核包括硬核、软核或固核。
6.如权利要求3所述的MIPI电路板,其特征在于:
所述第二接口模块还包括MIPI发送IP核;所述MIPI发送IP核配置为生成显示信号对应的数据信号和时钟信号,并输出至DSI接口。
7.如权利要求6所述的MIPI电路板,其特征在于:
所述MIPI发送IP核包括硬核、软核或固核。
8.如权利要求4所述的MIPI电路板,其特征在于:
所述MIPI接收IP核还配置为对所述接收数据进行缓存。
9.如权利要求1-8中任一项所述的MIPI电路板,其特征在于:
所述基于FPGA片上系统的MIPI电路板还包括:通用串行总线USB转联合测试工作组JTAG接口;所述USB转JTAG接口包括USB接口和JTAG接口;所述USB接口用于连接上位机,所述JTAG接口用于连接FPGA片上系统。
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