[发明专利]一种高宽带低延时存储转发控制装置及其控制方法有效

专利信息
申请号: 202210261915.2 申请日: 2022-03-16
公开(公告)号: CN114710453B 公开(公告)日: 2023-10-10
发明(设计)人: 袁结全;崔志辉;陈世伟;詹晋川 申请(专利权)人: 深圳市风云实业有限公司
主分类号: H04L47/52 分类号: H04L47/52;H04L47/56;H04L47/6275;H04L101/622
代理公司: 北京正华智诚专利代理事务所(普通合伙) 11870 代理人: 刘方正
地址: 518040 广东省深圳市福田区*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 宽带 延时 存储 转发 控制 装置 及其 方法
【说明书】:

发明公开了一种高宽带低延时存储转发控制装置及其控制方法,其装置包括接口数据处理单元、高速存储器读写控制单元和转发控制单元;接口数据处理单元用于对物理端口进行端口时序转换、优先级分类、帧定界符插入以及丢包操作;高速存储器读写控制单元用于确定高速存储器突发的数据结构、对物理端口的数据包进行字节间插以及读写调度;转发控制单元用于进行间插字节恢复、帧定界符去除以及将数据包转发至对应的物理端口。本发明的高宽带低延时存储转发控制装置很好的提高了高速存储器带宽,降低了端口转发延时,增加数据包的优先级队列控制,更好的适配实际应用场景。

技术领域

本发明属于电子信息技术领域,具体涉及一种高宽带低延时存储转发控制装置及其控制方法。

背景技术

在多端口存储转发控制的通信设备中,一般要求在多端口数据包突发时,能尽可能缓存突发,这对于高速存储器的带宽控制要求较高,目前多端口转发控制设备中,当高速存储器带宽提升后,端口转发延时就会增大,一般是采用折中的方案控制高速存储器带宽和端口转发延时,并且很少对数据包进行优先级调度。

发明内容

本发明的目的是为了解决现有多端口存储转发装置的问题,提出了一种高宽带低延时存储转发控制装置及其控制方法。

本发明的技术方案是:一种高宽带低延时存储转发控制装置包括接口数据处理单元、高速存储器读写控制单元和转发控制单元;

接口数据处理单元用于对物理端口进行端口时序转换、优先级分类、帧定界符插入以及丢包操作;

高速存储器读写控制单元用于确定高速存储器突发的数据结构、对物理端口的数据包进行字节间插以及读写调度;

转发控制单元用于进行间插字节恢复、帧定界符去除以及将数据包转发至对应的物理端口。

进一步地,接口数据处理单元包括接口处理模块、优先级调度模块、帧定界符插入模块和包级队列存储器丢包控制模块;

接口处理模块用于对物理端口的数据包进行时序转换,删除和添加物理端口对应的字节,转换为其余模块所需时序;并根据物理端口的类型,将其余模块所需时序转换为对应的物理端口时序;

优先级调度模块用于对物理端口的数据包进行优先级分类;

帧定界符插入模块用于在数据包的头尾分别添加帧定界符,且将数据包中作为帧定界符的数据进行字节转义,将其转义为非定界符;

包级队列存储器丢包控制模块用于在包级队列存储器存储空间达到阈值时,进行整包丢弃。

进一步地,高速存储器读写控制单元包括字节间插参数配置表模块、多通道数据字节间插模块和高速存储器读写调度模块;

字节间插参数配置表模块用于根据物理端口的数量配置高速存储器的数据位宽大小,开销字节位宽及字节位宽的含义,根据高速存储器计算任意物理端口的bit数a、间插的有效字节个数b、突发传输的数据位宽c,并根据任意物理端口的bit数a、间插的有效字节个数b、突发传输的数据位宽c确定高速存储器突发的数据结构;

多通道数据字节间插模块用于检查接口数据处理单元中包级队列存储器中是否存在数据包,若存在数据包,则按照物理端口顺序将数据间插至高速存储器的数据结构中,否则采用补位的方式将数据间插至高速存储器的数据结构中;

高速存储器读写调度模块用于循环进行连续写操作和连续读操作。

进一步地,转发控制单元包括多通道间插字节恢复模块、去帧定界符模块、物理端口转发表模块和转发控制模块;

多通道间插字节恢复模块用于对高速存储器读出的数据包按照物理端口顺序进行恢复;

去帧定界符模块用于对恢复后的数据包进行去除帧定界符操作;

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