[发明专利]阵列基板、显示面板和显示装置在审
申请号: | 202210396037.5 | 申请日: | 2022-04-15 |
公开(公告)号: | CN114823727A | 公开(公告)日: | 2022-07-29 |
发明(设计)人: | 尚庭华;张毅;青海刚;刘彪;肖邦清 | 申请(专利权)人: | 京东方科技集团股份有限公司;成都京东方光电科技有限公司 |
主分类号: | H01L27/12 | 分类号: | H01L27/12;H01L27/32;H01L23/552 |
代理公司: | 北京中博世达专利商标代理有限公司 11274 | 代理人: | 申健 |
地址: | 100015 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 阵列 显示 面板 显示装置 | ||
1.一种阵列基板,其特征在于,包括多个阵列设置的像素驱动电路,所述像素驱动电路至少包括补偿晶体管;所述阵列基板包括:
衬底;
设置于所述衬底一侧的有源层,所述有源层包括所述补偿晶体管的有源层图案,所述补偿晶体管的有源层图案包括两个沟道区,以及位于所述两个沟道区之间的导电区;
设置于所述有源层远离所述衬底一侧的第一栅极层,所述第一栅极层包括第一栅极信号线,所述第一栅极信号线在所述衬底上的正投影与所述两个沟道区在所述衬底上的正投影有重叠;
设置于所述第一栅极层远离所述衬底一侧的第二栅极层,所述第二栅极层包括稳压图案,所述稳压图案被配置为接收电源电压信号,所述稳压图案在所述衬底上的正投影与所述导电区在所述衬底上的正投影有重叠。
2.根据权利要求1所述的阵列基板,其特征在于,所述两个沟道区包括第一沟道区和第二沟道区;
所述补偿晶体管的有源层图案包括相连接的第一图案和第二图案,所述第一图案沿第一方向延伸,所述第二图案沿第二方向延伸,所述第一方向和第二方向相交,所述第一沟道区位于所述第一图案上,所述第二沟道区位于所述第二图案上,所述导电区位于所述第一图案和所述第二图案的连接位置处;
所述第一栅极信号线包括第一栅极信号主线和与所述第一栅极信号主线连接的至少一个第一延伸部,所述第一栅极信号主线沿所述第一方向延伸,所述第一延伸部沿所述第二方向延伸;第一栅极信号主线在所述衬底上的正投影与所述第二图案在所述衬底上的正投影有重叠,所述第一延伸部在所述衬底上的正投影与所述第一图案在所述衬底上的正投影有重叠。
3.根据权利要求1或2所述的阵列基板,其特征在于,所述像素驱动电路还包括电容器;
所述第一栅极层还包括所述电容器的第一极板;
所述第二栅极层还包括所述电容器的第二极板,所述第二极板在所述衬底上的正投影与所述第一极板在所述衬底上的正投影有重叠;
所述稳压图案与所述第二极板连接,所述稳压图案位于所述第二极板靠近所述第一栅极信号线的一侧。
4.根据权利要求3所述的阵列基板,其特征在于,所述第一栅极信号主线在所述衬底上的正投影与所述第一延伸部在所述衬底上的正投影形成至少一个拐角,所述稳压图案在所述衬底上的正投影位于所述拐角内侧。
5.根据权利要求4述的阵列基板,其特征在于,所述阵列基板还包括,
设置于所述有源层和所述第一栅极层之间的第一绝缘层;
设置于所述第一栅极层和所述第二栅极层之间的第二绝缘层;
设置于所述第二栅极层远离所述衬底一侧的第三绝缘层;
设置于所述第三绝缘层远离所述衬底一侧的第一源漏金属层;所述第一源漏金属层包括第一连接端和第一连接图案,所述第一连接端通过贯穿所述第一绝缘层、所述第二绝缘层和所述第三绝缘层的过孔连接所述有源层;所述第一连接图案包括依次连接的第一端、第一连接线和第二端,所述第一端通过贯穿所述第一绝缘层、所述第二绝缘层和所述第三绝缘层的过孔连接所述有源层;
所述第二栅极层还包括至少一个屏蔽图案,所述屏蔽图案在所述衬底上的正投影,位于相邻的第一连接端和连接图案的第一端之间;所述屏蔽图案被配置为接收恒压信号。
6.根据权利要求5所述的阵列基板,其特征在于,所述像素驱动电路还包括写入晶体管,所述有源层包括所述写入晶体管的有源层图案,所述第一连接端与所述写入晶体管的有源层图案连接;
所述第一连接图案的第一端与所述补偿晶体管的有源层图案连接,所述第一连接图案的第二端与所述电容器的第一极板连接。
7.根据权利要求5或6所述的阵列基板,其特征在于,所述第二栅极层还包括初始化信号线,所述屏蔽图案与所述初始化信号线连接。
8.根据权利要求7所述的阵列基板,其特征在于,所述初始化信号线包括第一初始化信号线,所述第一初始化信号线与所述屏蔽图案连接;
所述像素驱动电路还包括第一复位晶体管,所述有源层包括所述第一复位晶体管的有源层图案,所述第一初始化信号线与所述第一复位晶体管的有源层图案电连接。
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H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
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