[发明专利]处理系统、相关集成电路、设备及方法在审
申请号: | 202210481246.X | 申请日: | 2022-05-05 |
公开(公告)号: | CN115309678A | 公开(公告)日: | 2022-11-08 |
发明(设计)人: | B·维托雷利;S·巴特拉;V·K·索德;D·巴兰瓦尔 | 申请(专利权)人: | 意法半导体应用有限公司;意法半导体国际有限公司 |
主分类号: | G06F13/28 | 分类号: | G06F13/28;G06F13/40;G06F13/42;G06F9/455;G06F9/50;G06F12/06 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 董莘 |
地址: | 德国阿*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 处理 系统 相关 集成电路 设备 方法 | ||
一种通信系统将多个处理核心耦合在一起,每个处理核心具有存储虚拟机ID的关联寄存器,该虚拟机ID被插入到由相应处理核心发送的请求中。主电路关联了主接口电路,其中该主接口电路关联了用于存储第二虚拟机ID的寄存器,该第二虚拟机ID被插入到由主电路发送的请求中。从电路关联了从接口电路,该从接口电路被配置为选择性地转发寻址到地址子范围的读取或写入请求。从接口电路关联了存储与地址子范围相关联的第三虚拟机ID的第三寄存器,并且被配置为接收寻址到地址子范围的请求,从请求中提取虚拟机ID,确定所提取的虚拟机ID是否对应于第三虚拟机ID,然后转发或拒绝该请求。
技术领域
本公开的实施例涉及包括多个微处理器的处理系统,特别是被配置为执行虚拟机的处理系统。
背景技术
图1示出了典型的电子系统,诸如具有引擎35的车辆30的电子系统,包括多个处理系统10,诸如嵌入式系统或集成电路,例如现场可编程门阵列(FPGA)、数字信号处理器(DSP)或微控制器(例如专用于汽车市场)。
例如,在图1中示出了通过适当的通信系统20而连接的三个处理系统(PS)101、102和103。例如,通信系统可以包括车辆控制总线(诸如控制器局域网(CAN)总线和/或以太网)以及经由网关被连接到车辆控制总线的可能的多媒体总线(诸如面向媒体的系统传输(MOST)总线)。通常,处理系统10位于车辆的不同位置,并且可以包括例如引擎控制单元、变速箱控制单元(TCU),防抱死制动系统(ABS)、车身控制模块(BCM)、和/或导航和/或多媒体音频系统。因此,处理系统10中的一个或多个处理系统也可以实现实时控制和调节功能。这些处理系统通常被标识为电子控制单元。
图2示出了可以用作图1的任何处理系统10的示例性数字处理系统10(诸如微控制器)的框图。
在所考虑的示例中,处理系统10包括经由软件指令而编程的微处理器102(通常是中央处理单元(CPU))。通常,由微处理器102执行的软件被存储在非易失性程序存储器104(诸如闪存或EPROM)中。因此,存储器104被配置为存储处理单元102的固件,其中该固件包括将由微处理器102执行的软件指令。一般来说,非易失性存储器104还可以用于存储其它数据,诸如配置数据,例如校准数据。
微处理器102通常还与易失性存储器104b相关联,诸如随机存取存储器(RAM)。例如,存储器104b可以用于存储临时数据。
如图2所示,通常经由一个或多个存储器控制器100来执行与存储器104和/或104b的通信。(多个)存储器控制器100可以被集成在微处理器102中或经由通信信道(诸如,处理系统10的系统总线)被连接到微处理器102。类似地,存储器104和/或104b可以与微处理器102被集成在单个集成电路中,或者存储器104和/或104b可以采用单独的集成电路的形式并且例如经由印刷电路板的迹线被连接到微处理器102。
在所考虑的示例中,微处理器102可以与例如从包括以下项的组合中选择的一个或多个(硬件)资源106相关联:
一个或多个通信接口IF,例如用于经由通信系统20交换数据,诸如通用异步接收器/发送器(UART),串行外围接口总线(SPI),内部集成电路(I2C),控制器局域网(CAN)总线,和/或以太网接口,和/或调试接口;和/或
一个或多个模数转换器AD和/或数模转换器DA;和/或
一个或多个专用数字组件DC,诸如硬件定时器和/或计数器,或密码协处理器;和/或
一个或多个模拟组件AC,诸如比较器,传感器,诸如温度传感器等;和/或
一个或多个混合信号分量MSC,诸如PWM(脉宽调制)驱动器。
通常,专用数字组件DC也可以与被集成在处理系统10中的FPGA相对应。例如,在这种情况下,存储器104还可以包括用于这种FPGA的程序数据。
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