[发明专利]存储器装置中的独立平面架构在审

专利信息
申请号: 202210991987.2 申请日: 2022-08-17
公开(公告)号: CN115705853A 公开(公告)日: 2023-02-17
发明(设计)人: A·G·艾克斯欧塔;D·斯里尼瓦桑;A·摩哈马萨德;K·舒;G·L·里佐;辉俊胜;M·皮卡尔迪;T·瓦利;U·西奇利亚尼;R·马希加;李濬;A·S·叶;D·J·哈伯德 申请(专利权)人: 美光科技公司
主分类号: G11C5/02 分类号: G11C5/02;G11C5/06;G11C5/14;G11C16/08;G11C16/10;G11C16/30;G11C7/10
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 王龙
地址: 美国爱*** 国省代码: 暂无信息
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摘要:
搜索关键词: 存储器 装置 中的 独立 平面 架构
【权利要求书】:

1.一种存储器装置,其包括:

存储器阵列,其包括多个存储器平面,其中所述多个存储器平面以多个独立平面群组布置,并且其中所述多个独立平面群组中的每一者包括所述多个存储器平面中的一或多者;

多个独立模拟驱动器电路,其耦合到所述存储器阵列,其中所述多个独立模拟驱动器电路中的相应一者与所述多个独立平面群组中的相应一者相关联;

共同模拟电路,其耦合到所述存储器阵列,其中所述共同模拟电路由所述多个独立模拟驱动器电路和所述多个独立平面群组共享;以及

多个控制逻辑元件,其中所述多个控制逻辑元件中的相应一者与所述多个独立模拟驱动器电路中的相应一者和所述多个独立平面群组中的相应一者相关联。

2.根据权利要求1所述的存储器装置,其中当所述存储器装置被配置成处于第一操作模式时,所述多个控制逻辑元件被配置成使用所述多个独立模拟驱动器电路中的至少两者并行地对所述多个独立平面群组中的至少两者的存储器平面执行异步存储器存取操作。

3.根据权利要求1所述的存储器装置,其中所述多个控制逻辑元件中的第一控制逻辑元件选择性地耦合到所述多个模拟驱动器电路中的每一者和所述多个独立平面群组中的每一者。

4.根据权利要求3所述的存储器装置,其中当所述存储器装置被配置成处于第二操作模式时,启用所述多个控制逻辑元件中的所述第一控制逻辑元件且停用所述多个控制逻辑元件中的剩余部分,并且其中所述第一控制逻辑元件被配置成使用所述多个独立模拟驱动器电路中的一或多者对所述多个独立平面群组中的任一者的一或多个存储器平面执行存储器存取操作。

5.根据权利要求1所述的存储器装置,其进一步包括:

共同数据路径,其由所述多个独立平面群组共享;以及

共同命令接口,其由所述多个控制逻辑元件共享。

6.根据权利要求1所述的存储器装置,其中所述多个独立平面群组中的一者和所述多个独立模拟驱动器电路中的一者的每个相应对与所述多个独立平面群组和所述多个独立模拟驱动器电路的其它对以及所述多个控制逻辑元件隔离以减少信号噪声。

7.根据权利要求1所述的存储器装置,其中所述共同模拟电路包括与在所述存储器装置中执行存储器存取操作相关联的多个模拟电压参考。

8.根据权利要求7所述的存储器装置,其中所述多个独立模拟驱动器电路被配置成将从所述共同模拟电路接收的所述多个模拟电压参考中的选定者提供到所述多个独立平面群组中的所述相应者的存储器平面以执行所述存储器存取操作。

9.一种存储器装置,其包括:

存储器阵列,其包括多个存储器平面,其中所述多个存储器平面的第一子集与第一独立平面群组相关联,并且所述多个存储器平面的第二子集与第二独立平面群组相关联;

与所述第一独立平面群组相关联的第一独立模拟驱动器电路和与所述第二独立平面群组相关联的第二独立模拟驱动器电路;

共同模拟电路,其耦合到所述存储器阵列,其中所述共同模拟电路由所述第一和第二独立模拟驱动器电路以及所述第一和第二独立平面群组共享;以及

与所述第一独立模拟驱动器电路和所述第一独立平面群组相关联的第一控制逻辑元件,以及与所述第二独立模拟驱动器电路和所述第二独立平面群组相关联的第二控制逻辑元件。

10.根据权利要求9所述的存储器装置,其中当所述存储器装置被配置成处于第一操作模式时,所述第一控制逻辑元件被配置成使用所述第一独立模拟驱动器电路对所述第一独立平面群组执行第一异步存储器存取操作,并且并行地,所述第二控制逻辑元件被配置成使用所述第二独立模拟驱动器电路对所述第二独立平面群组执行第二异步存储器存取操作。

11.根据权利要求9所述的存储器装置,其中所述第一控制逻辑元件选择性地耦合到所述第二独立模拟驱动器电路和所述第二独立平面群组。

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