[发明专利]生成像素控制信号的方法在审
申请号: | 202210998923.5 | 申请日: | 2022-08-19 |
公开(公告)号: | CN116564208A | 公开(公告)日: | 2023-08-08 |
发明(设计)人: | 克雷格·迈克尔·沃勒 | 申请(专利权)人: | 晶典有限公司;芯鼎微(中山)光电半导体有限公司 |
主分类号: | G09G3/20 | 分类号: | G09G3/20;G09G3/32;G09G3/3208 |
代理公司: | 深圳紫藤知识产权代理有限公司 44570 | 代理人: | 黄威 |
地址: | 美国得克萨*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 生成 像素 控制 信号 方法 | ||
本发明提供一种生成像素控制信号的方法,所述方法更快速且以更少费用产生像素控制信号。所述像素控制信号用于控制像素块,所述像素块具有一第一像素及一第二像素,所述方法包括:产生由像素块共享的一基本控制信号;产生第一像素的一第一锐化控制信号,并产生第二像素的一第二锐化控制信号;使用第一锐化信号及基本控制信号产生第一像素控制信号;使用第二锐化信号及基本控制信号产生第二像素控制信号。基本控制信号储存于一第一存储器胞元中;第一锐化器控制信号储存于一第二存储器胞元中;并且第二锐化器控制信号储存于一第三存储器胞元中。
技术领域
本发明是关于显示技术。更具体而言,本发明是关于控制光调变元件、空间光调变器及光源的数位背板。
背景技术
微显示器通常包括光调变背板及一光调变单元或一发光单元。光调变单元包括例如硅上液晶(liquid crystal on silicon,LCOS)及数位微型镜装置(digital micromirrors device,DMD)等技术。发光单元包括例如有机发光二极管(Organic lightemitting diodes,OLED)及微型发光二极管(Micro LED,μLED)等技术。在此种微型显示器中使用的技术亦可用于制造更大的显示单元。
图1示出具有一控制器110及一显示面板150的一显示器100的一简化架构。控制器110包括一双讯框缓冲器112及逻辑块118。显示面板150包括像素阵列152、像素处理器155及场缓冲器158。一视讯流VS由控制器110接收,并由逻辑块118储存于双讯框缓冲器112中。双讯框缓冲器112可加载一个即将到来的讯框,同时储存由显示面板150显示的前一讯框。逻辑块118控制双讯框缓冲器112储存影像讯框并将影像场传送至场缓冲器158。本文中所使用的一影像场是一影像讯框的一组分。典型地,一影像讯框可被分成三个影像场,最常见的是一红色影像场、一绿色影像场及一蓝色影像场。一般而言,影像讯框的每一像素将具有一8位元红色分量、一8位元绿色分量及一8位元蓝色分量。因此,影像讯框的每一像素需要24位元的资料,而一影像场的每一像素需要8位元的资料。
显示面板150使用其中不同的彩色影像场极为快速地连续显示于像素阵列152上的一场序彩色系统(field-sequential color system,FSC)。然而,本发明亦适用于其他类型的彩色显示系统。场序彩色系统依靠人类视觉系统将连续的影像场融合成原始影像讯框的一极为接近的副本。此外,显示器100对每一像素使用一单个控制信号数位驱动方案。每一像素在任何时间点为开(控制信号处于逻辑高)或关(控制信号处于逻辑低)。具体而言,为一场时间周期FT显示每一场;场时间周期FT对于像素控制信号具有256个可能的更新时间。每一颜色场的每一像素的亮度由控制信号处于逻辑高的持续时间控制。一般而言,每一像素具有驱动像素控制信号的一存储器胞元(memory cell)。存储器胞元由像素处理器控制以产生像素控制信号。一般而言,像素处理器155针对像素阵列152的每一行包括一像素处理器。在每一像素更新时间,像素处理器其中的每一者更新相关联行中的所有像素。
图2示出三个像素控制信号PCS_1、PCS_2及PCS_3。具体而言,像素控制信号PCS_1以最大亮度控制一像素,并因此在更新时间0(在图2中标记为UT_0)导通(升高至逻辑高),并在整个场时间周期FT内保持导通(处于逻辑高)。在显示面板150的一些实施方式中,像素控制信号总是在场时间周期FT的末尾关断(降低至逻辑低)。而其他实施方式在像素控制信号处于最大亮度时保持其导通。像素控制信号PCS_2用于一亮度值155,因此像素控制信号PCS_2在更新时间0(在图2中标记为UT_0)导通(升高至逻辑高),并且保持导通(处于逻辑高)直至像素控制信号PCS_2被关断(降低至逻辑低)的更新时间155(在图2中标记为UT_155)。像素控制信号PCS_3用于一亮度值57,因此像素控制信号PCS_3在更新时间0(在图2中标记为UT_0)导通(升高至逻辑高),并且保持导通(处于逻辑高)直至像素控制信号PCS_2被关断(降低至逻辑低)的更新时间57(在图2中标记为UT_57)。
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