[发明专利]一种显示芯片的FPGA原型验证方法及系统在审
申请号: | 202211163333.7 | 申请日: | 2022-09-23 |
公开(公告)号: | CN115600534A | 公开(公告)日: | 2023-01-13 |
发明(设计)人: | 罗远彦 | 申请(专利权)人: | 深圳中微电科技有限公司 |
主分类号: | G06F30/331 | 分类号: | G06F30/331 |
代理公司: | 深圳市添源创鑫知识产权代理有限公司 44855 | 代理人: | 覃迎峰 |
地址: | 518000 广东省深圳市南山区粤*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 显示 芯片 fpga 原型 验证 方法 系统 | ||
1.一种显示芯片的FPGA原型验证方法,其特征在于:将显示芯片划分到多颗FPGA中,其中一颗FPGA称为主FPGA,其他的FPGA包括FPGA2、FPGA3至FPGAn,将显示芯片设计代码切割划分到多个FPGA中,将显示芯片设计代码转成FPGA代码,将主板连接子系统、显示子系统、AXI interconnect和内存子系统划分到主FPGA中,AXI interconnect和内存子系统相连,主板连接子系统与AXI interconnect相连,显示子系统与AXI interconnect相连,主板连接子系统、显示子系统和内存子系统通过AXI interconnect互联进行数据交互;将算法处理子系统划分到FPGA2、FPGA3至FPGAn中;各个算法处理子系统均与AXI interconnect相连,各个算法处理子系统通过AXI interconnect与主板连接子系统、显示子系统和内存子系统进行数据交互。
2.根据权利要求1所述的FPGA原型验证方法,其特征在于:主FPGA的AXI interconnect的切割处插入AXI2serdes模块,各个算法处理子系统的切割处插入serdes2AXI模块,各个其他的FPGA与主FPGA之间通过FPGA serdes高速接口传输数据,AXI2serdes模块完成AXI到FPGA serdes的转换与编码,serdes2AXI模块完成FPGA serdes到AXI的解码与转换;AXI2serdes表示AXI总线接口信号到FPGA serdes信号的转换,serdes2AXI表示FPGAserdes信号到AXI总线接口信号的转换,serdes表示串行器和解串器,ser表示串行器,des表示解串器,AXI表示AXI总线接口信号。
3.根据权利要求1所述的FPGA原型验证方法,其特征在于:在主FPGA中,PCIe IP与AXIinterconnect IP相连,显示子系统与AXI interconnect IP相连,AXI interconnect IP与DDR IP相连,从而搭建起显示子系统原型验证系统进行显示子系统FPGA原型验证。
4.根据权利要求1所述的FPGA原型验证方法,其特征在于:该FPGA原型验证方法包括主板连接子系统FPGA原型验证步骤,
在所述主板连接子系统FPGA原型验证步骤中,主板连接子系统的代码是显示芯片设计代码,其余代码用FPGA厂商成熟的IP或者已经验证过的成熟代码来搭建子系统FPGA原型验证系统。
5.根据权利要求1所述的FPGA原型验证方法,其特征在于:该FPGA原型验证方法包括内存子系统FPGA原型验证步骤,在内存子系统FPGA原型验证步骤中,内存子系统的代码是显示芯片设计代码外,其余代码用FPGA厂商成熟的IP或者已经验证过的成熟代码。
6.根据权利要求1所述的FPGA原型验证方法,其特征在于:该FPGA原型验证方法包括算法处理子系统1FPGA原型验证步骤,在算法处理子系统1FPGA原型验证步骤中,算法处理子系统1FPGA原型验证用主FPGA和FPGA2,主FPGA中的代码用FPGA厂商成熟的IP或者已经验证过的成熟代码,FPGA2中的算法处理子系统1代码用显示芯片设计代码。
7.根据权利要求1所述的FPGA原型验证方法,其特征在于:该FPGA原型验证方法包括算法处理子系统2FPGA原型验证步骤,在算法处理子系统2FPGA原型验证步骤中,算法处理子系统2FPGA原型验证用主FPGA和FPGA3,主FPGA中的代码用FPGA厂商成熟的IP或者已经验证过的成熟代码,FPGA3中的算法处理子系统2代码用显示芯片设计代码。
8.根据权利要求1所述的FPGA原型验证方法,其特征在于:该FPGA原型验证方法包括显示子系统FPGA原型验证步骤,在显示子系统FPGA原型验证步骤中,除显示子系统外的其余代码都用FPGA厂商成熟的IP。
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