[发明专利]数据传输电路及数据传输方法有效

专利信息
申请号: 202211390414.0 申请日: 2022-11-08
公开(公告)号: CN116166469B 公开(公告)日: 2023-06-20
发明(设计)人: 陈虎;汪文心;于洋 申请(专利权)人: 湖南毂梁微电子有限公司
主分类号: G06F11/10 分类号: G06F11/10;G06F13/40;G06F13/42
代理公司: 长沙国科天河知识产权代理有限公司 43225 代理人: 彭小兰
地址: 410000 湖南省长沙市开福区伍*** 国省代码: 湖南;43
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摘要:
搜索关键词: 数据传输 电路 方法
【权利要求书】:

1.一种数据传输电路,其特征在于,包括:

第一CRC校验电路,用于对待发送报文中的数据字段进行CRC校验处理;

发送缓冲寄存器,连接所述第一CRC校验电路,用于存储待发送报文信息;

发送中断电路,连接所述发送缓冲寄存器,用于根据报文发送的进度通知数据总线向所述发送缓冲寄存器写入数据或执行报文发送后操作;

发送移位寄存器,连接所述发送缓冲寄存器,用于保存当前正在发送的报文字段;

第一时钟发生电路,用于基于系统时钟产生两个与系统时钟同频率且反相位的内部发送时钟,所述内部发送时钟为双沿时钟;

发送控制电路,分别连接所述第一时钟发生电路和所述发送移位寄存器,用于在所述内部发送时钟的驱动下将所述发送移位寄存器中的报文字段按位移至输出信号并同时产生发送时钟;

第一可编程延时链,连接所述发送控制电路,用于分别对所述输出信号和所述发送时钟进行设定延时输出。

2.根据权利要求1所述的数据传输电路,其特征在于,还包括:

第二可编程延时链,用于分别对输入信号和接收时钟进行设定延时输入;

第二时钟发生电路,连接所述第二可编程延时链,用于基于所述接收时钟产生两个与所述接收时钟同频率且反相位的内部接收时钟,所述内部接收时钟为双沿时钟;

接收控制电路,分别连接所述第二可编程延时链和所述第二时钟发生电路,用于在所述内部接收时钟的驱动下将所述输入信号上的报文字段按位移至接收移位寄存器中;

所述接收移位寄存器,连接所述接收控制电路,用于保存当前正在接收的报文字段;

接收缓冲寄存器,连接所述接收移位寄存器,用于存储已接收且待数据总线读取的报文信息;

接收中断电路,连接所述接收缓冲寄存器,用于根据报文接收的进度通知数据总线从所述接收缓冲寄存器中读取报文信息或执行报文接收后的操作;

第二CRC校验电路,分别连接所述接收中断电路和所述接收缓冲寄存器,用于对已接收报文中的数据字段进行CRC校验处理。

3.根据权利要求1所述的数据传输电路,其特征在于,所述发送移位寄存器包括发送移位寄存器XSHTA和发送移位寄存器XSHTB,所述发送移位寄存器XSHTA分别连接所述发送缓冲寄存器和所述发送控制电路,所述发送移位寄存器XSHTB分别连接所述发送缓冲寄存器和所述发送控制电路;

所述发送移位寄存器XSHTA用于保存当前正在发送的报文字段,所述发送移位寄存器XSHTB用于保存当前正在发送的数据字段。

4.根据权利要求1或3所述的数据传输电路,其特征在于,所述第一可编程延时链包括第一级延时链和第二级延时链,所述第一级延时链包括第一选择器和N个级联的第一延时单元,所述第二级延时链包括第二选择器和N个级联的第二延时单元;

所述第一选择器的各输入端分别连接各所述第一延时单元的输出端,所述第一选择器的输出端连接所述第二级延时链的输入端,所述第二选择器的各输入端分别连接各所述第二延时单元的输出端;

所述第一选择器用于控制信号从选定的所述第一延时单元输出,所述第二选择器用于控制信号从选定的所述第二延时单元输出。

5.根据权利要求2所述的数据传输电路,其特征在于,所述第二可编程延时链的结构与所述第一可编程延时链的结构相同。

6.根据权利要求2所述的数据传输电路,其特征在于,所述接收移位寄存器包括接收移位寄存器RSHTA和接收移位寄存器RSHTB,所述接收移位寄存器RSHTB分别连接所述接收缓冲寄存器和所述接收控制电路,所述接收移位寄存器RSHTA分别连接所述接收缓冲寄存器和所述接收控制电路;

所述接收移位寄存器RSHTA用于保存当前正在接收的报文字段,所述接收移位寄存器RSHTB用于保存当前正在接收的数据字段。

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