[实用新型]一种双时钟速率源同步主从串行通信系统有效
申请号: | 202220414616.3 | 申请日: | 2022-02-28 |
公开(公告)号: | CN218728775U | 公开(公告)日: | 2023-03-24 |
发明(设计)人: | 邢通;孙丽敬;季宇;刘晓娟;刘国宇;黄鹭鹭;高波;蔺圣杰;王海涛 | 申请(专利权)人: | 国网上海能源互联网研究院有限公司 |
主分类号: | G06F1/12 | 分类号: | G06F1/12;G06F13/42 |
代理公司: | 北京工信联合知识产权代理有限公司 11266 | 代理人: | 夏德政 |
地址: | 200131 上海市浦东新区中国(上海)自*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 一种 时钟 速率 同步 主从 串行 通信 系统 | ||
1.一种双时钟速率源同步主从串行通信系统,其特征在于,
所述系统包括主控制器以及从控制器,所述主控制器包括AD采样模块、主控制器FPGA芯片、DSP芯片和外接端口;
所述主控制器FPGA芯片用于FPGA高速通信和FPGA数据转换,所述FPGA高速通信为与功率模块的高速通信,包括5路高速RS232、5路高速RS485;FPGA数据转换包括模拟输入信号采样、模拟信号输出、数字信号的开入开出、与DSP进行数据通信、与ARM通信管理板卡进行指令交互、遥信遥测以及遥控遥调。
2.根据权利要求1所述的系统,其特征在于,
所述AD采样模块用于将采集获得的连续的模拟信号转换成离散的数字信号,将数字信号传输到主控制器FPGA芯片中。
3.根据权利要求1所述的系统,其特征在于,
所述外接端口用于连接DSP芯片与不同类型存储器。
4.根据权利要求1所述的系统,其特征在于,
所述主控制器FPGA芯片包括时序控制模块、主控制器FPGA的AD启动与读取模块、
所述时序控制模块用于为操作指令执行提供操作定时信号;
所述主控制器FPGA的AD启动与读取模块用于将模拟信号转换成数字信号传输给所述主控制器FPGA,或将所述主控制器FPGA输出的数字信号转换为模拟信号输出,下发给从控制器FPGA。
5.根据权利要求1所述的系统,其特征在于,
所述主控制器FPGA芯片还包括主控制器FPGA的XINTF通信模块;
所述主控制器FPGA的XINTF通信模块用于与DSP间的数据交互,上传AD采样模块获得的数据,并接受DSP发出的遥测、遥信和控制指令。
6.根据权利要求1所述的系统,其特征在于,
所述主控制器FPGA芯片还包括主控制器FPGA的异步通信发送模块、主控制器FPGA的异步通信接收模块以及变换器驱动模块;
所述主控制器FPGA的异步通信发送模块用于将主控制器FPGA数据发送给从控制器FPGA的异步通信接受模块;
所述主控制器FPGA的异步通信接受模块用于接收从控制器FPGA上传的数据和AD转换模块上传的数据;
所述变换器驱动模块用于将PWM驱动信号下发给变压器的功率开关管。
7.根据权利要求1所述的系统,其特征在于,
所述从控制器包括子模块控制器FPGA芯片;
所述子模块控制器FPGA芯片包括三角波生成模块、驱动信号模块;
所述三角波生成模块用于接收主控制器发出的同步信号,生成与主控制器统一的时序信号,为所述从控制器FPGA的AD启动与读取模块、所述从控制器FPGA的异步通信发送模块、所述从控制器FPGA的异步通信接收模块以及驱动信号模块提供时序信号。
8.根据权利要求7所述的系统,其特征在于,
所述子模块控制器FPGA芯片还包括从控制器FPGA的AD启动与读取模块;
所述从控制器FPGA的AD启动与读取模块用于将模拟信号转换成数字信号传输给子模块控制器FPGA芯片或将子模块控制器FPGA芯片输出的数字信号转换为模拟信号输出。
9.根据权利要求7所述的系统,其特征在于,
所述子模块控制器FPGA芯片还包括从控制器FPGA的异步通信发送模块、从控制器FPGA的异步通信接收模块以及驱动信号模块;
所述从控制器FPGA的异步通信发送模块用于将从控制器FPGA的信号发送给主控制器FPGA的异步通信接受模块;
所述从控制器FPGA的异步通信接受模块用于接收来自主控制器FPGA发送的数据和AD转换模块上传的数据;
所述驱动信号模块用于将PWM驱动信号下发给变压器的功率开关管。
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