[实用新型]处理器系统有效
申请号: | 202221834654.0 | 申请日: | 2022-07-15 |
公开(公告)号: | CN217767439U | 公开(公告)日: | 2022-11-08 |
发明(设计)人: | 甘良棋;刘杰;于志刚;刘晓蕾;任元军;沈博;冯秀妍;常飞凡;马文帅 | 申请(专利权)人: | 深圳电器公司 |
主分类号: | G06F15/78 | 分类号: | G06F15/78;G06F13/38;G06F1/06;G06F1/3287;G06F1/3296 |
代理公司: | 广州三环专利商标代理有限公司 44202 | 代理人: | 邱群 |
地址: | 518000 广*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 处理器 系统 | ||
1.一种处理器系统,其特征在于,所述处理器系统包括:
处理器;
存储模块,所述存储模块电连接所述处理器,用于存储数据,传输数据至所述处理器,以及接收并存储所述处理器处理后的数据;
振荡模块,所述振荡模块电连接所述处理器,用于输出时钟信号;
电源模块,所述电源模块包括电源以及电源管理电路,所述电源管理电路包括电源输入端口及多个电源输出端口,所述电源输入端口电连接所述电源,用于接收所述电源输入的电压,所述多个电源输出端口分别电连接至所述处理器上不同的接口,用于为所述处理器以及其它模块提供电压,所述电源管理电路还用于管理所述多个电源输出端口的开断和功率输出;以及
接口模块,所述接口模块电连接所述处理器,所述接口模块包括多种接口,用于连接所述处理器与外部设备。
2.如权利要求1所述的处理器系统,其特征在于,所述存储模块包括:
内嵌式存储器,所述内嵌式存储器电连接所述处理器,用于管理传输及存储的数据;以及
动态随机存储器,所述动态随机存储器电连接所述处理器,用于同步动态随机存取数据。
3.如权利要求1所述的处理器系统,其特征在于,所述振荡模块包括晶体电路及晶振电路,所述晶体电路用于产生第一时钟信号并输出至所述处理器;所述晶振电路用于产生第二时钟信号并输出至所述处理器。
4.如权利要求3所述的处理器系统,其特征在于,所述振荡模块具有第一输入端及第一输出端,所述晶体电路包括:
晶体,所述晶体包括第一端及第二端,所述第一端电连接所述第一输入端,所述第二端电连接所述第一输出端,所述晶体用于产生第一时钟信号,并经由所述第二端以及所述第一输出端输出至所述处理器;
第一电阻,所述第一电阻的一端电连接所述第一输入端,另一端电连接所述第一输出端;
第一电容,所述第一电容的一端电连接所述第一输入端,另一端接地;及
第二电容,所述第二电容的一端电连接所述第一输出端,另一端接地。
5.如权利要求4所述的处理器系统,其特征在于,所述振荡模块还具有第二输入端及第二输出端,所述晶振电路包括:
晶振芯片,所述晶振芯片具有输入引脚、输出引脚、第一接地引脚及第二接地引脚,所述输入引脚电连接至所述第二输入端,所述第一接地引脚及所述第二接地引脚均接地,所述晶振芯片用于产生第二时钟信号,并经由所述输出引脚及所述第二输出端输出至所述处理器;
第二电阻,所述第二电阻的一端电连接至所述输出引脚,另一端电连接至所述第二输出端;
第三电容,所述第三电容一端电连接至所述第二输入端,另一端接地;及
第四电容,所述第四电容的一端电连接所述输出引脚,另一端接地。
6.如权利要求5所述的处理器系统,其特征在于,所述处理器包括:
时钟芯片,所述时钟芯片电连接所述第一输出端用于接收所述第一时钟信号,并根据所述第一时钟信号进行计时;以及
内核,所述内核一端电连接所述第二输出端,用于接收所述第二时钟信号,所述内核的另一端电连接所述接口模块,用于将所述第二时钟信号输出至所述接口模块。
7.如权利要求1所述的处理器系统,其特征在于,所述接口模块包括:
同步串口,所述同步串口电连接所述处理器,用于外部设备与所述处理器之间的数据传输;
异步串口,所述异步串口电连接所述处理器,用于外部设备与所述处理器之间的数据传输;以及
USB接口,所述USB接口电连接所述处理器,用于连接外部设备。
8.如权利要求7所述的处理器系统,其特征在于,所述接口模块还包括:
网口,所述网口电连接所述处理器,用于连接网线。
9.如权利要求8所述的处理器系统,其特征在于,所述接口模块还包括
GUI接口,所述GUI接口电连接所述处理器,用于外部设备与所述处理器之间的GUI信号传输。
10.如权利要求1-9任意一项所述的处理器系统,其特征在于,所述处理器系统还包括:
连接器,所述连接器设于所述处理器与所述接口模块之间,用于电连接所述处理器与所述接口模块。
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