[发明专利]集成电路工艺方法以及集成电路产品有效
申请号: | 202310033741.9 | 申请日: | 2023-01-10 |
公开(公告)号: | CN115831766B | 公开(公告)日: | 2023-05-02 |
发明(设计)人: | 凌坚 | 申请(专利权)人: | 日月新半导体(昆山)有限公司 |
主分类号: | H01L21/48 | 分类号: | H01L21/48;H01L23/488 |
代理公司: | 北京律盟知识产权代理有限责任公司 11287 | 代理人: | 林斯凯 |
地址: | 215341 江苏省苏*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 集成电路 工艺 方法 以及 产品 | ||
1.一种集成电路工艺方法,其特征在于,包括:
在晶圆上形成第一光阻层;
对所述第一光阻层进行第一刻蚀工艺以形成第一图案化光阻层,所述第一图案化光阻层在对应到所述晶圆上的连接点的位置具有多个凹槽;
在所述多个凹槽中形成第一连接件;
在所述第一图案化光阻层上形成第二光阻层以覆盖所述第一连接件;
对所述第二光阻层进行第二刻蚀工艺以形成第二图案化光阻层,所述第二图案化光阻层暴露多个所述第一连接件的至少其中之一;以及
在暴露的所述第一连接件上形成金属以形成第二连接件。
2.根据权利要求1所述的集成电路工艺方法,其特征在于,对所述第二光阻层进行所述第二刻蚀工艺以形成所述第二图案化光阻层包括:
刻蚀第一区域内的所述第二光阻层以暴露所述第一区域下方的所述第一连接件以及所述第一光阻层。
3. 根据权利要求2所述的集成电路工艺方法,其特征在于,刻蚀所述第一区域内的所述第二光阻层包括:
在所述第一区域上方设置掩模板;以及
对所述第二光阻层进行曝光和显影以刻蚀所述第一区域内的所述第二光阻层。
4.根据权利要求1所述的集成电路工艺方法,其特征在于,在暴露的所述第一连接件上形成金属以形成所述第二连接件包括:
在所述第一图案化光阻层和所述第一连接件合围的凹槽中形成金属以形成所述第二连接件。
5.根据权利要求2所述的集成电路工艺方法,其特征在于,对所述第二光阻层进行所述第二刻蚀工艺以形成所述第二图案化光阻层还包括:
保留第二区域内的所述第二光阻层,其中所述第二区域下方包括多个所述第一连接件。
6.根据权利要求5所述的集成电路工艺方法,其特征在于,还包括:
去除所述第二图案化光阻层以及所述第一图案化光阻层以暴露所述第一区域下方的所述第二连接件和所述第二区域下方的所述第一连接件。
7.根据权利要求1所述的集成电路工艺方法,其特征在于,在所述多个凹槽中形成所述第一连接件包括:
以电镀方式在所述多个凹槽中形成所述第一连接件。
8.根据权利要求1所述的集成电路工艺方法,其特征在于,在暴露的所述第一连接件上形成金属以形成所述第二连接件包括:
以电镀方式在暴露的所述第一连接件上形成金属。
9.根据权利要求1所述的集成电路工艺方法,其特征在于,所述晶圆包括数个电路单元,所述电路单元上包括第一区域及第二区域,所述第二区域包围所述第一区域,所述第一区域是矩形区域,所述第一区域包括经配置以形成所述第二连接件的多个第一位置,所述第二区域包括经配置以形成所述第一连接件的多个第二位置,所述第一位置到所述第一区域的边界的最近垂直距离大于等于4微米并小于等于所述第一位置与所述第二区域中距离所述第一位置最近的所述第二位置的垂直间距减去3微米。
10.根据权利要求1所述的集成电路工艺方法,其特征在于,所述晶圆包括数个电路单元,所述电路单元上包括第一区域及第二区域,所述第二区域包围所述第一区域,所述第一区域是矩形区域,所述第二区域中不包括用以形成连接件的位置,所述第一区域中包括经配置以形成所述第二连接件的第一位置,所述第一位置到所述第一区域的边界的最近垂直距离大于等于4微米并小于等于所述第一位置到所述电路单元的边界的最近垂直距离减去15微米。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
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