[发明专利]存储资源池结构、存储资源的动态管理方法和服务器在审

专利信息
申请号: 202310076595.8 申请日: 2023-02-02
公开(公告)号: CN116301590A 公开(公告)日: 2023-06-23
发明(设计)人: 朱保彬 申请(专利权)人: 苏州浪潮智能科技有限公司
主分类号: G06F3/06 分类号: G06F3/06;G06F13/40;G06F13/42;G06F1/3234
代理公司: 北京路浩知识产权代理有限公司 11002 代理人: 杨明月
地址: 215128 江苏省苏州*** 国省代码: 江苏;32
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摘要:
搜索关键词: 存储 资源 结构 动态 管理 方法 服务器
【权利要求书】:

1.一种存储资源池结构,其特征在于,包括:光电转换模块,连接模块,背板,硬盘和动态管理模块,

其中,所述光电转换模块通过光纤与高速串行总线开关板连接,所述光电转换模块用于将来自所述高速串行总线开关板的第一光信号转换成高速串行总线信号,或者,将来自硬盘的电信号转换成第二光信号;

所述连接模块用于连接所述光电转换模块和所述背板;

所述背板上安插有多个所述硬盘;

所述光电转换模块还用于对所述第一光信号或第二光信号进行检测,输出光电检测信号;

所述动态管理模块用于基于所述光电检测信号,确定高速串行总线信号的访问状态,基于所述访问状态对所述硬盘的功耗进行动态管理。

2.根据权利要求1所述的存储资源池结构,其特征在于,所述光电转换模块包括:接收机,第一阵列光栅,第一光电转换单元,数据解码单元,数据编码单元,第二光电转换单元,第二阵列光栅以及光电检测单元,

其中,所述接收机用于对来自所述高速串行总线开关板的第一光信号进行放大或衰减处理,并将处理后的第一光信号发送至所述第一阵列光栅,所述第一阵列光栅用于将所述处理后的第一光信号分成多个链路lane的光信号,并发送至所述第一光电转换单元,所述第一光电转换单元用于将所述多个lane的光信号转换成第一电信号,并输出所述第一电信号至所述数据解码单元,所述数据解码单元用于对所述第一电信号进行解码,得到所述高速串行总线信号;

所述数据编码单元用于接收来自硬盘的电信号,对所述高速电信号进行编码,生成第二电信号,并将所述第二电信号发送至第二光电转换单元,所述第二光电转换单元用于将所述第二电信号转换成多个lane的光信号,并通过所述第二阵列光栅将所述多个lane的光信号合成为第二光信号,输出所述第二光信号;

所述光电检测单元用于对所述第一光信号或第二光信号进行检测,输出光电检测信号。

3.根据权利要求2所述的存储资源池结构,其特征在于,所述光电检测单元包括:光电检测二极管和跨阻放大器,

其中,所述光电检测二极管用于将对应lane的光信号转换成电流信号;

所述跨阻放大器用于将所述电流信号转换成光电检测信号,并输出所述光电检测信号。

4.根据权利要求3所述的存储资源池结构,其特征在于,所述动态管理模块包括:模拟数字转换器、主板管理控制模块和电子保险丝,

所述模拟数字转换器用于将所述光电检测信号转换成数字信号,并输入至所述主板管理控制模块;

所述主板管理控制模块用于对所述数字信号进行检测,确定高速串行总线信号的访问状态,并根据所述高速串行总线信号的访问状态控制所述电子保险丝的通断;

所述电子保险丝通过电缆与背板连接,用于对所述硬盘的电压进行关闭或打开。

5.根据权利要求4所述的存储资源池结构,其特征在于,所述主板管理控制模块,包括:主板管理控制器和复杂可编程逻辑器件CPLD,

其中,所述主板管理控制器用于对所述数字信号进行检测,确定高速串行总线信号的访问状态,并根据所述高速串行总线信号的访问状态向CPLD发送控制指令;

所述CPLD用于接收所述控制指令,输出电平信号,以控制所述电子保险丝的通断。

6.根据权利要求1所述的存储资源池结构,其特征在于,所述连接模块包括:时钟数据恢复单元和线缆连接器,

其中,所述时钟数据恢复单元用于对所述高速串行总线信号进行整形以实现时钟数据恢复,并将经过整形的高速串行总线信号输出至所述线缆连接器;

所述线缆连接器用于通过电缆将所述经过整形的高速串行总线信号输出至所述背板;

所述线缆连接器还用于接收所述背板输出的来自硬盘的电信号,将所述来自硬盘的电信号输出至所述时钟数据恢复单元;

所述时钟数据恢复单元,还用于对所述来自硬盘的电信号进行整形,输出整形后的电信号至所述光电转换模块。

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