[其他]具有向后接脚相容性的大规模集成电路微处理机芯片无效
申请号: | 85105002 | 申请日: | 1985-07-01 |
公开(公告)号: | CN85105002A | 公开(公告)日: | 1987-03-11 |
发明(设计)人: | 纳英奥;布雷德利 | 申请(专利权)人: | 霍尼韦尔资料系统有限公司 |
主分类号: | G06F13/00 | 分类号: | G06F13/00;H01L49/00 |
代理公司: | 中国专利代理有限公司 | 代理人: | 李先春 |
地址: | 美国马萨诸*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 具有 向后 相容性 大规模集成电路 微处理机 芯片 | ||
1、一以先进技术制造且用于多数计算机系统的第一个的集成电路微处理机芯片,该芯片包括:
多数外接脚;
许多功能区被互相连接以担任处理操作,至少有一该功能区提供的功能未存于该系统的第二个,该功能区被连接到该系统的该第二个中未使用的外接脚之一;
一相容性装置,被连接到该功能区,及连接到该另一区以及连接到在该第二系统中未使用的该另一外接脚,该相容性装置在该芯片被包括入该第二系统时用以使该功能区除能,且限定该另一区在该第二系统中以与其所代替的芯片的同样方式但以由所说先进技术而获得的较高的速度和性能来操作。
2、如权利要求第1项所述的芯片,其中所说相容性装置,当该芯片被包括入该第一系统中时,使该功能区致能区致能且限定该其他区以用该新功能来操作。
3、如权利要求第1项所述的芯片,其中该功能区为一记忆处理区用以将虚位址转译成实位址,并提供一增加的实位址空间。
4、如权利要求第3项所述的芯片,其中该记忆处理区是连接到一所说外接脚以接收和产生一额外的位址位元以提供该增加的实位址空间。
5、如权利要求第2项所述的芯片,其中所说其他区包括一被连接到该相容性装置和连接到该功能区的误差探测区。该误差探测区在该相容性装置所选定的第一组或第二组条件下用以产生一输出信号以表示一非法存取,该相容性装置是作为该芯片所在系统中的功能。
6、如权利要求第5项所述的芯片,其中所说其他区包括一记忆控制区,该记忆控制区被连接到该相容性装置和连接到一用以防止定址一未用源的该外接脚,该误差探测区限定该记忆控制区以根据该来自该误差探测区的未用源信号来产生信号。
7、如权利要求第5项所述的芯片,其中该相容性装置包括:
一电压源和门控装置,具有至少一对输入端和一输出端,该输入端之一被连接到该一外接脚与该电压源相同,该另一输入端被连接到该功能区的一输出,且该输出端被连接到该误差探测区,当芯片被安装在该第二系统时,该门控装置则被致能以限制该误差探测区并产生该输出信号来回应代表该第一组条件的信号,而当该芯片被安装在第一系统时该门控装置则被除能以产生该输出信号来回应代表该第二组条件的信号。
8、如权利要求第7项所述的芯片,其中该功能区包括一加法器且该输出对应于该加法器的最高效位元,该加法器被连接以便将一进位信号施加到该误差探测区,该门控装置当被致能时则施加该最高效位元与代表该第一组条件的该进位信号,而该门控装置当被除能时,则禁止代表该第二组条件的该最高效位元的应用。
9、如权利要求第8项所述的芯片,其中该门控装置包括一AND(与)门且该芯片是以具有该较高速度和性能的最新技术的MOSFET来制造。
10、一以产生高性能和低成本的新技术制造且用于一新计算机系统的集成电路微处理机芯片,该芯片包括:
许多外接脚;
许多功能区被互相连接以担任处理操作,至少有一该功能区提供的功能未存于现有系统中,该功能区被连接到该现有系统中未使用的外接脚之一;
一相容性装置,被连接到该功能区,及连接到该其他区以及连接到在该现有系统中未使用的该另一外接脚;该相容性装置在该芯片被无改变地安装入该现有系统时是用以使该功能区除能,且限定该其他区以在该现有系统中以产生与它先前的芯片同样的回应并提供较高的性能和较低的成本。
11、如权利要求第10项所述的芯片,其中该相容性装置,当该芯片被安装入该新系统中时,则使该功能区致能且限定该其他区用该新功能来操作。
12、如权利要求第10项所述的芯片,其中该功能区为一记忆处理区用以将虚位址转译成实位址,并且提供一增加的实位址空间。
13、如权利要求第12项所述的芯片,其中该记忆处理区是连接到一该外接脚以接收和产生一额外的位址位元以提供该增加的实位址空间。
14、如权利要求第11项所述的芯片,其中所说其他区包括一误差探测区,该误差探测区被连接到该相容性装置和连接到该功能区,该误差探测区在该相容性装置的控制下的第一或第二组条件下用以产生一未用源信号以表示一非法存取,该相容性装置是作为该芯片所在系统中的一功能。
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