[其他]波形成型电路无效
申请号: | 86100810 | 申请日: | 1986-02-13 |
公开(公告)号: | CN86100810A | 公开(公告)日: | 1986-08-13 |
发明(设计)人: | 小岛雄一;千叶芳之 | 申请(专利权)人: | 索尼公司 |
主分类号: | H04L25/03 | 分类号: | H04L25/03 |
代理公司: | 中国专利代理有限公司 | 代理人: | 肖春京 |
地址: | 日本东京都品*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 波形 成型 电路 | ||
1、用于一数字信号传输装置的波形成形电路其特征包括:
a)具有一数字数据输入端和第一、第二两组输出的N级移位寄存器,要成形的波形数字数据供给上述数字数据输入端;
b)具有若干个地址控制端及一输出端的一第一只读存贮器;
c)具有若干个地址控制端及一输出端的一第二只读存贮器;
d)电路装置用于将第一只读存贮器的各个地址控制端连接到移位寄存器的第一组输出端,以及用于连接第二只读存贮器的各个地址控制端到移位寄存器的第二组输出端;
e)加法器装置,具有输入端被连接到上述第一和第二只读存贮器的输出端,以及有一输出端用于产生一数字输出信号,该信号是上述第一和第二只读存贮器输出相加的数字信号;
f)来自加法器装置的数字输出信号提供给-D/A(数到模)转换器,以至根据数字数据产生一成形的波形输出信号。
2、根据权利要求1的波形成形电路,其特征在于上述第一和第二只读存贮器的地址控制端数相互是等同的。
3、根据权利要求1的波形成形电路,其特征在于上述移位寄存器和D/A转换器由一与时钟脉冲信号相同的频率所提供。
4、根据权利要求1的波形成形电路,上述第一和第二只读存贮器的每一表含有一同样的字长。
5、用于一数字信号转输装置的波形成形电路其特征包括:
a)具有一数字数据输入端和第一与第二组输出端的第一N级移位寄存器,一要成形的波形数字数据提供给所说的数字数据输入端;
b)第一只读存贮器有若干个地址控制端和一输出端;
c)第二只读存贮器有若干个地址控制端和一输出端;
d)电路装置用于连接第一只读存贮器的各个地址控制端到上述移位寄存器的第一组输出端,以及用于连接第二只读存贮器的各个地址控制端到移位寄存器的第二组输出端;
e)第一加法装置,具有输入端连接到第一和第二只读存贮器的输出端,以及产生一数字输出信号的一输出端,该输出信号为第一和第二只读存贮器输出的相加数字信号;
f)具有一数字数据输入端和第一、第二组输出端的一第二N级移位寄存器,数字数据提供给所述的数字数据输入端;
g)一第三只读存贮器有若干个地址控制端和一输出端;
h)一第四只读存贮器有若干个地址控制端和一输出端;
i)第二加法器装置,有若干输入端连接到第三和第四只读存贮器的输出端以及用于产生一数字输出信号的输出端,该输出信号为第三和第四只读存贮器输出的相加数字信号;
j)第三加法器装置,具有若干输入端连接到第一和第二加法器的输出端以及用于产生一数字输出信号的一输出端;
k)一D/A(数到模)转换器由来自第三加法器的数字输出信号来提供以至根据上述数字数据产生一成形的波形输出信号。
6、根据权利要求5的一波形成形电路,第一到第四只读存贮器的地址控制端的数量彼此之间相等。
7、根据权利要求5中的波形成形电路,上述第一和第二移位寄存器的信号由具有相反相位的时钟脉冲来提供。
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